JAJSCO3C August   2016  – June 2017 ADS124S06 , ADS124S08

PRODUCTION DATA.  

  1. 1 特長
  2. 2 アプリケーション
  3. 3 概要
  4. 4 改訂履歴
  5. 5 Device Family Comparison Table
  6. 6 Pin Configuration and Functions
  7. 7 Specifications
    1. 7.1 Absolute Maximum Ratings
    2. 7.2 ESD Ratings
    3. 7.3 Recommended Operating Conditions
    4. 7.4 Thermal Information
    5. 7.5 Electrical Characteristics
    6. 7.6 Timing Characteristics
    7. 7.7 Switching Characteristics
    8. 7.8 Typical Characteristics
  8. 8 Parameter Measurement Information
    1. 8.1 Noise Performance
  9. 9 Detailed Description
    1. 9.1 Overview
    2. 9.2 Functional Block Diagram
    3. 9.3 Feature Description
      1. 9.3.1  Multiplexer
      2. 9.3.2  Low-Noise Programmable Gain Amplifier
        1. 9.3.2.1 PGA Input-Voltage Requirements
        2. 9.3.2.2 PGA Rail Flags
        3. 9.3.2.3 Bypassing the PGA
      3. 9.3.3  Voltage Reference
        1. 9.3.3.1 Internal Reference
        2. 9.3.3.2 External Reference
        3. 9.3.3.3 Reference Buffers
      4. 9.3.4  Clock Source
      5. 9.3.5  Delta-Sigma Modulator
      6. 9.3.6  Digital Filter
        1. 9.3.6.1 Low-Latency Filter
          1. 9.3.6.1.1 Low-Latency Filter Frequency Response
          2. 9.3.6.1.2 Data Conversion Time for the Low-Latency Filter
        2. 9.3.6.2 Sinc3 Filter
          1. 9.3.6.2.1 Sinc3 Filter Frequency Response
          2. 9.3.6.2.2 Data Conversion Time for the Sinc3 Filter
        3. 9.3.6.3 Note on Conversion Time
        4. 9.3.6.4 50-Hz and 60-Hz Line Cycle Rejection
        5. 9.3.6.5 Global Chop Mode
      7. 9.3.7  Excitation Current Sources (IDACs)
      8. 9.3.8  Bias Voltage Generation
      9. 9.3.9  System Monitor
        1. 9.3.9.1 Internal Temperature Sensor
        2. 9.3.9.2 Power Supply Monitors
        3. 9.3.9.3 Burn-Out Current Sources
      10. 9.3.10 Status Register
        1. 9.3.10.1 POR Flag
        2. 9.3.10.2 RDY Flag
        3. 9.3.10.3 PGA Output Voltage Rail Monitors
        4. 9.3.10.4 Reference Monitor
      11. 9.3.11 General-Purpose Inputs and Outputs (GPIOs)
      12. 9.3.12 Low-Side Power Switch
      13. 9.3.13 Cyclic Redundancy Check (CRC)
      14. 9.3.14 Calibration
        1. 9.3.14.1 Offset Calibration
        2. 9.3.14.2 Gain Calibration
    4. 9.4 Device Functional Modes
      1. 9.4.1 Reset
        1. 9.4.1.1 Power-On Reset
        2. 9.4.1.2 RESET Pin
        3. 9.4.1.3 Reset by Command
      2. 9.4.2 Power-Down Mode
      3. 9.4.3 Standby Mode
      4. 9.4.4 Conversion Modes
        1. 9.4.4.1 Continuous Conversion Mode
        2. 9.4.4.2 Single-Shot Conversion Mode
        3. 9.4.4.3 Programmable Conversion Delay
    5. 9.5 Programming
      1. 9.5.1 Serial Interface
        1. 9.5.1.1 Chip Select (CS)
        2. 9.5.1.2 Serial Clock (SCLK)
        3. 9.5.1.3 Serial Data Input (DIN)
        4. 9.5.1.4 Serial Data Output and Data Ready (DOUT/DRDY)
        5. 9.5.1.5 Data Ready (DRDY)
        6. 9.5.1.6 Timeout
      2. 9.5.2 Data Format
      3. 9.5.3 Commands
        1. 9.5.3.1  NOP
        2. 9.5.3.2  WAKEUP
        3. 9.5.3.3  POWERDOWN
        4. 9.5.3.4  RESET
        5. 9.5.3.5  START
        6. 9.5.3.6  STOP
        7. 9.5.3.7  SYOCAL
        8. 9.5.3.8  SYGCAL
        9. 9.5.3.9  SFOCAL
        10. 9.5.3.10 RDATA
        11. 9.5.3.11 RREG
        12. 9.5.3.12 WREG
      4. 9.5.4 Reading Data
        1. 9.5.4.1 Read Data Direct
        2. 9.5.4.2 Read Data by RDATA Command
        3. 9.5.4.3 Sending Commands When Reading Data
      5. 9.5.5 Interfacing with Multiple Devices
    6. 9.6 Register Map
      1. 9.6.1 Configuration Registers
        1. 9.6.1.1  Device ID Register (address = 00h) [reset = xxh]
        2. 9.6.1.2  Device Status Register (address = 01h) [reset = 80h]
        3. 9.6.1.3  Input Multiplexer Register (address = 02h) [reset = 01h]
        4. 9.6.1.4  Gain Setting Register (address = 03h) [reset = 00h]
        5. 9.6.1.5  Data Rate Register (address = 04h) [reset = 14h]
        6. 9.6.1.6  Reference Control Register (address = 05h) [reset = 10h]
        7. 9.6.1.7  Excitation Current Register 1 (address = 06h) [reset = 00h]
        8. 9.6.1.8  Excitation Current Register 2 (address = 07h) [reset = FFh]
        9. 9.6.1.9  Sensor Biasing Register (address = 08h) [reset = 00h]
        10. 9.6.1.10 System Control Register (address = 09h) [reset = 10h]
        11. 9.6.1.11 Offset Calibration Register 1 (address = 0Ah) [reset = 00h]
        12. 9.6.1.12 Offset Calibration Register 2 (address = 0Bh) [reset = 00h]
        13. 9.6.1.13 Offset Calibration Register 3 (address = 0Ch) [reset = 00h]
        14. 9.6.1.14 Gain Calibration Register 1 (address = 0Dh) [reset = 00h]
        15. 9.6.1.15 Gain Calibration Register 2 (address = 0Eh) [reset = 00h]
        16. 9.6.1.16 Gain Calibration Register 3 (address = 0Fh) [reset = 40h]
        17. 9.6.1.17 GPIO Data Register (address = 10h) [reset = 00h]
        18. 9.6.1.18 GPIO Configuration Register (address = 11h) [reset = 00h]
  10. 10Application and Implementation
    1. 10.1 Application Information
      1. 10.1.1 Serial Interface Connections
      2. 10.1.2 Analog Input Filtering
      3. 10.1.3 External Reference and Ratiometric Measurements
      4. 10.1.4 Establishing a Proper Input Voltage
      5. 10.1.5 Unused Inputs and Outputs
      6. 10.1.6 Pseudo Code Example
    2. 10.2 Typical Application
      1. 10.2.1 Design Requirements
      2. 10.2.2 Detailed Design Procedure
        1. 10.2.2.1 Register Settings
      3. 10.2.3 Application Curves
    3. 10.3 Do's and Don'ts
  11. 11Power Supply Recommendations
    1. 11.1 Power Supplies
    2. 11.2 Power-Supply Sequencing
    3. 11.3 Power-On Reset
    4. 11.4 Power-Supply Decoupling
  12. 12Layout
    1. 12.1 Layout Guidelines
    2. 12.2 Layout Example
  13. 13デバイスおよびドキュメントのサポート
    1. 13.1 デバイス・サポート
      1. 13.1.1 開発サポート
    2. 13.2 ドキュメントのサポート
      1. 13.2.1 関連資料
    3. 13.3 関連リンク
    4. 13.4 ドキュメントの更新通知を受け取る方法
    5. 13.5 コミュニティ・リソース
    6. 13.6 商標
    7. 13.7 静電気放電に関する注意事項
    8. 13.8 Glossary
  14. 14メカニカル、パッケージ、および注文情報

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

1 特長

  • 低消費電力: 280µA
  • 低ノイズPGA: 19nVRMS(ゲイン = 128)
  • プログラマブル・ゲイン: 1～128
  • プログラマブル・データ・レート: 2.5SPS～4kSPS
  • 低レイテンシ・デジタル・フィルタによる50Hzおよび60Hzの同時リジェクション(20 SPS以下)
  • 12個(ADS124S08)または 6個(ADS124S06)の個別選択可能な入力を持つアナログ・マルチプレクサ
  • センサ励起のためのデュアル・マッチのプログラム可能電流源: 10µA～2000µA
  • 内部リファレンス: 2.5V、最大ドリフト10ppm/℃
  • 内部オシレータ: 4.096MHz、1.5%精度
  • 内部温度センサ
  • 機能拡張された障害検出回路
  • セルフ・オフセットおよびシステム較正
  • 4つの汎用I/O
  • オプションCRC付きSPI互換インターフェイス
  • アナログ電源: ユニポーラ(2.7V～5.25V)またはバイポーラ(±2.5V)
  • デジタル電源: 2.7V～3.6V
  • 動作温度範囲: -50℃～+125℃

2 アプリケーション

  • センサ・トランスデューサおよびトランスミッタ:
    温度、圧力、歪み、フロー
  • PLCおよびDCSアナログ入力モジュール
  • 温度コントローラ
  • 人工気象室、産業用オーブン

3 概要

ADS124S06およびADS124S08は高精度の24ビット、デルタ-シグマ(ΔΣ)、アナログ/デジタル・コンバータ(ADC)です。低い消費電力と多くの内蔵機能で、小信号を測定するセンサ・アプリケーションのシステム・コストと部品点数を削減できます。

これらのADCは、ノイズの多い産業用環境で使用できる
よう、50Hzまたは60Hzのリジェクションと低レイテンシの変換結果を実現する、構成可能なデジタル・フィルタを備えています。低ノイズのPGA (プログラマブル・ゲイン・アンプ)は、1～128のゲインを提供し、抵抗ブリッジや熱電対アプリケーション用に低レベルの信号を増幅します。また、プリント回路基板(PCB)の面積を削減する低ドリフトの2.5Vリファレンスを備えています。さらに、2つのプログラム可能励起電流源(IDAC)により、高精度なRTDバイアスを簡単に実現できます。

入力マルチプレクサは、ADS124S08では12個、ADS124S06では6個の入力をサポートしており、これらの入力は自由に組み合わせてADCに接続できるため、柔軟な設計が可能です。また、センサの過熱故障検出、熱電対用電圧バイアス、システム・モニタリング、4つの汎用I/Oを備えています。

リードレスVQFN-32またはTQFP-32パッケージで提供されます。

製品情報

発注型番 パッケージ (ピン) 本体サイズ
ADS124S0x TQFP (32) 5.0mm×5.0mm
VQFN (32) 5.0mm×5.0mm

機能ブロック図

ADS124S06 ADS124S08 ai_fbd_sbas660.gif