JAJSIH0B July 2020 – June 2021 DRV8106-Q1
PRODUCTION DATA
デバイスごとのパッケージ図は、PDF版データシートをご参照ください。
図 7-4 は、ハーフブリッジ・ゲート・ドライバ・アーキテクチャの高レベル機能ブロック図を示しています。ゲート・ドライバ・ブロックは、MOSFET 制御、フィードバック、保護のための各種機能を提供します。これには、可変駆動電流、制御ロジック・レベル・シフタ、VDS、および VGS フィードバック・コンパレータ、ハイサイド・ツェナー・クランプ、パッシブ / アクティブ・プルダウン抵抗を持つ、相補型のプッシュプル・ハイサイド / ローサイド・ゲート・ドライバが含まれています。