JAJSKX0 April 2020 – December 2020 DRV8955
PRODUCTION DATA
ピン | 種類 | 説明 | ||
---|---|---|---|---|
名前 | PWP | RGE | ||
IN1 | 25 | 20 | I | PWM 入力。ハーフブリッジ 1 の状態をロジック制御します。内部プルダウン。 |
IN2 | 24 | 19 | I | PWM 入力。ハーフブリッジ 2 の状態をロジック制御します。内部プルダウン。 |
IN3 | 23 | 18 | I | PWM 入力。ハーフブリッジ 3 の状態をロジック制御します。内部プルダウン。 |
IN4 | 22 | 17 | I | PWM 入力。ハーフブリッジ 4 の状態をロジック制御します。内部プルダウン。 |
OUT1 | 4, 5 | 3 | O | ハーフブリッジ 1 の出力。 |
OUT2 | 6, 7 | 4 | O | ハーフブリッジ 2 の出力。 |
OUT3 | 10, 11 | 6 | O | ハーフブリッジ 3 の出力。 |
OUT4 | 8, 9 | 5 | O | ハーフブリッジ 4 の出力。 |
VREF12/EN3 | 18 | 13 | I | MODE ピンが 0、1、またはハイ・インピーダンスの場合、このピンは基準電圧入力ピンとして機能し、ハーフブリッジ 1 および 2 の電流レベルを制御します。330k の抵抗を MODE ピンとグランドの間に接続すると、このピンのロジック High によって OUT3 がイネーブルになります。 |
VREF34/EN4 | 17 | 12 | I | MODE ピンが 0、1、またはハイ・インピーダンスの場合、このピンは基準電圧入力ピンとして機能し、ハーフブリッジ 3 および 4 の電流レベルを制御します。330k の抵抗を MODE ピンとグランドの間に接続すると、このピンのロジック High によって OUT4 がイネーブルになります。 |
RSVD/EN1 | 20 | 15 | - | MODE ピンが 0、1、またはハイ・インピーダンスの場合、このピンは未接続のままにしてください。330k の抵抗を MODE ピンとグランドの間に接続すると、このピンでロジック HIGH になると OUT1 がイネーブルになります。 |
MODE | 21 | 16 | I | MODE ピンの電圧により、個々のハーフブリッジの並列接続を選択するか、ブリッジの独立したハイ・インピーダンス動作を選択します。MODE が 0 のとき、 4 つの独立したソレノイド負荷を駆動できます。MODE が 1 のとき、ハーフブリッジのペアを並列接続することで、 2 つのソレノイド負荷を高い出力電流で駆動できます。MODEがオープンのときは、すべてのハーフブリッジが並列になり、単一のソレノイド負荷が駆動されます。330k の抵抗を MODE とグランドの間に接続すると、独立したハイ・インピーダンス動作がイネーブルになり、各ハーフ・ブリッジ出力を個別にイネーブルまたはディセーブルにすることができます。 |
CPH | 28 | 23 | PWR | チャージ・ポンプのスイッチング・ノード。X7R、0.022μF、VM 定格セラミック・コンデンサを CPH と CPL の間に接続します。 |
CPL | 27 | 22 | ||
GND | 14 | 9 | PWR | デバイスのグランド。システム・グランドに接続します。 |
TOFF/EN2 | 19 | 14 | I | MODE ピンが 0、1、またはハイ・インピーダンスの場合、このピンは、電流チョッピング中のオフ時間を設定します。330k の抵抗を MODE と グランド の間に接続すると、このピンのロジック High によって OUT2 がイネーブルになります。 |
DVDD | 15 | 10 | PWR | ロジック電源電圧。X7R、0.47µF~1µF、6.3V または 10V 定格セラミック・コンデンサを GND との間に接続します。 |
VCP | 1 | 24 | O | チャージ・ポンプの出力。X7R、0.22μF、16V セラミック・コンデンサを VM との間に接続します。 |
VM | 2, 13 | 1, 8 | PWR | 電源。電源電圧に接続し、VM 定格の 2 つの 0.01µF セラミック・コンデンサ (各ピンに 1 つずつ) と 1 つのバルク・コンデンサを使用して PGND にバイパスします。 |
PGND | 3, 12 | 2, 7 | PWR | 電源グランド。システム・グランドに接続します。 |
nFAULT | 16 | 11 | O | フォルト通知。フォルト条件により論理 Low に駆動されます。オープン・ドレイン出力には外部プルアップ抵抗が必要です。 |
nSLEEP | 26 | 21 | I | スリープ・モード入力。論理 High でデバイスをイネーブル。論理 Low で低消費電力スリープ・モードに移行。内部プルダウン抵抗。 |
PAD | - | - | - | サーマル・パッド。システム・グランドに接続します。 |