JAJSI56B September   2016  – October 2019 DS280BR820

PRODUCTION DATA.  

  1. 1 特長
  2. 2 アプリケーション
  3. 3 概要
    1.     概略回路図
  4. 4 改訂履歴
  5. 5 Pin Configuration and Functions
    1.     Pin Functions
  6. 6 Specifications
    1. 6.1 Absolute Maximum Ratings
    2. 6.2 ESD Ratings
    3. 6.3 Recommended Operating Conditions
    4. 6.4 Thermal Information
    5. 6.5 Electrical Characteristics
    6. 6.6 Electrical Characteristics – Serial Management Bus Interface
    7. 6.7 Timing Requirements – Serial Management Bus Interface
    8. 6.8 Typical Characteristics
  7. 7 Detailed Description
    1. 7.1 Overview
    2. 7.2 Functional Block Diagram
    3. 7.3 Feature Description
      1. 7.3.1 Device Data Path Operation
      2. 7.3.2 AC-Coupled Receiver Inputs
      3. 7.3.3 Signal Detect
      4. 7.3.4 2-Stage CTLE
      5. 7.3.5 Driver DC Gain Control
      6. 7.3.6 FIR Filter (Limiting Mode)
      7. 7.3.7 Configurable SMBus Address
    4. 7.4 Device Functional Modes
      1. 7.4.1 SMBus Slave Mode Configuration
      2. 7.4.2 SMBus Master Mode Configuration (EEPROM Self Load)
    5. 7.5 Programming
      1. 7.5.1 Transfer of Data with the SMBus Interface
    6. 7.6 Register Maps
      1. 7.6.1 Register Types: Global, Shared, and Channel
      2. 7.6.2 Global Registers: Channel Selection and ID Information
        1. Table 2. Global Register Map
      3. 7.6.3 Shared Registers
        1. Table 3. Shared Register Map
      4. 7.6.4 Channel Registers
        1. Table 4. Channel Register Map
  8. 8 Application and Implementation
    1. 8.1 Application Information
    2. 8.2 Typical Applications
      1. 8.2.1 Backplane and Mid-Plane Reach Extension
        1. 8.2.1.1 Design Requirements
        2. 8.2.1.2 Detailed Design Procedure
      2. 8.2.2 Front-Port Applications
        1. 8.2.2.1 Design Requirements
        2. 8.2.2.2 Detailed Design Procedure
      3. 8.2.3 Application Curves
        1. 8.2.3.1 Pattern Generator Characteristics
        2. 8.2.3.2 Equalizing Moderate Pre-Channel Loss
        3. 8.2.3.3 Equalizing High Pre-Channel Loss
        4. 8.2.3.4 Equalizing High Pre-Channel Loss and Moderate Post-Channel Loss
        5. 8.2.3.5 Output in FIR Limiting Mode with 16T Pattern
    3. 8.3 Initialization Set Up
  9. 9 Power Supply Recommendations
  10. 10Layout
    1. 10.1 Layout Guidelines
    2. 10.2 Layout Examples
      1. 10.2.1 Stripline Example
      2. 10.2.2 Microstrip Example
  11. 11デバイスおよびドキュメントのサポート
    1. 11.1 ドキュメントのサポート
      1. 11.1.1 関連資料
    2. 11.2 ドキュメントの更新通知を受け取る方法
    3. 11.3 商標
    4. 11.4 静電気放電に関する注意事項
    5. 11.5 Glossary

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

3 概要

DS280BR820は非常に消費電力が低く高パフォーマンスの8チャネル・リニア・イコライザーで、マルチレート、マルチプロトコルで最大28Gbpsのインターフェイスをサポートします。バックプレーン、フロントポート、チップ・ツー・チップのアプリケーションにおいて、高速シリアル・リンクの到達範囲を拡張し、堅牢性を強化するために使用されます。

DS280BR820の均等化の直線性から、送信信号の特性が保持され、ホストとリンク・パートナーのASICとが、送信イコライザーの係数を自由にネゴシエーションできるようになります(100G-CR4/KR4)。このリンク・トレーニング・プロトコルへの透過性により、レイテンシへの影響を最小限に抑えながら、システム・レベルの相互運用性を向上できます。各チャネルは独立に動作するため、DS280BR820は個別のレーン・フォワード・エラー訂正(FEC)パススルーをサポートできます。

DS280BR820はパッケージの寸法が小さく、高速信号エスケープが最適化され、Retimerポートフォリオとピン互換なため、高密度のバックプレーン・アプリケーションに理想的です。単純化された均等化制御、低い消費電力、非常に低い付加的ジッタから、100G-SR4/LR4/CR4などのフロントポート・インターフェイスに適しています。8mm x 13mm と占有面積が小さいため、QSFP、SFP、CFP2、CFP4、CDFP など各種の標準フロントポート・コネクタに簡単に収まり、ヒートシンクの必要もありません。

ACカップリング・コンデンサ(RX側)が内蔵されているため、PCB上に外付けのコンデンサが必要ありません。DS280BR820は単一電源で、必要な外部コンポーネントも最小限です。これらの特長により、PCBの配線の複雑性と、部品表(BOM)コストを低減できます。

より到達範囲の長いアプリケーション用には、ピン互換のRetimerデバイスを利用可能です。

DS280BR820 は SMBus 経由、または外付けの EEPROM により構成可能です。単一のEEPROMを、最大16個のデバイスで共有できます。

製品情報 (1)

型番 パッケージ 本体サイズ（公称）
DS280BR820 nFBGA (135) 8.0mm×13.0mm
  1. 利用可能なすべてのパッケージについては、このデータシートの末尾にある注文情報を参照してください。

概略回路図

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