JAJSVL6 November   2024 F29H850TU , F29H859TU-Q1

ADVANCE INFORMATION  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
    1. 3.1 機能ブロック図
  5. 4 デバイスの比較
    1. 4.1 関連製品
  6. 5 ピン構成および機能
    1. 5.1 ピン配置図
    2. 5.2 ピン属性
    3. 5.3 信号の説明
      1. 5.3.1 アナログ信号
      2. 5.3.2 デジタル信号
      3. 5.3.3 電源およびグランド
      4. 5.3.4 テスト、JTAG、リセット
    4. 5.4 内部プルアップおよびプルダウン付きのピン
    5. 5.5 ピン多重化
      1. 5.5.1 GPIO 多重化ピン
    6. 5.6 未使用ピンの接続
  7. 6 仕様
    1. 6.1  絶対最大定格
    2. 6.2  F29H85x ESD 定格 - 民生用
    3. 6.3  F29H85x ESD 定格 - 車載用
    4. 6.4  F29P58x ESD 定格 - 民生用
    5. 6.5  F29P58x ESD 定格 - 車載用
    6. 6.6  推奨動作条件
    7. 6.7  消費電力の概略
      1. 6.7.1 システム消費電流 VREG イネーブル
      2. 6.7.2 システム消費電流 VREG ディセーブル - 外部電源
      3. 6.7.3 動作モード テストの説明
      4. 6.7.4 消費電流の低減
        1. 6.7.4.1 ペリフェラル ディセーブル時の標準的な電流低減
    8. 6.8  電気的特性
    9. 6.9  ZEX パッケージの熱抵抗特性
    10. 6.10 PTS パッケージの熱抵抗特性
    11. 6.11 RFS パッケージの熱抵抗特性
    12. 6.12 PZS パッケージの熱抵抗特性
    13. 6.13 熱設計の検討事項
    14. 6.14 システム
      1. 6.14.1  パワー マネージメント モジュール (PMM)
        1. 6.14.1.1 概要
        2. 6.14.1.2 概要
          1. 6.14.1.2.1 電源レール監視
            1. 6.14.1.2.1.1 I/O POR (パワーオン・リセット) 監視
            2. 6.14.1.2.1.2 I/O BOR (ブラウンアウト・リセット) 監視
            3. 6.14.1.2.1.3 VDD POR (パワーオン・リセット) 監視
          2. 6.14.1.2.2 外部監視回路の使用
          3. 6.14.1.2.3 遅延ブロック
          4. 6.14.1.2.4 内部1.2V LDO 電圧レギュレータ (VREG)
          5. 6.14.1.2.5 VREGENZ
        3. 6.14.1.3 外付け部品
          1. 6.14.1.3.1 デカップリング・コンデンサ
            1. 6.14.1.3.1.1 VDDIO デカップリング
            2. 6.14.1.3.1.2 VDD デカップリング
        4. 6.14.1.4 電源シーケンス
          1. 6.14.1.4.1 電源ピンの一括接続
          2. 6.14.1.4.2 信号ピンの電源シーケンス
          3. 6.14.1.4.3 電源ピンの電源シーケンス
            1. 6.14.1.4.3.1 外部 VREG/VDD モード シーケンス
            2. 6.14.1.4.3.2 内部 VREG/VDD モード シーケンス
            3. 6.14.1.4.3.3 電源シーケンスの概要と違反の影響
            4. 6.14.1.4.3.4 電源スルーレート
        5. 6.14.1.5 パワー マネージメント モジュールの電気的データおよびタイミング
          1. 6.14.1.5.1 パワー マネージメント モジュールの動作条件
          2. 6.14.1.5.2 パワー マネージメント モジュールの特性
      2. 6.14.2  リセット タイミング
        1. 6.14.2.1 リセット ソース
        2. 6.14.2.2 リセットの電気的データおよびタイミング
          1. 6.14.2.2.1 リセット XRSn のタイミング要件
          2. 6.14.2.2.2 リセット XRSn のスイッチング特性
          3. 6.14.2.2.3 リセットのタイミング図
      3. 6.14.3  クロック仕様
        1. 6.14.3.1 クロック・ソース
        2. 6.14.3.2 クロック周波数、要件、および特性
          1. 6.14.3.2.1 入力クロック周波数およびタイミング要件、PLL ロック時間
            1. 6.14.3.2.1.1 入力クロック周波数
            2. 6.14.3.2.1.2 XTAL 発振器の特性
            3. 6.14.3.2.1.3 外部の水晶振動子ではないクロック ソース使用時の X1 入力レベルの特性
            4. 6.14.3.2.1.4 X1 のタイミング要件
            5. 6.14.3.2.1.5 AUXCLKIN のタイミング要件
            6. 6.14.3.2.1.6 APLL の特性
            7. 6.14.3.2.1.7 XCLKOUT のスイッチング特性 (PLL バイパスまたはイネーブル)
        3. 6.14.3.3 入力クロック
        4. 6.14.3.4 XTAL 発振器
          1. 6.14.3.4.1 はじめに
          2. 6.14.3.4.2 概要
            1. 6.14.3.4.2.1 電気発振回路
              1. 6.14.3.4.2.1.1 動作モード
                1. 6.14.3.4.2.1.1.1 水晶動作モード
                2. 6.14.3.4.2.1.1.2 シングルエンド動作モード
              2. 6.14.3.4.2.1.2 XCLKOUT での XTAL 出力
            2. 6.14.3.4.2.2 水晶振動子
            3. 6.14.3.4.2.3 GPIO 動作モード
          3. 6.14.3.4.3 機能動作
            1. 6.14.3.4.3.1 ESR – 等価直列抵抗
            2. 6.14.3.4.3.2 Rneg – 負性抵抗
            3. 6.14.3.4.3.3 起動時間
            4. 6.14.3.4.3.4 DL – 励振レベル
          4. 6.14.3.4.4 水晶振動子の選択方法
          5. 6.14.3.4.5 テスト
          6. 6.14.3.4.6 一般的な問題とデバッグのヒント
          7. 6.14.3.4.7 水晶発振回路の仕様
            1. 6.14.3.4.7.1 水晶発振器の電気的特性
            2. 6.14.3.4.7.2 水晶振動子の等価直列抵抗 (ESR) 要件
            3. 6.14.3.4.7.3 水晶発振器のパラメータ
            4. 6.14.3.4.7.4 水晶発振器の電気的特性
        5. 6.14.3.5 内部発振器
          1. 6.14.3.5.1 INTOSC 特性
      4. 6.14.4  フラッシュ パラメータ
        1. 6.14.4.1 フラッシュ パラメータ 
      5. 6.14.5  メモリ サブシステム (MEMSS)
        1. 6.14.5.1 はじめに
        2. 6.14.5.2 特長
        3. 6.14.5.3 RAM の仕様
      6. 6.14.6  デバッグ / JTAG
        1. 6.14.6.1 JTAG の電気的データおよびタイミング
          1. 6.14.6.1.1 DEBUGSS のタイミング要件
          2. 6.14.6.1.2 DEBUGSS のスイッチング特性
          3. 6.14.6.1.3 JTAG のタイミング図
          4. 6.14.6.1.4 SWD タイミング図
      7. 6.14.7  GPIO の電気的データおよびタイミング
        1. 6.14.7.1 GPIO - 出力タイミング
          1. 6.14.7.1.1 汎用出力のスイッチング特性
          2. 6.14.7.1.2 汎用出力のタイミング図
        2. 6.14.7.2 GPIO - 入力タイミング
          1. 6.14.7.2.1 汎用入力のタイミング要件
          2. 6.14.7.2.2 サンプリング・モード
        3. 6.14.7.3 入力信号のサンプリング・ウィンドウ幅
      8. 6.14.8  リアルタイム ダイレクト メモリ アクセス (RTDMA)
        1. 6.14.8.1 はじめに
          1. 6.14.8.1.1 特長
          2. 6.14.8.1.2 ブロック図
      9. 6.14.9  低消費電力モード
        1. 6.14.9.1 クロック ゲーティング低消費電力モード
        2. 6.14.9.2 低消費電力モードのウェークアップ タイミング
          1. 6.14.9.2.1 アイドル モードのタイミング要件
          2. 6.14.9.2.2 アイドル モードのスイッチング特性
          3. 6.14.9.2.3 IDLE 開始および終了タイミング図
          4. 6.14.9.2.4 スタンバイ モードのタイミング要件
          5. 6.14.9.2.5 スタンバイ モードのスイッチング特性
          6. 6.14.9.2.6 STANDBY の開始 / 終了タイミング図
      10. 6.14.10 外部メモリ インターフェイス (EMIF)
        1. 6.14.10.1 非同期メモリのサポート
        2. 6.14.10.2 同期 DRAM のサポート
        3. 6.14.10.3 EMIF の電気的データおよびタイミング
          1. 6.14.10.3.1 EMIF 同期メモリのタイミング要件
          2. 6.14.10.3.2 EMIF 同期メモリのスイッチング特性
          3. 6.14.10.3.3 EMIF 同期メモリのタイミング図
          4. 6.14.10.3.4 EMIF 非同期メモリのタイミング要件
          5. 6.14.10.3.5 EMIF 非同期メモリのスイッチング特性
          6. 6.14.10.3.6 EMIF 非同期メモリのタイミング図
    15. 6.15 C29x アナログ ペリフェラル
      1. 6.15.1 アナログ サブシステム
        1. 6.15.1.1 特長
        2. 6.15.1.2 ブロック図
        3. 6.15.1.3 アナログ ピン接続
      2. 6.15.2 A/D コンバータ (ADC)
        1. 6.15.2.1 ADC の構成可能性
          1. 6.15.2.1.1 信号モード
        2. 6.15.2.2 ADC の電気的データおよびタイミング
          1. 6.15.2.2.1  ADC の動作条件 12 ビット シングルエンド
          2. 6.15.2.2.2  ADC の動作条件 12 ビット差動
          3. 6.15.2.2.3  ADC の動作条件 16 ビット シングルエンド
          4. 6.15.2.2.4  ADC の動作条件 16 ビット差動
          5. 6.15.2.2.5  ADC のタイミング要件
          6. 6.15.2.2.6  ADC 特性 12 ビット シングルエンド
          7. 6.15.2.2.7  ADC 特性 12 ビット差動
          8. 6.15.2.2.8  ADC 特性 16 ビット シングルエンド
          9. 6.15.2.2.9  ADC 特性 16 ビット差動
          10. 6.15.2.2.10 ‌ADC の INL と DNL
          11. 6.15.2.2.11 ADC 入力モデル モデル
          12. 6.15.2.2.12 ADC のタイミング図
      3. 6.15.3 温度センサ
        1. 6.15.3.1 温度センサの電気的データおよびタイミング
          1. 6.15.3.1.1 温度センサの特性
      4. 6.15.4 コンパレータ・サブシステム (CMPSS)
        1. 6.15.4.1 CMPSS 接続図
        2. 6.15.4.2 ブロック図
        3. 6.15.4.3 CMPSS の電気的データおよびタイミング
          1. 6.15.4.3.1 コンパレータ電気的特性
          2.        CMPSS コンパレータの入力換算オフセットとヒステリシス
          3. 6.15.4.3.2 CMPSS DAC の静的電気特性
          4. 6.15.4.3.3 CMPSS の説明用グラフ
      5. 6.15.5 バッファ付き D/A コンバータ (DAC)
        1. 6.15.5.1 バッファ付き DAC の電気的データおよびタイミング
          1. 6.15.5.1.1 バッファ付き DAC の動作条件
          2. 6.15.5.1.2 バッファ付き DAC の電気的特性
    16. 6.16 C29x コントロール ペリフェラル
      1. 6.16.1 拡張キャプチャ (eCAP)
        1. 6.16.1.1 eCAP のブロック図
        2. 6.16.1.2 eCAP の同期
        3. 6.16.1.3 eCAP の電気的データおよびタイミング
          1. 6.16.1.3.1 eCAP のタイミング要件
          2. 6.16.1.3.2 eCAP のスイッチング特性
      2. 6.16.2 高分解能キャプチャ (HRCAP)
        1. 6.16.2.1 eCAP と HRCAP のブロック図
        2. 6.16.2.2 HRCAP の電気的データおよびタイミング
          1. 6.16.2.2.1 HRCAP スイッチング特性
          2. 6.16.2.2.2 HRCAP の図とグラフ
      3. 6.16.3 拡張パルス幅変調器 (ePWM)
        1. 6.16.3.1 制御ペリフェラルの同期
        2. 6.16.3.2 ePWM の電気的データおよびタイミング
          1. 6.16.3.2.1 ePWM のタイミング要件
          2. 6.16.3.2.2 ePWM のスイッチング特性
          3. 6.16.3.2.3 トリップ ゾーン入力のタイミング
            1. 6.16.3.2.3.1 PWM ハイ インピーダンス特性のタイミング図
      4. 6.16.4 外部 ADC 変換開始の電気的データおよびタイミング
        1. 6.16.4.1 外部 ADC 変換開始のスイッチング特性
        2. 6.16.4.2 ADCSOCAO または ADCSOCBO のタイミング図
      5. 6.16.5 高分解能パルス幅変調器 (HRPWM)
        1. 6.16.5.1 HRPWM の電気的データおよびタイミング
          1. 6.16.5.1.1 高分解能 PWM の特性
      6. 6.16.6 拡張直交エンコーダ パルス (eQEP)
        1. 6.16.6.1 eQEP の電気的データおよびタイミング
          1. 6.16.6.1.1 eQEP のタイミング要件
          2. 6.16.6.1.2 eCAP のスイッチング特性
      7. 6.16.7 シグマ-デルタ・フィルタ・モジュール (SDFM)
        1. 6.16.7.1 SDFM の電気的データおよびタイミング
          1. 6.16.7.1.1 SDFM の電気的データおよびタイミング (同期 GPIO)
          2. 6.16.7.1.2 SDFM の電気的データおよびタイミング (ASYNC を使用)
            1. 6.16.7.1.2.1 非同期 GPIO ASYNC オプション使用時の SDFM のタイミング要件
            2. 6.16.7.1.2.2 同期 GPIO SYNC オプション使用時の SDFM のタイミング要件
          3. 6.16.7.1.3 SDFM タイミング図
    17. 6.17 C29x 通信ペリフェラル
      1. 6.17.1 モジュラー・コントローラ・エリア・ネットワーク (MCAN)
      2. 6.17.2 高速シリアル インターフェイス (FSI)
        1. 6.17.2.1 FSI トランスミッタ
          1. 6.17.2.1.1 FSITX の電気的データおよびタイミング
            1. 6.17.2.1.1.1 FSITX スイッチング特性
            2. 6.17.2.1.1.2 FSITX タイミング
        2. 6.17.2.2 FSI レシーバ
          1. 6.17.2.2.1 FSIRX の電気的データおよびタイミング
            1. 6.17.2.2.1.1 FSIRX のタイミング要件
            2. 6.17.2.2.1.2 FSIRX スイッチング特性
            3. 6.17.2.2.1.3 FSIRX タイミング
        3. 6.17.2.3 FSI SPI 互換モード
          1. 6.17.2.3.1 FSITX SPI 信号モードの電気的データおよびタイミング
            1. 6.17.2.3.1.1 FSITX SPI 信号モードのスイッチング特性
            2. 6.17.2.3.1.2 FSITX SPI 信号モードのタイミング
      3. 6.17.3 I2C (Inter-Integrated Circuit)
        1. 6.17.3.1 I2C の電気的データおよびタイミング
          1. 6.17.3.1.1 I2C のタイミング要件
          2. 6.17.3.1.2 I2C のスイッチング特性
          3. 6.17.3.1.3 I2C のタイミング図
      4. 6.17.4 PMBus (Power Management Bus) インターフェイス
        1. 6.17.4.1 PMBus の電気的データおよびタイミング
          1. 6.17.4.1.1 PMBus の電気的特性
          2. 6.17.4.1.2 PMBus ファスト プラス モードのスイッチング特性
          3. 6.17.4.1.3 PMBus ファスト モードのスイッチング特性
          4. 6.17.4.1.4 PMBus スタンダード モードのスイッチング特性
      5. 6.17.5 シリアル・ペリフェラル・インターフェイス (SPI)
        1. 6.17.5.1 SPI コントローラ モードのタイミング
          1. 6.17.5.1.1 SPI コントローラ モードのスイッチング特性 - クロック位相 0
          2. 6.17.5.1.2 SPI コントローラ モードのスイッチング特性 - クロック位相 1
          3. 6.17.5.1.3 SPI コントローラ モードのタイミング要件
          4. 6.17.5.1.4 SPI コントローラ・モードのタイミング図
        2. 6.17.5.2 SPI ペリフェラル モードのタイミング
          1. 6.17.5.2.1 SPI ペリフェラル モードのスイッチング特性
          2. 6.17.5.2.2 SPI ペリフェラル モードのタイミング要件
          3. 6.17.5.2.3 SPI ペリフェラル・モードのタイミング図
      6. 6.17.6 シングル エッジ ニブル伝送 (SENT)
        1. 6.17.6.1 はじめに
        2. 6.17.6.2 特長
      7. 6.17.7 LIN (Local Interconnect Network)
      8. 6.17.8 EtherCAT SubordinateDevice コントローラ (ESC)
        1. 6.17.8.1 ESC の機能
        2. 6.17.8.2 ESC サブシステムの統合機能
        3. 6.17.8.3 EtherCAT IP のブロック図
        4. 6.17.8.4 EtherCAT の電気的データおよびタイミング
          1. 6.17.8.4.1 EtherCAT のタイミング要件
          2. 6.17.8.4.2 EtherCAT のスイッチング特性
          3. 6.17.8.4.3 EtherCAT のタイミング図
      9. 6.17.9 UART (Universal Asynchronous Receiver-Transmitter)
  8. 7 詳細説明
    1. 7.1  概要
    2. 7.2  機能ブロック図
    3. 7.3  エラー通知モジュール (ESM_C29)
      1. 7.3.1 はじめに
      2. 7.3.2 ESM サブシステム
      3. 7.3.3 システム ESM
    4. 7.4  エラー アグリゲータ
      1. 7.4.1 エラー アグリゲータ モジュール
      2. 7.4.2 エラー アグリゲータ インターフェイス
    5. 7.5  メモリ
      1. 7.5.1 C29x メモリ マップ
      2. 7.5.2 フラッシュ メモリ マップ
        1. 7.5.2.1 フラッシュ メイン領域のアドレス マップ (F29H85x、4MB)
        2. 7.5.2.2 フラッシュ メイン領域のアドレス マップ (F29H85x、2MB)
        3. 7.5.2.3 フラッシュ メイン領域のアドレス マップ (F29P58x、4MB)
        4. 7.5.2.4 フラッシュ メイン領域のアドレスマップ (F29P58x、2MB)
        5. 7.5.2.5 フラッシュ メイン領域のアドレス マップ (F29P58x、1MB)
        6. 7.5.2.6 フラッシュ データ バンクのアドレス マップ
        7. 7.5.2.7 フラッシュ BANKMGMT 領域のアドレス マップ
        8. 7.5.2.8 フラッシュ SECCFG 領域のアドレス マップ
      3. 7.5.3 ペリフェラル・レジスタのメモリ・マップ
    6. 7.6  識別
    7. 7.7  ブート ROM
      1. 7.7.1 デバイス ブート シーケンス
      2. 7.7.2 デバイス ブート モード
        1. 7.7.2.1 デフォルト ブート モード
        2. 7.7.2.2 カスタム ブート モード
      3. 7.7.3 デバイス ブートの構成
        1. 7.7.3.1 ブート モード ピンの構成
        2. 7.7.3.2 ブート モード テーブル オプションの設定
      4. 7.7.4 デバイスのブート フロー図
        1. 7.7.4.1 デバイス ブート フロー
        2. 7.7.4.2 CPU1 のブート フロー
        3. 7.7.4.3 エミュレーション ブート フロー
        4. 7.7.4.4 スタンドアロン ブート フロー
      5. 7.7.5 GPIO の割り当て
    8. 7.8  セキュリティ モジュールおよび暗号化アクセラレータ
      1. 7.8.1 セキュリティ モジュール
        1. 7.8.1.1 ハードウェア セキュリティ モジュール (HSM)
        2. 7.8.1.2 暗号化アクセラレータ
      2. 7.8.2 安全およびセキュリティ ユニット (SSU)
        1. 7.8.2.1 システム図
    9. 7.9  C29x サブシステム
      1. 7.9.1 C29 CPU のアーキテクチャ
      2. 7.9.2 ペリフェラル割り込みの優先度と拡張 (PIPE)
        1. 7.9.2.1 はじめに
          1. 7.9.2.1.1 特長
          2. 7.9.2.1.2 割り込みの概念
        2. 7.9.2.2 割り込みアーキテクチャ
          1. 7.9.2.2.1 動的優先度アービトレーション ブロック
          2. 7.9.2.2.2 後処理ブロック
          3. 7.9.2.2.3 メモリ マップト レジスタ
        3. 7.9.2.3 割り込みの伝搬
      3. 7.9.3 データ ロギングとトレース (DLT)
        1. 7.9.3.1 はじめに
          1. 7.9.3.1.1 特長
            1. 7.9.3.1.1.1 ブロック図
      4. 7.9.4 波形アナライザ診断 (WADI)
        1. 7.9.4.1 WADI の概要
          1. 7.9.4.1.1 特長
          2. 7.9.4.1.2 ブロック図
          3. 7.9.4.1.3 概要
      5. 7.9.5 組み込みのリアルタイム解析および診断 (ERAD)
      6. 7.9.6 プロセッサ間通信 (IPC)
        1. 7.9.6.1 はじめに
      7. 7.9.7 ウォッチドッグ
      8. 7.9.8 デュアル・クロック・コンパレータ (DCC)
        1. 7.9.8.1 特長
        2. 7.9.8.2 DCCx クロック ソース入力のマッピング
      9. 7.9.9 構成可能ロジック ブロック (CLB)
    10. 7.10 ロックステップ比較モジュール (LCM)
  9. 8 アプリケーション、実装、およびレイアウト
    1. 8.1 リファレンス デザイン
  10. 9 デバイスおよびドキュメントのサポート
    1. 9.1 デバイスの命名規則
    2. 9.2 マーキング
    3. 9.3 ツールとソフトウェア
    4. 9.4 ドキュメントのサポート
    5. 9.5 サポート・リソース
    6. 9.6 商標
    7. 9.7 静電気放電に関する注意事項
    8. 9.8 用語集
  11. 10改訂履歴
  12. 11メカニカル、パッケージ、および注文情報
    1. 11.1 パッケージ情報
    2.     トレイ

パッケージ・オプション

デバイスごとのパッケージ図は、PDF版データシートをご参照ください。

メカニカル・データ（パッケージ｜ピン）
  • PTS|176
  • RFS|144
  • ZEX|256
サーマルパッド・メカニカル・データ
発注情報

7.5.3 ペリフェラル・レジスタのメモリ・マップ

表 7-27 ペリフェラル・レジスタのメモリ・マップ
構造 DriverLib 名 ベース アドレス 適用可能なフレーム CPU1 CPU2 CPU3 RTDMA1 RTDMA2 HSM
vbusp_config
RTDMA_REGS RTDMA1_BASE 0x301C_0000 - あり あり あり - - あり
RTDMA_DIAG_REGS RTDMA1_DIAG_BASE 0x301C_0800 - あり あり あり - - あり
RTDMA_SELFTEST_REGS RTDMA1_SELFTEST_BASE 0x301C_0C00 - あり あり あり - - あり
RTDMA_MPU_REGS RTDMA1_MPU_BASE 0x301C_1000 - あり あり あり - - あり
RTDMA_REGS RTDMA2_BASE 0x301C_8000 - あり あり あり - - あり
RTDMA_DIAG_REGS RTDMA2_DIAG_BASE 0x301C_8800 - あり あり あり - - あり
RTDMA_SELFTEST_REGS RTDMA2_SELFTEST_BASE 0x301C_8C00 - あり あり あり - - あり
RTDMA_MPU_REGS RTDMA2_MPU_BASE 0x301C_9000 - あり あり あり - - あり
FRI_CTRL_REGS FRI1_BASE 0x301D_0000 - あり あり あり - - あり
MEMSS_L_CONFIG_REGS MEMSSLCFG_BASE 0x301D_8000 - あり あり あり - - あり
MEMSS_C_CONFIG_REGS MEMSSCCFG_BASE 0x301D_8400 - あり あり あり - - あり
MEMSS_M_CONFIG_REGS MEMSSMCFG_BASE 0x301D_8800 - あり あり あり - - あり
MEMSS_MISCI_REGS MEMSSMISCI_BASE 0x301D_8E00 - あり あり あり - - あり
SYNCBRIDGEMPU_REGS SYNCBRIDGEMPU_BASE 0x301E_0000 - あり あり あり - - あり
INPUT_XBAR_REGS INPUTXBAR_BASE 0x301E_8000 - あり あり あり - - あり
EPWM_XBAR_REGS EPWMXBAR_BASE 0x301E_9000 - あり あり あり - - あり
CLB_XBAR_REGS CLBXBAR_BASE 0x301E_A000 - あり あり あり - - あり
OUTPUTXBAR_REGS OUTPUTXBAR_BASE 0x301E_B000 - あり あり あり - - あり
MDL_XBAR_REGS MDLXBAR_BASE 0x301E_C000 - あり あり あり - - あり
ICL_XBAR_REGS ICLXBAR_BASE 0x301E_D000 - あり あり あり - - あり
LCM_REGS LCM_DMA_BASE 0x301F_4000 - あり あり あり - - あり
c29bus
ADC_RESULT_REGS ADCARESULT_BASE 0x303C_0000 - あり あり あり あり あり -
ADC_RESULT_REGS ADCBRESULT_BASE 0x303C_1000 - あり あり あり あり あり -
ADC_RESULT_REGS ADCCRESULT_BASE 0x303C_2000 - あり あり あり あり あり -
ADC_RESULT_REGS ADCDRESULT_BASE 0x303C_3000 - あり あり あり あり あり -
ADC_RESULT_REGS ADCERESULT_BASE 0x303C_4000 - あり あり あり あり あり -
EMIF_REGS EMIF1_BASE 0x3080_0000 - あり あり あり - - -
vbus32_config
DEV_CFG_REGS DEVCFG_BASE 0x3018_0000 - あり あり あり - - あり
ANALOG_SUBSYS_REGS ANALOGSUBSYS_BASE 0x3018_2000 - あり あり あり - - あり
GPIO_CTRL_REGS GPIOCTRL_BASE 0x3019_0000 - あり あり あり - - あり
IPC_COUNTER_REGS IPCCOUNTER_BASE 0x301B_0000 - あり あり あり - - あり
vbusp_prog
FLASH_CMD_REGS_FLC1 FLASHCONTROLLER1_BASE 0x3010_0000 - あり - あり - - あり
FLASH_CMD_REGS_FLC2 FLASHCONTROLLER2_BASE 0x3011_0000 - あり - あり - - あり
HSM_ERROR_AGGREGATOR_CONFIG_REGS HSMERRORAGGREGATOR_BASE 0x3012_0000 - - - - - - あり
vbus32_ethercat
ESCSS_REGS ESC_SS_BASE 0x3038_8000 - あり あり あり あり あり -
ESCSS_CONFIG_REGS ESC_SS_CONFIG_BASE 0x3038_8200 - あり あり あり あり あり -
vbusp_cpu1、vbusp_cpu2、vbusp_cpu3
C29_RTINT_STACK C29CPURTINTSTACK_BASE 0x3000_8000 - あり あり あり - - -
C29_SECCALL_STACK C29CPUSECCALLSTACK_BASE 0x3000_C000 - あり あり あり - - -
C29_SECURE_REGS C29CPUSECURE_BASE 0x3000_D000 - あり あり あり - - -
C29_DIAG_REGS C29CPUDIAG_BASE 0x3000_E000 - あり あり あり - - -
C29_SELFTEST_REGS C29CPUSELFTEST_BASE 0x3000_F000 - あり あり あり - - -
DLT_CORE_REGS CPUDLT_BASE 0x3001_0000 - あり あり あり - - -
PIPE_REGS PIPE_BASE 0x3002_0000 - あり あり あり - - -
ERAD_REGS ERAD_BASE 0x3003_0000 - あり あり あり - - -
vbusp_frame0
RTDMA_CH_REGS RTDMA1CH1_BASE 0x6000_0000 あり あり あり あり あり あり -
RTDMA_CH_REGS RTDMA1CH2_BASE 0x6000_1000 あり あり あり あり あり あり -
RTDMA_CH_REGS RTDMA1CH3_BASE 0x6000_2000 あり あり あり あり あり あり -
RTDMA_CH_REGS RTDMA1CH4_BASE 0x6000_3000 あり あり あり あり あり あり -
RTDMA_CH_REGS RTDMA1CH5_BASE 0x6000_4000 あり あり あり あり あり あり -
RTDMA_CH_REGS RTDMA1CH6_BASE 0x6000_5000 あり あり あり あり あり あり -
RTDMA_CH_REGS RTDMA1CH7_BASE 0x6000_6000 あり あり あり あり あり あり -
RTDMA_CH_REGS RTDMA1CH8_BASE 0x6000_7000 あり あり あり あり あり あり -
RTDMA_CH_REGS RTDMA1CH9_BASE 0x6000_8000 あり あり あり あり あり あり -
RTDMA_CH_REGS RTDMA1CH10_BASE 0x6000_9000 あり あり あり あり あり あり -
RTDMA_CH_REGS RTDMA2CH1_BASE 0x6001_0000 あり あり あり あり あり あり -
RTDMA_CH_REGS RTDMA2CH2_BASE 0x6001_1000 あり あり あり あり あり あり -
RTDMA_CH_REGS RTDMA2CH3_BASE 0x6001_2000 あり あり あり あり あり あり -
RTDMA_CH_REGS RTDMA2CH4_BASE 0x6001_3000 あり あり あり あり あり あり -
RTDMA_CH_REGS RTDMA2CH5_BASE 0x6001_4000 あり あり あり あり あり あり -
RTDMA_CH_REGS RTDMA2CH6_BASE 0x6001_5000 あり あり あり あり あり あり -
RTDMA_CH_REGS RTDMA2CH7_BASE 0x6001_6000 あり あり あり あり あり あり -
RTDMA_CH_REGS RTDMA2CH8_BASE 0x6001_7000 あり あり あり あり あり あり -
RTDMA_CH_REGS RTDMA2CH9_BASE 0x6001_8000 あり あり あり あり あり あり -
RTDMA_CH_REGS RTDMA2CH10_BASE 0x6001_9000 あり あり あり あり あり あり -
MCANSS_REGS MCANSSA_BASE 0x6002_4000 あり あり あり あり あり あり -
MCAN_REGS MCANA_BASE 0x6002_4600 あり あり あり あり あり あり -
MCAN_ERROR_REGS MCANA_ERROR_BASE 0x6002_4800 あり あり あり あり あり あり -
MCANSS_REGS MCANBSS_BASE 0x6002_C000 あり あり あり あり あり あり -
MCAN_REGS MCANB_BASE 0x6002_C600 あり あり あり あり あり あり -
MCAN_ERROR_REGS MCANB_ERROR_BASE 0x6002_C800 あり あり あり あり あり あり -
MCANSS_REGS MCANCSS_BASE 0x6003_4000 あり あり あり あり あり あり -
MCAN_REGS MCANC_BASE 0x6003_4600 あり あり あり あり あり あり -
MCAN_ERROR_REGS MCANC_ERROR_BASE 0x6003_4800 あり あり あり あり あり あり -
MCANSS_REGS MCANDSS_BASE 0x6003_C000 あり あり あり あり あり あり -
MCAN_REGS MCAND_BASE 0x6003_C600 あり あり あり あり あり あり -
MCAN_ERROR_REGS MCAND_ERROR_BASE 0x6003_C800 あり あり あり あり あり あり -
MCANSS_REGS MCANESS_BASE 0x6004_4000 あり あり あり あり あり あり -
MCAN_REGS MCANE_BASE 0x6004_4600 あり あり あり あり あり あり -
MCAN_ERROR_REGS MCANE_ERROR_BASE 0x6004_4800 あり あり あり あり あり あり -
MCANSS_REGS MCANFSS_BASE 0x6004_C000 あり あり あり あり あり あり -
MCAN_REGS MCANF_BASE 0x6004_C600 あり あり あり あり あり あり -
MCAN_ERROR_REGS MCANF_ERROR_BASE 0x6004_C800 あり あり あり あり あり あり -
LIN_REGS LINA_BASE 0x6006_0000 あり あり あり あり あり あり -
LIN_REGS LINB_BASE 0x6006_1000 あり あり あり あり あり あり -
SENT_CFG SENT1CSENT_BASE 0x6006_8000 あり あり あり あり あり あり -
SENT_MEM SENT1MEM_BASE 0x6006_8400 あり あり あり あり あり あり -
SENT_MTPG SENT1MTPG_BASE 0x6006_8800 あり あり あり あり あり あり -
SENT_CFG SENT2CSENT_BASE 0x6006_9000 あり あり あり あり あり あり -
SENT_MEM SENT2MEM_BASE 0x6006_9400 あり あり あり あり あり あり -
SENT_MTPG SENT2MTPG_BASE 0x6006_9800 あり あり あり あり あり あり -
SENT_CFG SENT3CSENT_BASE 0x6006_A000 あり あり あり あり あり あり -
SENT_MEM SENT3MEM_BASE 0x6006_A400 あり あり あり あり あり あり -
SENT_MTPG SENT3MTPG_BASE 0x6006_A800 あり あり あり あり あり あり -
SENT_CFG SENT4CSENT_BASE 0x6006_B000 あり あり あり あり あり あり -
SENT_MEM SENT4MEM_BASE 0x6006_B400 あり あり あり あり あり あり -
SENT_MTPG SENT4MTPG_BASE 0x6006_B800 あり あり あり あり あり あり -
SENT_CFG SENT5CSENT_BASE 0x6006_C000 あり あり あり あり あり あり -
SENT_MEM SENT5MEM_BASE 0x6006_C400 あり あり あり あり あり あり -
SENT_MTPG SENT5MTPG_BASE 0x6006_C800 あり あり あり あり あり あり -
SENT_CFG SENT6CSENT_BASE 0x6006_D000 あり あり あり あり あり あり -
SENT_MEM SENT6MEM_BASE 0x6006_D400 あり あり あり あり あり あり -
SENT_MTPG SENT6MTPG_BASE 0x6006_D800 あり あり あり あり あり あり -
UART_REGS、UART_REGS_WRITE UARTA_BASE、UARTA_WRITE_BASE 0x6007_0000 あり あり あり あり あり あり -
UART_REGS、UART_REGS_WRITE UARTB_BASE、UARTB_WRITE_BASE 0x6007_2000 あり あり あり あり あり あり -
UART_REGS、UART_REGS_WRITE UARTC_BASE、UARTC_WRITE_BASE 0x6007_4000 あり あり あり あり あり あり -
UART_REGS、UART_REGS_WRITE UARTD_BASE、UARTD_WRITE_BASE 0x6007_6000 あり あり あり あり あり あり -
UART_REGS、UART_REGS_WRITE UARTE_BASE、UARTE_WRITE_BASE 0x6007_8000 あり あり あり あり あり あり -
UART_REGS、UART_REGS_WRITE UARTF_BASE、UARTF_WRITE_BASE 0x6007_A000 あり あり あり あり あり あり -
DCC_REGS DCC1_BASE 0x6008_0000 あり あり あり あり あり あり -
DCC_REGS DCC2_BASE 0x6008_1000 あり あり あり あり あり あり -
DCC_REGS DCC3_BASE 0x6008_2000 あり あり あり あり あり あり -
ERROR_AGGREGATOR_CONFIG_REGS ERRORAGGREGATOR_BASE 0x6008_C000 あり あり あり あり あり あり -
ESM_CPU_REGS ESMCPU1_BASE 0x6009_0000 あり あり あり あり あり あり -
ESM_CPU_REGS ESMCPU2_BASE 0x6009_1000 あり あり あり あり あり あり -
ESM_CPU_REGS ESMCPU3_BASE 0x6009_2000 あり あり あり あり あり あり -
ESM_SYSTEM_REGS ESMSYSTEM_BASE 0x6009_F000 あり あり あり あり あり あり -
ESM_SAFETYAGG_REGS ESMSAFETYAGG_BASE 0x600A_0000 あり あり あり あり あり あり -
WADI_CONFIG_REGS WADI1BLK1CONFIG_BASE 0x600B_0000 あり あり あり あり あり あり -
WADI_CONFIG_REGS WADI1BLK2CONFIG_BASE 0x600B_0100 あり あり あり あり あり あり -
WADI_CONFIG_REGS WADI1BLK3CONFIG_BASE 0x600B_0200 あり あり あり あり あり あり -
WADI_CONFIG_REGS WADI1BLK4CONFIG_BASE 0x600B_0300 あり あり あり あり あり あり -
WADI_OPER_SSS_REGS WADI1OPERSSS_BASE 0x600B_1000 あり あり あり あり あり あり -
WADI_CONFIG_REGS WADI2BLK1CONFIG_BASE 0x600B_2000 あり あり あり あり あり あり -
WADI_CONFIG_REGS WADI2BLK2CONFIG_BASE 0x600B_2100 あり あり あり あり あり あり -
WADI_CONFIG_REGS WADI2BLK3CONFIG_BASE 0x600B_2200 あり あり あり あり あり あり -
WADI_CONFIG_REGS WADI2BLK4CONFIG_BASE 0x600B_2300 あり あり あり あり あり あり -
WADI_OPER_SSS_REGS WADI2OPERSSS_BASE 0x600B_3000 あり あり あり あり あり あり -
OUTPUTXBAR_FLAG_REGS OUTPUTXBAR1_FLAGS_BASE 0x600C_0000 あり あり あり あり あり あり -
OUTPUTXBAR_FLAG_REGS OUTPUTXBAR2_FLAGS_BASE 0x600C_1000 あり あり あり あり あり あり -
OUTPUTXBAR_FLAG_REGS OUTPUTXBAR3_FLAGS_BASE 0x600C_2000 あり あり あり あり あり あり -
OUTPUTXBAR_FLAG_REGS OUTPUTXBAR4_FLAGS_BASE 0x600C_3000 あり あり あり あり あり あり -
OUTPUTXBAR_FLAG_REGS OUTPUTXBAR5_FLAGS_BASE 0x600C_4000 あり あり あり あり あり あり -
OUTPUTXBAR_FLAG_REGS OUTPUTXBAR6_FLAGS_BASE 0x600C_5000 あり あり あり あり あり あり -
OUTPUTXBAR_FLAG_REGS OUTPUTXBAR7_FLAGS_BASE 0x600C_6000 あり あり あり あり あり あり -
OUTPUTXBAR_FLAG_REGS OUTPUTXBAR8_FLAGS_BASE 0x600C_7000 あり あり あり あり あり あり -
OUTPUTXBAR_FLAG_REGS OUTPUTXBAR9_FLAGS_BASE 0x600C_8000 あり あり あり あり あり あり -
OUTPUTXBAR_FLAG_REGS OUTPUTXBAR10_FLAGS_BASE 0x600C_9000 あり あり あり あり あり あり -
OUTPUTXBAR_FLAG_REGS OUTPUTXBAR11_FLAGS_BASE 0x600C_A000 あり あり あり あり あり あり -
OUTPUTXBAR_FLAG_REGS OUTPUTXBAR12_FLAGS_BASE 0x600C_B000 あり あり あり あり あり あり -
OUTPUTXBAR_FLAG_REGS OUTPUTXBAR13_FLAGS_BASE 0x600C_C000 あり あり あり あり あり あり -
OUTPUTXBAR_FLAG_REGS OUTPUTXBAR14_FLAGS_BASE 0x600C_D000 あり あり あり あり あり あり -
OUTPUTXBAR_FLAG_REGS OUTPUTXBAR15_FLAGS_BASE 0x600C_E000 あり あり あり あり あり あり -
OUTPUTXBAR_FLAG_REGS OUTPUTXBAR16_FLAGS_BASE 0x600C_F000 あり あり あり あり あり あり -
XBAR_REGS XBAR_BASE 0x600E_0000 あり あり あり あり あり あり -
DLT_FIFO_REGS CPU1DLTFIFO_BASE 0x600F_8000 あり あり あり あり あり あり -
DLT_FIFO_REGS CPU2DLTFIFO_BASE 0x600F_A000 あり あり あり あり あり あり -
DLT_FIFO_REGS CPU3DLTFIFO_BASE 0x600F_C000 あり あり あり あり あり あり -
vbus32_ap_cpu1、vbus32_ap_cpu2、vbus32_ap_cpu3
CPU_SYS_REGS CPUSYS_BASE 0x3020_0000 - あり あり あり - - -
CPU_PER_CFG_REGS CPUPERCFG_BASE 0x3020_8000 - あり あり あり - - -
WD_REGS WD_BASE 0x3020_8C00 - あり あり あり - - -
CPUTIMER_REGS CPUTIMER0_BASE 0x3021_8000 - あり あり あり - - -
CPUTIMER_REGS CPUTIMER1_BASE 0x3021_9000 - あり あり あり - - -
CPUTIMER_REGS CPUTIMER2_BASE 0x3021_A000 - あり あり あり - - -
CPU1_IPC_SEND_REGS CPU1IPCSEND_BASE 0x3022_0000 - あり あり あり - - -
CPU2_IPC_SEND_REGS CPU2IPCSEND_BASE 0x3022_8000 - あり あり あり - - -
CPU3_IPC_SEND_REGS CPU3IPCSEND_BASE 0x3023_0000 - あり あり あり - - -
CPU1_IPC_RCV_REGS CPU1IPCRCV_BASE 0x3024_0000 - あり あり あり - - -
CPU2_IPC_RCV_REGS CPU2IPCRCV_BASE 0x3024_8000 - あり あり あり - - -
CPU3_IPC_RCV_REGS CPU3IPCRCV_BASE 0x3025_0000 - あり あり あり - - -
GPIO_DATA_REGS GPIODATA_BASE 0x3026_8000 - あり あり あり - - -
GPIO_DATA_READ_REGS GPIODATAREAD_BASE 0x3026_9000 - あり あり あり - - -
XINT_REGS XINT_BASE 0x3027_0000 - あり あり あり - - -
vbusp_cpu1
SECAP_HANDLER_REGS C29DEBUGSS_BASE 0x3001_8000 - あり - - - - -
LCM_REGS LCM_CPU_BASE 0x3003_2000 - あり - - - - -
vbus32_frame0
EPWM_REGS EPWM1_BASE 0x7000_0000 あり あり あり あり あり あり -
EPWM_XCMP_REGS EPWM1XCMP_BASE 0x7000_0400 あり あり あり あり あり あり -
DE_REGS EPWM1DE_BASE 0x7000_0800 あり あり あり あり あり あり -
MINDB_LUT_REGS EPWM1MINDBLUT_BASE 0x7000_0C00 あり あり あり あり あり あり -
EPWM_REGS EPWM2_BASE 0x7000_1000 あり あり あり あり あり あり -
EPWM_XCMP_REGS EPWM2XCMP_BASE 0x7000_1400 あり あり あり あり あり あり -
DE_REGS EPWM2DE_BASE 0x7000_1800 あり あり あり あり あり あり -
MINDB_LUT_REGS EPWM2MINDBLUT_BASE 0x7000_1C00 あり あり あり あり あり あり -
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