JAJSUF7 November 2023 – April 2024 IWRL6432AOP
ADVANCE INFORMATION
図 8-4 に、IWRL6432AOP デバイスのカスタマー プログラマブル プロセッサ サブシステムのブロック図を示します。概念的には、2 つのカスタマー プログラマブル プロセッサ サブシステムが存在し、図に示すように点線で区切られています。左側に、HWA、高性能高帯域幅 (64 ビット、80MHz) インターコネクト、関連ペリフェラルのデータ転送を示します。測定データ出力用の RDIF インターフェイス、L3 レーダー データ キューブ メモリ、ADC バッファ、CRC エンジン、データ ハンドシェイク メモリ (インターコネクト上に搭載された追加メモリ)。
この図の右側に、メイン サブシステムを示します。メイン サブシステムは、本デバイスの頭脳であり、本デバイスのすべてのペリフェラルとハウスキーピング動作を制御します。メイン サブシステムには、Cortex-M4F プロセッサと関連ペリフェラルおよびハウスキーピング コンポーネント (例:DMA、CRC、PCR (ペリフェラル セントラル リソース) インターコネクトを介してメイン インターコネクトに接続されたペリフェラル (I2C、UART、SPI、CAN、PMIC クロック モジュール、PWM など)) が含まれます。