JAJSTE0A March 2024 – December 2025 LMK05318B-Q1
PRODUCTION DATA
デバイスごとのパッケージ図は、PDF版データシートをご参照ください。
各 DPLL リファレンス クロック入力は、リファレンスクロックが認定され、DPLL による選択に使用できるようになる前に、入力検証のために個別に監視されます。リファレンス監視ブロックには、振幅、周波数スレッショルド、欠落パルス(レイト ウィンドウ)、ランツ パルス(アーリー ウィンドウ)、および 1PPS 位相有効検出器が含まれます。入力周波数が 2 kHz 未満の場合、1PPS 位相有効検出および LVCMOS 振幅検出はサポートされますが、差動入力の振幅、周波数スレッショルド、欠落パルス、ラント パルスの各監視はサポートされないため、無効化する必要があります。2kHz 以上の入力周波数では、1PPS 位相有効モニタを除くすべての検出器がサポートされています。入力が有効と判定される前に、有効化されているすべてのリファレンス監視がフラグなしの状態を維持すべき最小時間を設定するための検証タイマも用意されています。
すべてのリファレンス モニタと検証タイマの有効化と有効なスレッショルドは、入力ごとにプログラム可能です。リファレンス監視および検証タイマは有効化が任意ですが、ホールドオーバーやスイッチオーバー時に信頼性の高い DPLL ロックと最適な過渡応答性能を実現するうえで重要です。リファレンス モニタと検証タイマも、信頼性の低いクロック入力または断続的なクロック入力の選択を回避するために使用されます。特定の検出器が有効になっていない場合、検出器はフラグを設定せず、無視されます。有効な検出器のステータス フラグは、任意のリファレンス入力 (選択されているか、選択されていないか) のステータス ピンを通じて確認できます。有効になっている検出器のステータス フラグは、DPLL の選択された入力のステータス ビットを通じて読み取ることもできます。