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LMK1D120x 低付加ジッタ LVDS バッファ
JAJSJN5B
december 2020 – june 2023
LMK1D1204
,
LMK1D1208
PRODUCTION DATA
CONTENTS
SEARCH
LMK1D120x 低付加ジッタ LVDS バッファ
1
1
特長
2
アプリケーション
3
概要
4
Revision History
5
Device Comparison
6
Pin Configuration and Functions
7
Specifications
7.1
Absolute Maximum Ratings
7.2
ESD Ratings
7.3
Recommended Operating Conditions
7.4
Electrical Characteristics
7.5
Typical Characteristics
8
Parameter Measurement Information
9
Detailed Description
9.1
Overview
9.2
Functional Block Diagram
9.3
Feature Description
9.3.1
Fail-Safe Input and Hysteresis
9.3.2
Input Mux
9.4
Device Functional Modes
9.4.1
LVDS Output Termination
9.4.2
Input Termination
10
Application and Implementation
10.1
Application Information
10.2
Typical Application
10.2.1
Design Requirements
10.2.2
Detailed Design Procedure
10.2.3
Application Curves
10.3
Power Supply Recommendations
10.4
Layout
10.4.1
Layout Guidelines
10.4.2
Layout Example
11
Device and Documentation Support
11.1
Documentation Support
11.1.1
Related Documentation
11.2
ドキュメントの更新通知を受け取る方法
11.3
サポート・リソース
11.4
Trademarks
11.5
静電気放電に関する注意事項
11.6
用語集
12
Mechanical, Packaging, and Orderable Information
重要なお知らせ
パッケージ・オプション
メカニカル・データ（パッケージ｜ピン）
RGT|16
MPQF119H
サーマルパッド・メカニカル・データ
RGT|16
QFND098S
発注情報
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jajsjn5b_pm
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Data Sheet
LMK1D120x 低付加ジッタ LVDS バッファ
このリソースの元の言語は英語です。 翻訳は概要を便宜的に提供するもので、自動化ツール (機械翻訳) を使用していることがあり、TI では翻訳の正確性および妥当性につきましては一切保証いたしません。 実際の設計などの前には、ti.com で必ず最新の英語版をご参照くださいますようお願いいたします。
