JAJSMA9A october 2021 – june 2023 LMK1D1208P
PRODUCTION DATA
LMK1D1208P クロック・バッファは、2 つのクロック入力 (IN0 および IN1) のいずれか 1 つを 8 ペアの差動 LVDS クロック出力 (OUT0~OUT7) に分配します。このとき、クロック分配のスキューを最小限に抑えます。入力は LVDS、LVPECL、LVCMOS、HCSL、CML のいずれかに対応可能です。
LMK1D1208P は、50Ω 伝送経路の駆動に特化して設計されています。シングルエンド・モードで入力を駆動する場合は、未使用の負入力ピンに適切なバイアス電圧を印加する必要があります (図 9-6 参照)。IN_SEL ピンは、どの入力を出力に転送するかを選択します。このデバイスは、フェイルセーフ入力機能をサポートしています。さらに、このデバイスは入力ヒステリシスを備えており、入力信号が存在しないときに出力がランダムに発振することを防止します。
各 LVDS 差動出力は、対応する OEx ピンをロジック HIGH 「1」に設定するとイネーブルになります。このピンがロジック LOW 「0」に設定されている場合、出力がディセーブルされて HIGH Z 状態になり、消費電力の低減につながります。
このデバイスは、1.8V、2.5V または 3.3V 電源で動作し、-40℃~105℃ (周囲温度) で動作が規定されています。