JAJSF48 March 2018 LP87561-Q1 , LP87562-Q1 , LP87563-Q1 , LP87564-Q1 , LP87565-Q1
PRODUCTION DATA.
デバイスごとのパッケージ図は、PDF版データシートをご参照ください。
Address: 0x22
D7 | D6 | D5 | D4 | D3 | D2 | D1 | D0 |
Reserved | RESET_REG
_MASK |
Bits | Field | Type | Default | Description |
---|---|---|---|---|
7:1 | Reserved | R/W | 0h | |
0 | RESET_REG_MASK | R/W | X | Masking for the register reset interrupt (the RESET_REG bit in the INT_TOP2 register)
0h = Interrupt generated 1h = Interrupt not generated |