JAJSD64C april 2017 – february 2023 PGA460
PRODUCTION DATA
PGA460 デバイスには、記録期間のエコー検出段において、トランスおよび駆動回路の他の部分からトランスデューサを分離するオプションがあります。このプロセスでは、駆動回路によって発生するノイズにトランスデューサがさらされず、また、負荷が減少します。これは、検出されたエコーを PGA460 デバイスによって感知するために、大きい電圧スイングを発生できることを意味します。この機能では、PGA460 デバイスの DECPL ピンを使用して、外部トランジスタ QDECPLのゲート (またはベース) を駆動します。記録期間のバースト段および減衰段では、DECPL ピンが HIGH (IOREG レベルに応じて 3.3V または 5V) になって、外部トランジスタがイネーブルになり、トランス駆動回路が GND に接続され、トランスデューサと結合されます。EEPROM の DECPL_TEMP_SEL ビットが 0 に設定されている場合には、時間デカップリング機能が選択されます。
バースト段が終了すると、タイマが起動され、EEPROM の DECPL_Tビットで定義された値までカウントします。この時間が経過すると、DECPL ピンの状態が LOW (GND) になります。これは、外部トランジスタ QDECPL がディセーブルになり、トランスの 2 次側コイルがトランスデューサから切断されることを意味します。図 7-37 に、回路の実装を示します。