JAJSQF2N December   1995  – February 2024 SN54AHCT02 , SN74AHCT02

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 ピン構成および機能
  6. 5 仕様
    1. 5.1 絶対最大定格
    2. 5.2 ESD 定格
    3. 5.3 推奨動作条件
    4. 5.4 熱に関する情報
    5. 5.5 電気的特性
    6. 5.6 スイッチング特性
    7. 5.7 ノイズ特性
    8. 5.8 動作特性
    9. 5.9 代表的特性
  7. 6 パラメータ測定情報
  8. 7 詳細説明
    1. 7.1 概要
    2. 7.2 機能ブロック図
    3. 7.3 機能説明
      1. 7.3.1 TTL 互換 CMOS 入力
      2. 7.3.2 平衡化された CMOS プッシュプル出力
      3. 7.3.3 クランプ・ダイオード構造
    4. 7.4 デバイスの機能モード
  9. 8 アプリケーションと実装
    1. 8.1 アプリケーション情報
    2. 8.2 代表的なアプリケーション
      1. 8.2.1 設計要件
        1. 8.2.1.1 電源に関する考慮事項
        2. 8.2.1.2 入力に関する考慮事項
        3. 8.2.1.3 出力に関する考慮事項
      2. 8.2.2 詳細な設計手順
      3. 8.2.3 アプリケーション曲線
    3. 8.3 電源に関する推奨事項
    4. 8.4 レイアウト
      1. 8.4.1 レイアウトのガイドライン
      2. 8.4.2 レイアウト例
  10. 9 デバイスおよびドキュメントのサポート
    1. 9.1 ドキュメントのサポート
      1. 9.1.1 関連資料
    2. 9.2 ドキュメントの更新通知を受け取る方法
    3. 9.3 サポート・リソース
    4. 9.4 商標
    5. 9.5 静電気放電に関する注意事項
    6. 9.6 用語集
  11. 10改訂履歴
  12. 11メカニカル、パッケージ、および注文情報

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

3 概要

これらのデバイスには 4 つの独立した 2 入力 NOR ゲートが内蔵されており、ブール関数 Y =A×Bまたは Y =A + Bを正論理で実行します。

製品情報
部品番号 定格 パッケージ サイズ(1)
SN54AHCT02 軍事 J (CDIP、14)
W (CFP、14)
FK (LCCC、20)
SN74AHCT02 商用 D (SOIC、14)
DB (SSOP、14)
DGV (TVSOP、14)
N (PDIP、14)
NS (SOP、14)
PW (SOP、14)
RGY (VQFN、14)
BQA (WQFN、14)
(1) 詳細については、セクション 11 を参照してください。
GUID-5F1071DF-A1DE-4AD2-9DA6-3A07B49BFFF4-low.gif論理図 (正論理)