JAJSW11H June   1998  – January 2025 SN54AHCT123A , SN74AHCT123A

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 概要
  4. 3 ピン構成および機能
  5. 4 仕様
    1. 4.1 絶対最大定格
    2. 4.2 ESD 定格
    3. 4.3 推奨動作条件
    4. 4.4 熱に関する情報
    5. 4.5 電気的特性
    6. 4.6 タイミング要件
    7. 4.7 スイッチング特性
    8. 4.8 動作特性
    9. 4.9 入力 / 出力タイミング図
  6. 5 パラメータ測定情報
  7. 6 詳細説明
    1. 6.1 概要
    2. 6.2 機能ブロック図
    3. 6.3 機能説明
      1. 6.3.1 CMOS シュミット トリガ入力
      2. 6.3.2 TTL 互換 CMOS 入力
    4. 6.4 デバイスの機能モード
  8. 7 アプリケーションと実装
    1. 7.1 アプリケーション インフォメーション
      1. 7.1.1 使用上の注意
      2. 7.1.2 パワーダウンに関する考慮事項
      3. 7.1.3 出力パルス持続時間
      4. 7.1.4 データの再トリガ
    2. 7.2 電源に関する推奨事項
    3. 7.3 レイアウト
      1. 7.3.1 レイアウトのガイドライン
      2. 7.3.2 レイアウト例
  9. 8 デバイスおよびドキュメントのサポート
    1. 8.1 ドキュメントのサポート
      1. 8.1.1 関連資料
    2. 8.2 ドキュメントの更新通知を受け取る方法
    3. 8.3 サポート・リソース
    4. 8.4 商標
    5. 8.5 静電気放電に関する注意事項
    6. 8.6 用語集
  10. 9 改訂履歴
  11. 10メカニカル、パッケージ、および注文情報

パッケージ・オプション

デバイスごとのパッケージ図は、PDF版データシートをご参照ください。

メカニカル・データ（パッケージ｜ピン）
  • W|16
  • J|16
  • FK|20
サーマルパッド・メカニカル・データ
発注情報

6.1 概要

パルスのトリガは特定の電圧レベルで発生し、入力パルスの遷移時間とは直接関係しません。 A、 B、および CLR入力は、入力の遷移速度が遅くても出力にジッタを発生させずにパルス生成するのに十分なヒステリシスを持ったシュミット トリガを備えています。

一度トリガされると、ゲート付きの Low レベル アクティブ (A) または High レベル アクティブ (B) 入力を再トリガすることで、基本パルスの持続時間を延長することができます 。CLR を Low にすることで、パルスの持続時間を低減することができます。CLR 入力を使用することで、A または B 入力をオーバーライドできます。入力 / 出力のタイミング図は、入力の再トリガと早期クリアによるパルス制御を示しています。

デバイス間での出力パルス持続時間のばらつきは、一般に、特定の外部タイミング 部品について ±0.5% 未満です。'AHCT123A のこの分布の例を図 7-9に示します。電源電圧および温度に対する出力パルス持続時間の変動を図 7-5に示します。

電源オン時、Q 出力は Low 状態、Q出力は High 状態になります。出力は、リセット パルスを印加せずに、グリッチ フリーです。

マルチバイブレータのアプリケーション インフォメーションの詳細については、アプリケーション レポート『SN74AHC123AおよびSN74AHCT123Aを使用した設計』（文献番号SCLA014）を参照してください。