JAJSQ84D May   2023  – March 2024 SN74AC244-Q1

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 ピン構成および機能
  6. 5 仕様
    1. 5.1  絶対最大定格
    2. 5.2  ESD 定格
    3. 5.3  推奨動作条件
    4. 5.4  熱に関する情報
    5. 5.5  電気的特性
    6. 5.6  スイッチング特性：1.5V VCC
    7. 5.7  スイッチング特性：1.8V VCC
    8. 5.8  スイッチング特性：2.5V VCC
    9. 5.9  スイッチング特性：3.3V VCC
    10. 5.10 スイッチング特性：5V VCC
    11. 5.11 ノイズ特性
    12. 5.12 代表的特性
  7. 6 パラメータ測定情報
  8. 7 詳細説明
    1. 7.1 概要
    2. 7.2 機能ブロック図
    3. 7.3 機能説明
      1. 7.3.1 平衡化された CMOS 3 ステート出力
      2. 7.3.2 標準 CMOS 入力
      3. 7.3.3 クランプ ダイオード構造
      4. 7.3.4 ウェッタブル フランク
    4. 7.4 デバイスの機能モード
  9. 8 アプリケーション情報に関する免責事項
    1. 8.1 アプリケーション情報
    2. 8.2 代表的なアプリケーション
      1. 8.2.1 設計要件
        1. 8.2.1.1 電源に関する考慮事項
        2. 8.2.1.2 入力に関する考慮事項
        3. 8.2.1.3 出力に関する考慮事項
      2. 8.2.2 詳細な設計手順
      3. 8.2.3 アプリケーション曲線
    3. 8.3 電源に関する推奨事項
    4. 8.4 レイアウト
      1. 8.4.1 レイアウトのガイドライン
      2. 8.4.2 レイアウト例
  10. 9 デバイスおよびドキュメントのサポート
    1. 9.1 ドキュメントの更新通知を受け取る方法
    2. 9.2 サポート・リソース
    3. 9.3 商標
    4. 9.4 静電気放電に関する注意事項
    5. 9.5 用語集
  11. 10改訂履歴
  12. 11メカニカル、パッケージ、および注文情報

パッケージ・オプション

デバイスごとのパッケージ図は、PDF版データシートをご参照ください。

メカニカル・データ（パッケージ｜ピン）
  • RKS|20
  • PW|20
  • DGS|20
サーマルパッド・メカニカル・データ
発注情報

6 パラメータ測定情報

波形間の位相関係は、任意に選択されています。すべての入力パルスは、以下の特性を持つジェネレータで供給されます。PRR ≦ 1MHz、ZO = 50Ω、tt < 2.5ns。

クロック入力では、入力デューティ・サイクルが 50% のときの fmax が測定されます。

出力は一度に 1 つずつ測定され、測定するたびに入力が 1 回遷移します。

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(1) CL にはプローブとテスト装置の容量が含まれます。
図 6-1 3 ステート出力用負荷回路
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(1) S1 = 閉、S2 = 開。
(2) S1 = 開、S2 = 閉。
(3) tPZL と tPZH の間の大きい方が ten と同じになります。
(4) tPLZ と tPHZ の間の大きい方が tdis と同じになります。
図 6-3 電圧波形の伝搬遅延
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(1) tPLH と tPHL の間の大きい方が tpd と同じになります。
図 6-2 電圧波形の伝搬遅延
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(1) tr と tf の間の大きい方が tt と同じになります。
図 6-4 電圧波形、入力と出力の遷移時間