JAJSV35B October   2004  – July 2024 SN74ACT10-Q1

PRODUCTION DATA  

  1.   1
  2. 特長
  3. 概要
  4. Pin Configuration and Functions
  5. Specifications
    1. 4.1 Absolute Maximum Ratings
    2. 4.2 Recommended Operating Conditions
    3. 4.3 Thermal Information
    4. 4.4 Electrical Characteristics
    5. 4.5 Switching Characteristics
    6. 4.6 Operating Characteristics
  6. Parameter Measurement Information
  7. Detailed Description
    1. 6.1 Functional Block Diagram
    2. 6.2 Device Functional Modes
  8. Application and Implementation
    1. 7.1 Power Supply Recommendations
    2. 7.2 Layout
      1. 7.2.1 Layout Guidelines
  9. Device and Documentation Support
    1. 8.1 Documentation Support (Analog)
      1. 8.1.1 Related Links
    2. 8.2 ドキュメントの更新通知を受け取る方法
    3. 8.3 サポート・リソース
    4. 8.4 Trademarks
    5. 8.5 静電気放電に関する注意事項
    6. 8.6 用語集
  10. Revision History
  11. 10Mechanical, Packaging, and Orderable Information

パッケージ・オプション

メカニカル・データ(パッケージ|ピン)
サーマルパッド・メカニカル・データ
発注情報

概要

SN74ACT10 デバイスには、3 つの独立した 3 入力 NAND ゲートが内蔵されています。ブール関数 Y = A • B • C、つまり Y = A + B + C を正論理で実行します。

パッケージ情報
部品番号 パッケージ (1) パッケージ サイズ(2) 本体サイズ (3)
SN74ACT10-Q1 PW (TSSOP、14) 5mm × 6.4mm 5mm × 4.4mm
詳細については、「メカニカル、パッケージ、および注文情報」を参照してください。
パッケージ サイズ (長さ × 幅) は公称値であり、該当する場合はピンも含まれます。
本体サイズ (長さ×幅) は公称値であり、ピンは含まれません。
SN74ACT10-Q1 各ゲートの論理図 (正論理)各ゲートの論理図 (正論理)