JAJSVP6 November   2024 SN74ACT3G99

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 ピン構成および機能
  6. 5 仕様
    1. 5.1 絶対最大定格
    2. 5.2 ESD 定格
    3. 5.3 推奨動作条件
    4. 5.4 熱に関する情報
    5. 5.5 電気的特性
    6. 5.6 スイッチング特性
    7. 5.7 代表的特性
  7. 6 パラメータ測定情報
  8. 7 詳細説明
    1. 7.1 概要
    2. 7.2 機能ブロック図
    3. 7.3 組み合わせロジックの構成
    4. 7.4 機能説明
      1. 7.4.1 平衡化された CMOS 3 ステート出力
      2. 7.4.2 TTL 互換 シュミット トリガーCMOS 入力
      3. 7.4.3 クランプ ダイオード構造
    5. 7.5 デバイスの機能モード
  9. 8 アプリケーションと実装
    1. 8.1 アプリケーション情報
    2. 8.2 代表的なアプリケーション
      1. 8.2.1 設計要件
        1. 8.2.1.1 電源に関する考慮事項
        2. 8.2.1.2 入力に関する考慮事項
        3. 8.2.1.3 出力に関する考慮事項
      2. 8.2.2 詳細な設計手順
      3. 8.2.3 アプリケーション曲線
    3. 8.3 電源に関する推奨事項
    4. 8.4 レイアウト
      1. 8.4.1 レイアウトのガイドライン
      2. 8.4.2 レイアウト例
  10. 9 デバイスおよびドキュメントのサポート
    1. 9.1 ドキュメントのサポート
      1. 9.1.1 関連資料
    2. 9.2 ドキュメントの更新通知を受け取る方法
    3. 9.3 サポート・リソース
    4. 9.4 商標
    5. 9.5 静電気放電に関する注意事項
    6. 9.6 用語集
  11. 10改訂履歴
  12. 11メカニカル、パッケージ、および注文情報

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

3 概要

SN74ACT3G99 デバイスには、3 ステート出力を備えた 3 つの独立した構成可能なロジック ゲートが内蔵されています。各ゲートには 4 つの入力があり、ブール関数 Y = (A•C+ B•C)⊕D を実行します。

製品情報
部品番号パッケージ (1)パッケージ サイズ(2)本体サイズ (3)
SN74ACT3G99DGS (VSSOP、20)7.2mm × 7.8mm7.2mm × 5.3mm
PW (TSSOP、20)6.5mm × 6.4mm6.5mm × 4.4mm
RKS (VQFN、20) 4.5mm × 2.5mm 4.5mm × 2.5mm
(1) 詳細については、セクション 11 を参照してください。
(2) パッケージ サイズ (長さ × 幅) は公称値であり、該当する場合はピンも含まれます。
(3) 本体サイズ (長さ×幅) は公称値であり、ピンは含まれません。
SN74ACT3G99 機能図機能図