JAJSQW5 august   2023 SN74AHC126-Q1

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 改訂履歴
  6. 5 ピン構成と機能
  7. 6 仕様
    1. 6.1  絶対最大定格
    2. 6.2  ESD 定格
    3. 6.3  推奨動作条件
    4. 6.4  熱に関する情報
    5. 6.5  電気的特性
    6. 6.6  スイッチング特性、VCC = 3.3V ± 0.3V
    7. 6.7  スイッチング特性、VCC = 5V±0.5V
    8. 6.8  ノイズ特性
    9. 6.9  動作特性
    10. 6.10 標準的特性
  8. 7 パラメータ測定情報
  9. 8 詳細説明
    1. 8.1 概要
    2. 8.2 機能ブロック図
    3. 8.3 機能説明
      1. 8.3.1 平衡な CMOS 3 ステート出力
      2. 8.3.2 標準 CMOS 入力
      3. 8.3.3 ウェッタブル・フランク
      4. 8.3.4 クランプ・ダイオード構造
    4. 8.4 デバイスの機能モード
  10. 9 アプリケーションと実装
    1. 9.1 アプリケーション情報
    2. 9.2 代表的なアプリケーション
      1. 9.2.1 設計要件
        1. 9.2.1.1 電源に関する考慮事項
        2. 9.2.1.2 入力に関する考慮事項
        3. 9.2.1.3 出力に関する考慮事項
      2. 9.2.2 詳細な設計手順
      3. 9.2.3 アプリケーション曲線
    3. 9.3 電源に関する推奨事項
    4. 9.4 レイアウト
      1. 9.4.1 レイアウトのガイドライン
      2. 9.4.2 レイアウト例
  11. 10デバイスおよびドキュメントのサポート
    1. 10.1 ドキュメントの更新通知を受け取る方法
    2. 10.2 サポート・リソース
    3. 10.3 商標
    4. 10.4 静電気放電に関する注意事項
    5. 10.5 用語集
  12. 11メカニカル、パッケージ、および注文情報

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

7 パラメータ測定情報

以下の表に示す例では、波形間の位相関係を任意に選択しました。すべての入力パルスは、以下の特性を持つジェネレータから供給されます：PRR ≦ 1MHz、ZO = 50Ω、tt < 3 ns。

出力は個別に測定され、測定するたびに入力が 1 回遷移します。

テスト S1 S2 RL CL Δ V VCC
tPLH、tPHL オープン オープン — 15pF 、 50pF — すべて
tPLZ、tPZL クローズ オープン 1kΩ 15pF 、 50pF 0.15V ≤ 2.5V
tPHZ、tPZH オープン クローズ 1kΩ 15pF 、 50pF 0.15V ≤ 2.5V
tPLZ、tPZL クローズ オープン 1kΩ 15pF 、 50pF 0.3V > 2.5 V
tPHZ、tPZH オープン クローズ 1kΩ 15pF 、 50pF 0.3V > 2.5 V

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(1) CL にはプローブとテスト装置の容量が含まれます。
図 7-1 3 ステート出力用負荷回路
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(3) tPZL と tPZH の大きいほうは、ten と等しくなります。
(4) tPLZ と tPHZ の大きいほうは、tdis と等しくなります。
図 7-3 電圧波形の伝搬遅延
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他のすべての出力を同時にスイッチングして測定されたノイズ値。
図 7-5 電圧波形、ノイズ
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(1) tPLH と tPHL の大きいほうは、tpd と等しくなります。
図 7-2 電圧波形の伝搬遅延
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(1) tr と tf の大きいほうは、tt と等しくなります。
図 7-4 電圧波形、入力および出力の遷移時間