JAJSTG7 March   2024 SN74AHC238

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 ピン構成および機能
    1.     6
    2.     7
  6. 5 仕様
    1. 5.1 絶対最大定格
    2. 5.2 ESD 定格
    3. 5.3 推奨動作条件
    4. 5.4 熱に関する情報
    5. 5.5 電気的特性
    6. 5.6 スイッチング特性
    7. 5.7 ノイズ特性
  7. 6 パラメータ測定情報
  8. 7 詳細説明
    1. 7.1 概要
    2. 7.2 機能ブロック図
    3. 7.3 機能説明
      1. 7.3.1 平衡化された CMOS プッシュプル出力
      2. 7.3.2 標準 CMOS 入力
      3. 7.3.3 クランプ ダイオード構造
    4. 7.4 デバイスの機能モード
  9. 8 アプリケーションと実装
    1. 8.1 アプリケーション情報
    2. 8.2 代表的なアプリケーション
    3. 8.3 設計要件
      1. 8.3.1 電源に関する考慮事項
      2. 8.3.2 入力に関する考慮事項
      3. 8.3.3 出力に関する考慮事項
    4. 8.4 詳細な設計手順
    5. 8.5 アプリケーション曲線
    6. 8.6 電源に関する推奨事項
    7. 8.7 レイアウト
      1. 8.7.1 レイアウトのガイドライン
      2. 8.7.2 レイアウト例
  10. 9 デバイスおよびドキュメントのサポート
    1. 9.1 ドキュメントの更新通知を受け取る方法
    2. 9.2 サポート・リソース
    3. 9.3 商標
    4. 9.4 静電気放電に関する注意事項
    5. 9.5 用語集
  11. 10改訂履歴
  12. 11メカニカル、パッケージ、および注文情報

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

7.1 概要

SN74AHC238 は、メモリ アドレス デコードまたはデータ ルーティング アプリケーションに最適な高速シリコン ゲート CMOS デコーダです。シングル 3:8 デコーダを搭載しています。

SN74AHC238 には 3 つのアドレス選択入力 (A2、A1、A0) があります。この回路は通常の 1:8 デコーダとして機能します。

カスケード接続を簡素化し、多重分離を容易にするため、 3 つのストローブ入力 (G2、G1、 G0) が用意されています。いずれかの入力ストローブがアクティブのとき、すべての出力が強制的に LOW 状態になります。

多重分離機能は、最初に選択入力を使って必要な出力を選択し、次にストローブ入力のうちの 1 つをデータ入力として使うことで実現されます。

SN74AHC238 の出力は通常は Low であり、選択されると High になります。