JAJSTZ4 March   2024 SN74AHCT164-Q1

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 ピン構成および機能
  6.   6
  7. 5 仕様
    1. 5.1 絶対最大定格
    2. 5.2 ESD 定格
    3. 5.3 推奨動作条件
    4. 5.4 熱に関する情報
    5. 5.5 電気的特性
    6. 5.6 タイミング特性
    7. 5.7 スイッチング特性
    8. 5.8 ノイズ特性
    9. 5.9 代表的特性
  8. 6 パラメータ測定情報
  9. 7 詳細説明
    1. 7.1 概要
    2. 7.2 機能ブロック図
    3. 7.3 機能説明
      1. 7.3.1 平衡化された CMOS プッシュプル出力
      2. 7.3.2 ラッチ ロジック
      3. 7.3.3 TTL 互換 CMOS 入力
      4. 7.3.4 ウェッタブル フランク
      5. 7.3.5 クランプ ダイオード構造
    4. 7.4 デバイスの機能モード
  10. 8 アプリケーションと実装
    1. 8.1 アプリケーション情報
    2. 8.2 代表的なアプリケーション
    3. 8.3 設計要件
      1. 8.3.1 電源に関する考慮事項
      2. 8.3.2 入力に関する考慮事項
      3. 8.3.3 出力に関する考慮事項
    4. 8.4 詳細な設計手順
    5. 8.5 アプリケーション曲線
    6. 8.6 電源に関する推奨事項
    7. 8.7 レイアウト
      1. 8.7.1 レイアウトのガイドライン
      2. 8.7.2 レイアウト例
  11. 9 デバイスおよびドキュメントのサポート
    1. 9.1 ドキュメントのサポート
      1. 9.1.1 関連資料
    2. 9.2 ドキュメントの更新通知を受け取る方法
    3. 9.3 サポート・リソース
    4. 9.4 商標
    5. 9.5 静電気放電に関する注意事項
    6. 9.6 用語集
  12. 10改訂履歴
  13. 11メカニカル、パッケージ、および注文情報

パッケージ・オプション

デバイスごとのパッケージ図は、PDF版データシートをご参照ください。

メカニカル・データ（パッケージ｜ピン）
  • PW|14
  • BQA|14
サーマルパッド・メカニカル・データ
発注情報

3 概要

SN74AHCT164-Q1 は、AND ゲート付きシリアル入力と非同期クリア (CLR) 入力を備えた 8 ビット シフト レジスタです。出力は内部シフト レジスタに直接接続されているので、値がレジスタにシフトされるとすぐに出力が変化します。ゲート付きシリアル (A および B) 入力により受信データを完全に制御できます。どちらかの入力を LOW にすると新しいデータの入力が禁止され、次のクロック (CLK) パルスで第 1 のフリップ フロップが LOW レベルにリセットされます。入力を HIGH レベルにすると反対側の入力が有効になり、第 1 のフリップ フロップの状態が決定されます。シリアル入力のデータは、CLK が HIGH または LOW の間に変更できます (最小セットアップ時間要件が満たされた場合)。CLK が LOW レベルから HIGH レベルに遷移するときにクロックが動作します。

パッケージ情報
部品番号パッケージ (1)パッケージ サイズ(2)本体サイズ (公称)(3)
SN74AHCT164-Q1BQA (WQFN、14)3mm × 2.5mm3mm × 2.5mm
PW (TSSOP、14)5mm × 6.4mm5mm × 4.4mm
(1) 詳細については、セクション 11 を参照してください。
(2) パッケージ サイズ (長さ×幅) は公称値であり、該当する場合はピンも含まれます
(3) 本体サイズ (長さ×幅) は公称値であり、ピンは含まれません。
GUID-20240214-SS0I-LMSV-W0TF-6F0NVBVG2LTN-low.svg論理図 (正論理)