JAJSV94N December   1995  – August 2024 SN54AHCT540 , SN74AHCT540

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 概要
  4. 3 Pin Configuration and Functions
  5. 4 Specifications
    1. 4.1 Absolute Maximum Ratings
    2. 4.2 ESD Ratings
    3. 4.3 Recommended Operating Conditions
    4. 4.4 Thermal Information
    5. 4.5 Electrical Characteristics
    6. 4.6 Switching Characteristics
    7. 4.7 Operating Characteristics
  6. 5 Parameter Measurement Information
  7. 6 Detailed Description
    1. 6.1 Overview
    2. 6.2 Functional Block Diagram
    3. 6.3 Device Functional Modes
  8. 7 Application and Implementation
    1. 7.1 Power Supply Recommendations
    2. 7.2 Layout
      1. 7.2.1 Layout Guidelines
      2. 7.2.2 Layout Example
  9. 8 Device and Documentation Support
    1. 8.1 Documentation Support (Analog)
      1. 8.1.1 Related Links
    2. 8.2 ドキュメントの更新通知を受け取る方法
    3. 8.3 サポート・リソース
    4. 8.4 Trademarks
    5. 8.5 静電気放電に関する注意事項
    6. 8.6 用語集
  10. 9 Revision History
  11. 10Mechanical, Packaging, and Orderable Information

パッケージ・オプション

デバイスごとのパッケージ図は、PDF版データシートをご参照ください。

メカニカル・データ（パッケージ｜ピン）
  • DGV|20
  • DB|20
  • NS|20
  • N|20
  • DW|20
  • PW|20
サーマルパッド・メカニカル・データ
発注情報

3 Pin Configuration and Functions

SN74AHCT540 SN54AHCT540 SN54AHCT540: J Package, 20-Pin CDIP; SN74AHCT540: DB, DGV, DW, N, NS, or PW Package; 20-Pin SSOP, TVSOP, SOIC, PDIP, PDIP, or TSSOP(Top View)Figure 3-1 SN54AHCT540: J Package, 20-Pin CDIP; SN74AHCT540: DB, DGV, DW, N, NS, or PW Package; 20-Pin SSOP, TVSOP, SOIC, PDIP, PDIP, or TSSOP(Top View)
Table 3-1 Pin Functions
PIN I/O DESCRIPTION
NO. NAME
1 OE1 I Output Enable 1
2 A1 I A1 Input
3 A2 I A2 Input
4 A3 I A3 Input
5 A4 I A4 Input
6 A5 I A5 Input
7 A6 I A6 Input
8 A7 I A7 Input
9 A8 I A8 Input
10 GND — Ground
11 Y8 O Y8 Output
12 Y7 O Y7 Output
13 Y6 O Y6 Output
14 Y5 O Y5 Output
15 Y4 O Y4 Output
16 Y3 O Y3 Output
17 Y2 O Y2 Output
18 Y1 O Y1 Output
19 OE2 I Output Enable 2
20 VCC — Power Pin