JAJSHP0F July   2019  – January 2024 SN74AXC4T245-Q1

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 ピン構成および機能
  6. 5 仕様
    1. 5.1  絶対最大定格
    2. 5.2  ESD 定格
    3. 5.3  推奨動作条件
    4. 5.4  熱に関する情報
    5. 5.5  電気的特性
    6. 5.6  スイッチング特性、VCCA = 0.7V ± 0.05V
    7. 5.7  スイッチング特性、VCCA = 0.8V ± 0.04V
    8. 5.8  スイッチング特性、VCCA = 0.9V ± 0.045V
    9. 5.9  スイッチング特性、VCCA = 1.2V ± 0.1V
    10. 5.10 スイッチング特性、VCCA = 1.5V ± 0.1V
    11. 5.11 スイッチング特性、VCCA = 1.8V ± 0.15V
    12. 5.12 スイッチング特性、VCCA = 2.5V ± 0.2V
    13. 5.13 スイッチング特性、VCCA = 3.3V ± 0.3V
    14. 5.14 動作特性：TA = 25℃
    15. 5.15 代表的特性
  7. 6 パラメータ測定情報
    1. 6.1 負荷回路および電圧波形
  8. 7 詳細説明
    1. 7.1 概要
    2. 7.2 機能ブロック図
    3. 7.3 機能説明
      1. 7.3.1  標準 CMOS 入力
      2. 7.3.2  バランスのとれた高駆動能力の CMOS プッシュプル出力
      3. 7.3.3  部分的パワーダウン (Ioff)
      4. 7.3.4  VCC 絶縁
      5. 7.3.5  過電圧許容入力
      6. 7.3.6  グリッチの発生しない電源シーケンシング
      7. 7.3.7  負のクランプ ダイオード
      8. 7.3.8  フル構成可能なデュアル レール設計
      9. 7.3.9  スタティック プルダウン抵抗内蔵の I/O
      10. 7.3.10 高速変換をサポート
      11. 7.3.11 ウェッタブル・フランク
    4. 7.4 デバイスの機能モード
  9. 8 アプリケーションと実装
    1. 8.1 アプリケーション情報
    2. 8.2 代表的なアプリケーション
      1. 8.2.1 設計要件
      2. 8.2.2 詳細な設計手順
      3. 8.2.3 アプリケーション曲線
    3. 8.3 電源に関する推奨事項
    4. 8.4 レイアウト
      1. 8.4.1 レイアウトのガイドライン
      2. 8.4.2 レイアウト例
  10. 9 デバイスおよびドキュメントのサポート
    1. 9.1 ドキュメントのサポート
      1. 9.1.1 関連資料
    2. 9.2 ドキュメントの更新通知を受け取る方法
    3. 9.3 サポート・リソース
    4. 9.4 商標
    5. 9.5 静電気放電に関する注意事項
    6. 9.6 用語集
  11. 10改訂履歴
  12. 11メカニカル、パッケージ、および注文情報

パッケージ・オプション

デバイスごとのパッケージ図は、PDF版データシートをご参照ください。

メカニカル・データ（パッケージ｜ピン）
  • PW|16
  • BQB|16
  • RSV|16
サーマルパッド・メカニカル・データ
発注情報

6.1 負荷回路および電圧波形

特に記述のない限り、すべての入力パルスは、以下の特性を持つジェネレータで生成されます。

  • f = 1MHz
  • ZO = 50Ω
  • dv/dt ≦ 1ns/V

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A. CL にはプローブと治具の容量が含まれます。
図 6-1 負荷回路
表 6-1 負荷回路の条件
パラメータVCCORLCLS1VTP
Δt/Δv入力遷移の立ち上がりまたは立ち下がりレート0.65V～3.6V1MΩ15pFオープン該当なし
tpd伝搬 (遅延) 時間1.1V～3.6V2kΩ15pFオープン該当なし
0.65V～0.95V20kΩ15pFオープン該当なし
ten、tdisイネーブル時間、ディセーブル時間3V～3.6V2kΩ15pF2 × VCCO0.3V
1.65V～2.7V2kΩ15pF2 × VCCO0.15V
1.1V～1.6V2kΩ15pF2 × VCCO0.1V
0.65V～0.95V20kΩ15pF2 × VCCO0.1V
ten、tdisイネーブル時間、ディセーブル時間3V～3.6V2kΩ15pFGND0.3V
1.65V～2.7V2kΩ15pFGND0.15V
1.1V～1.6V2kΩ15pFGND0.1V
0.65V～0.95V20kΩ15pFGND0.1V
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  1. VCCI は、入力ポートに関連付けられた電源ピンです。
  2. VOH と VOL は、指定した RL、CL、S1 で発生する標準出力電圧レベルです。
図 6-2 伝搬遅延
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  1. VCCI は、入力ポートに関連付けられた電源ピンです。
  2. VOH と VOL は、指定した RL、CL、S1 で発生する標準出力電圧レベルです。
図 6-3 入力遷移の立ち上がりまたは立ち下がりレート
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A. 入力が有効なロジック Low に駆動されたときの出力波形。
B. 入力が有効なロジック High に駆動されたときの出力波形。
C. VCCO は、出力ポートに関連付けられた電源ピンです。
D. VOH と VOL は、指定した RL、CL、S1 における標準出力電圧レベルです。
図 6-4 イネーブル時間とディセーブル時間