JAJSOC3F December   1982  – March 2022 SN54HC259 , SN74HC259

PRODUCTION DATA  

  1. 1 特長
  2. 2 概要
  3. 3 Revision History
  4. 4 Pin Configuration and Functions
  5. 5 Specifications
    1. 5.1 Absolute Maximum Ratings
    2. 5.2 Recommended Operating Conditions (1)
    3. 5.3 Thermal Information
    4. 5.4 Electrical Characteristics
    5. 5.5 Timing Requirements
    6. 5.6 Switching Characteristics
    7. 5.7 Operating Characteristics
  6. 6 Parameter Measurement Information
  7. 7 Detailed Description
    1. 7.1 Overview
    2. 7.2 Functional Block Diagram
    3. 7.3 Device Functional Modes
  8. 8 Power Supply Recommendations
  9. 9 Layout
    1. 9.1 Layout Guidelines
  10. 10Device and Documentation Support
    1. 10.1 Receiving Notification of Documentation Updates
    2. 10.2 サポート・リソース
    3. 10.3 Trademarks
    4. 10.4 Electrostatic Discharge Caution
    5. 10.5 Glossary
  11. 11Mechanical, Packaging, and Orderable Information

パッケージ・オプション

デバイスごとのパッケージ図は、PDF版データシートをご参照ください。

メカニカル・データ（パッケージ｜ピン）
  • PW|16
  • DYY|16
  • NS|16
  • N|16
  • D|16
サーマルパッド・メカニカル・データ
発注情報

7.3 Device Functional Modes

Table 7-1 Function Table
INPUTS OUTPUT OF ADDRESSED LATCH EACH OTHER OUTPUT FUNCTION
CLR G
H L D QiO Addressable latch
H H QiO QiO Memory
L L D L 8-line demultiplexer
L H L L Clear
Table 7-2 Latch Selection Table
SELECT INPUTS LATCH
ADDRESSED
S2 S1 S0
L L L 0
L L H 1
L H L 2
L H H 3
H L L 4
H L H 5
H H L 6
H H H 7