JAJSHI9G March   2004  – June 2019 SN74LVC1G08-Q1

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  1. 1 特長
  2. 2 アプリケーション
  3. 3 概要
    1.     Device Images
  4. 4 改訂履歴
  5. 5 Pin Configuration and Functions
    1.     Pin Functions
  6. 6 Specifications
    1. 6.1 Absolute Maximum Ratings
    2. 6.2 ESD Ratings
    3. 6.3 Recommended Operating Conditions
    4. 6.4 Thermal Information
    5. 6.5 Electrical Characteristics
    6. 6.6 Switching Characteristics, TA = –40°C to 125°C
    7. 6.7 Switching Characteristics, TA = –40°C to 85°C
    8. 6.8 Operating Characteristics
    9. 6.9 Typical Characteristics
  7. 7 Parameter Measurement Information
  8. 8 Detailed Description
    1. 8.1 Overview
    2. 8.2 Functional Block Diagram
    3. 8.3 Feature Description
    4. 8.4 Device Functional Modes
  9. 9 Application and Implementation
    1. 9.1 Application Information
    2. 9.2 Typical Application
      1. 9.2.1 Design Requirements
      2. 9.2.2 Detailed Design Procedure
      3. 9.2.3 Application Curves
  10. 10Power Supply Recommendations
  11. 11Layout
    1. 11.1 Layout Guidelines
    2. 11.2 Layout Example
  12. 12デバイスおよびドキュメントのサポート
    1. 12.1 商標
    2. 12.2 静電気放電に関する注意事項
    3. 12.3 Glossary
  13. 13メカニカル、パッケージ、および注文情報

パッケージ・オプション

デバイスごとのパッケージ図は、PDF版データシートをご参照ください。

メカニカル・データ（パッケージ｜ピン）
  • DBV|5
  • DCK|5
  • DRY|6
サーマルパッド・メカニカル・データ
発注情報

3 概要

この単一 2 入力の正 AND ゲートは、1.65V～5.5V の VCC で動作するよう設計されています。

SN74LVC1G08-Q1 デバイスは、ブール関数 SN74LVC1G08-Q1 ineq_ces217.gif を正論理で実行します。

このデバイスは、Ioff を使用する部分的パワーダウン・アプリケーション用に完全に動作が規定されています。Ioff 回路が出力をディセーブルするため、電源オフ時にデバイスに電流が逆流して損傷を引き起こすことを防止できます。

CMOS デバイスは出力駆動能力が大きく、広い VCC 動作範囲にわたって、静止電力消費が低く保たれます。

SN74LVC1G08 は、本体サイズ 1.45mm × 1.00mm の小型 DRY パッケージなど、各種のパッケージで供給されます。

製品情報(1)

型番 パッケージ 本体サイズ
SN74LVC1G08Q SOT-23 (5) 2.90mm × 1.60mm
SC70 (5) 2.00mm × 1.25mm
SON (6) 事前情報 1.45mm × 1.00mm
  1. 利用可能なすべてのパッケージについては、このデータシートの末尾にある注文情報を参照してください。