JAJSUY3 July   2024 SN74LVC258A

PRODUCTION DATA  

  1.   1
  2. 特長
  3. アプリケーション
  4. 概要
  5. ピン構成および機能
  6. 仕様
    1. 5.1 絶対最大定格
    2. 5.2 ESD 定格
    3. 5.3 推奨動作条件
    4. 5.4 熱に関する情報
    5. 5.5 電気的特性
    6. 5.6 スイッチング特性
    7. 5.7 ノイズ特性
    8. 5.8 代表的特性
  7. パラメータ測定情報
  8. 詳細説明
    1. 7.1 概要
    2. 7.2 機能ブロック図
    3. 7.3 機能説明
      1. 7.3.1 平衡化された CMOS 3 ステート出力
      2. 7.3.2 部分的パワー ダウン (Ioff)
      3. 7.3.3 標準 CMOS 入力
      4. 7.3.4 クランプ ダイオード構造
    4. 7.4 デバイスの機能モード
  9. アプリケーションと実装
    1. 8.1 アプリケーション情報
    2. 8.2 代表的なアプリケーション
      1. 8.2.1 設計要件
        1. 8.2.1.1 電源に関する考慮事項
        2. 8.2.1.2 入力に関する考慮事項
        3. 8.2.1.3 出力に関する考慮事項
      2. 8.2.2 詳細な設計手順
      3. 8.2.3 アプリケーション曲線
    3. 8.3 電源に関する推奨事項
    4. 8.4 レイアウト
      1. 8.4.1 レイアウトのガイドライン
      2. 8.4.2 レイアウト例
  10. デバイスおよびドキュメントのサポート
    1. 9.1 ドキュメントのサポート
      1. 9.1.1 関連資料
    2. 9.2 ドキュメントの更新通知を受け取る方法
    3. 9.3 サポート・リソース
    4. 9.4 商標
    5. 9.5 静電気放電に関する注意事項
    6. 9.6 用語集
  11. 10改訂履歴
  12. 11メカニカル、パッケージ、および注文情報

パッケージ・オプション

デバイスごとのパッケージ図は、PDF版データシートをご参照ください。

メカニカル・データ(パッケージ|ピン)
  • PW|16
サーマルパッド・メカニカル・データ
発注情報

パラメータ測定情報

以下の表に示す例では、波形間の位相関係を任意に選択しました。すべての入力パルスは、以下の特性を持つジェネレータによって供給されます。PRR ≦ 1MHz、ZO = 50Ω、tt ≦ 2.5ns。

出力は個別に測定され、測定するたびに入力が 1 回遷移します。

TEST S1 S2 RL CL ΔV VLOAD
tPLH、tPHL オープン オープン 500Ω 50pF
tPLZ、tPZL クローズ オープン 500Ω 50pF 0.3V 2 × VCC
tPHZ、tPZH オープン クローズ 500Ω 50pF 0.3V

VCC Vt RL CL ΔV VLOAD
1.2V ± 0.1V VCC/2 2kΩ 15pF 0.1V 2 × VCC
1.5V ± 0.12V VCC/2 2kΩ 15pF 0.1V 2 × VCC
1.8V ± 0.15V VCC/2 1kΩ 30pF 0.15V 2 × VCC
2.5V ± 0.2V VCC/2 500Ω 30pF 0.15V 2 × VCC
2.7V 1.5V 500Ω 50pF 0.3V 6V
3.3V ± 0.3V 1.5V 500Ω 50pF 0.3V 6V

SN74LVC258A  3 ステート出力の負荷回路
(1) CL にはプローブとテスト装置の容量が含まれます。
図 6-1 3 ステート出力の負荷回路
SN74LVC258A  電圧波形、伝搬遅延
(1) tPZL と tPZH の大きい方が ten に相当します。
(2) tPLZ と tPHZ の大きい方が tdis に相当します。
図 6-3 電圧波形、伝搬遅延
SN74LVC258A  電圧波形、ノイズ
他のすべての出力を同時にスイッチングして測定されたノイズ値。
図 6-5 電圧波形、ノイズ
SN74LVC258A  電圧波形、伝搬遅延
(1) tPLH と tPHL の大きい方が tpd に相当します。
図 6-2 電圧波形、伝搬遅延
SN74LVC258A  電圧波形、入力および出力の遷移時間
(1) tr と tf の大きい方が tt に相当します。
図 6-4 電圧波形、入力および出力の遷移時間