JAJSOW0A July   2022  – July 2023 TDP1204

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 Revision History
  6. 5 Pin Configuration and Functions
  7. 6 Specifications
    1. 6.1 Absolute Maximum Ratings
    2. 6.2 ESD Ratings
    3. 6.3 Recommended Operating Conditions
    4. 6.4 Thermal Information
    5. 6.5 Electrical Characteristics
    6. 6.6 Timing Requirements
    7. 6.7 Switching Characteristics
    8. 6.8 Typical Characteristics
  8. 7 Parameter Measurement Information
  9. 8 Detailed Description
    1. 8.1 Functional Block Diagram
    2. 8.2 Feature Description
      1. 8.2.1  4-Level Inputs
      2. 8.2.2  I/O Voltage Level Selection
      3. 8.2.3  HPD_OUT
      4. 8.2.4  Lane Control
      5. 8.2.5  Swap
      6. 8.2.6  Linear and Limited Redriver
      7. 8.2.7  Main Link Inputs
      8. 8.2.8  Receiver Equalizer
      9. 8.2.9  CTLE Bypass
      10. 8.2.10 Adaptive Equalization in HDMI 2.1 FRL
        1. 8.2.10.1 HDMI 2.1 TX Compliance Testing with AEQ Enabled
      11. 8.2.11 HDMI 2.1 Link Training Compatible Rx EQ
      12. 8.2.12 Input Signal Detect
      13. 8.2.13 Main Link Outputs
        1. 8.2.13.1 Transmitter Bias
        2. 8.2.13.2 Transmitter Impedance Control
        3. 8.2.13.3 TX Slew Rate Control
        4. 8.2.13.4 TX Pre-Emphasis and De-Emphasis Control
        5. 8.2.13.5 TX Swing Control
      14. 8.2.14 DDC Buffer
      15. 8.2.15 HDMI DDC Capacitance
      16. 8.2.16 DisplayPort
    3. 8.3 Device Functional Modes
      1. 8.3.1 MODE Control
        1. 8.3.1.1 I2C Mode (MODE = "F")
        2. 8.3.1.2 Pin Strap Modes
          1. 8.3.1.2.1 Pin-Strap: HDMI 1.4 and HDMI 2.0 Functional Description
          2. 8.3.1.2.2 Pin-Strap HDMI 2.1 Function (MODE = "0"): Fixed Rx EQ and DDC Buffer Enabled
          3. 8.3.1.2.3 Pin-Strap HDMI 2.1 Function (MODE = "1"): Flexible RX EQ and DDC Buffer Enabled
          4. 8.3.1.2.4 Pin-Strap HDMI 2.1 Function (MODE = "R"): Flexible Rx EQ and DDC Buffer Disabled
      2. 8.3.2 DDC Snoop Feature
        1. 8.3.2.1 HDMI Type
        2. 8.3.2.2 HDMI 2.1 FRL Snoop
      3. 8.3.3 Low Power States
    4. 8.4 Programming
      1. 8.4.1 Pseudocode Examples
        1. 8.4.1.1 HDMI 2.1 Source Example with DDC Snoop and DDC Buffer Enabled
        2. 8.4.1.2 HDMI 2.1 Source Example with DDC Snoop Disabled and DDC Buffer Disabled
      2. 8.4.2 TDP1204 I2C Address Options
      3. 8.4.3 I2C Target Behavior
    5. 8.5 Register Maps
      1. 8.5.1 TDP1204 Registers
  10. 9 Application and Implementation
    1. 9.1 Application Information
    2. 9.2 Typical Source-Side Application
      1. 9.2.1 Design Requirements
      2. 9.2.2 Detailed Design Procedure
        1. 9.2.2.1 Pre-Channel (LAB)
        2. 9.2.2.2 Post-Channel (LCD)
        3. 9.2.2.3 Common Mode Choke
        4. 9.2.2.4 ESD Protection
      3. 9.2.3 Application Curves
    3. 9.3 Typical Sink-Side Application
      1. 9.3.1 Design Requirements
      2. 9.3.2 Detailed Design Procedures
    4. 9.4 Power Supply Recommendations
      1. 9.4.1 Supply Decoupling
    5. 9.5 Layout
      1. 9.5.1 Layout Guidelines
      2. 9.5.2 Layout Example
  11. 10デバイスおよびドキュメントのサポート
    1. 10.1 ドキュメントのサポート
      1. 10.1.1 関連資料
    2. 10.2 ドキュメントの更新通知を受け取る方法
    3. 10.3 サポート・リソース
    4. 10.4 商標
    5. 10.5 静電気放電に関する注意事項
    6. 10.6 用語集
  12. 11Mechanical, Packaging, and Orderable Information

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

3 概要

TDP1204 は、最大 12Gbps のデータ・レートをサポートする HDMI 2.1 リドライバです。HDMI 1.4b および HDMI 2.0b と下位互換性があります。高速な差動入力および出力は AC 結合と DC 結合のどちらにも対応できるため、DP++ から HDMI へのレベル・シフタとしても、HDMI リドライバとしても、TDP1204 を使うことができます。TDP1204 は、3 レーンと 4 レーンの HDMI 2.1 FRL の両方を 3、6、8、10、12Gbps でサポートできます。

TDP1204 は、ソースとシンクの両方のアプリケーションをサポートするハイブリッド・リドライバです。ハイブリッド・リドライバは、リニア・リドライバ機能とリミッティング・リドライバ機能のどちらでも動作できます。リミッティング・リドライバとして構成した場合、TDP1204 の差動出力電圧レベルは、グラフィックス処理ユニット (GPU) の出力レベルと無関係になるため、HDMI に準拠したレベルをレセプタクルで確保できます。リミッティング・リドライバ・モードは、HDMI ソース・アプリケーションに推奨されます。リニア・リドライバとして構成した場合、TDP1204 の差動出力レベルは GPU 出力レベルの線形関数になるため、リンク・トレーニングに対して TDP1204 を透過的にして、チャネル・ショートナとして動作させることができます。リニア・リドライバ・モードは HDMI シンク・アプリケーションに推奨されます。

TDP1204 は HPD レベル・シフタを内蔵しています。この HPD レベル・シフタは 5V の HPD 信号を 1.8V または 3.3V に変換します。レベル・シフタの出力は、プッシュ、プルまたはオープン・ドレインに構成することもできます。TDP1204 にはデジタル・ディスプレイ制御 (DDC) バッファも内蔵されています。この DDC バッファにより、容量性絶縁と、5V の DDC レベルから 3.3V、1.8V、1.2V の電圧レベルへのレベル・シフトが可能です。レベル・シフタを内蔵しているため、ディスクリート・ソリューションが不要であり、システム・コストを節約できます。

TDP1204 は、VCC として 3.3V の単一電源レールをサポートしており、民生用温度仕様 (TDP1204) と産業用温度仕様 (TDP1204I) で提供しています。

製品情報
部品番号 (1) 温度 パッケージ
TDP1204 Ta = 0℃～70℃ RNQ (WQFN、40)
TDP1204I Ta = -40℃～85℃
(1) 利用可能なすべてのパッケージについては、このデータシートの末尾にある注文情報を参照してください。