JAJA725B march   2023  – june 2023 MSPM0G1105 , MSPM0G1106 , MSPM0G1107 , MSPM0G1505 , MSPM0G1506 , MSPM0G1507 , MSPM0G3105 , MSPM0G3106 , MSPM0G3107 , MSPM0G3505 , MSPM0G3506 , MSPM0G3507

 

  1.   1
  2.   概要
  3.   商標
  4. 1 MSPM0G ハードウェア設計チェック・リスト
  5. 2 MSPM0G デバイスの電源
    1. 2.1 デジタル電源
    2. 2.2 アナログ電源
    3. 2.3 電源および電圧リファレンスを内蔵
    4. 2.4 電源に推奨されるデカップリング回路
  6. 3 リセットおよび電源スーパーバイザ
    1. 3.1 デジタル電源
    2. 3.2 電源スーパーバイザ
  7. 4 クロック・システム
    1. 4.1 内部発振器
    2. 4.2 外部発振器
    3. 4.3 外部クロック出力 (CLK_OUT)
    4. 4.4 周波数クロック・カウンタ (FCC)
  8. 5 デバッガ
    1. 5.1 デバッグ・ポートのピンとピン配置
    2. 5.2 標準 JTAG コネクタを使用したデバッグ・ポート接続
  9. 6 主要なアナログペリフェラル
    1. 6.1 ADC 設計の検討事項
    2. 6.2 OPA 設計の検討事項
    3. 6.3 DAC 設計の検討事項
    4. 6.4 COMP 設計の検討事項
    5. 6.5 GPAMP 設計の検討事項
  10. 7 主要なデジタル・ペリフェラル
    1. 7.1 タイマ・リソースと設計の検討事項
    2. 7.2 UART と LIN のリソースと設計の検討事項
    3. 7.3 MCAN 設計の検討事項
    4. 7.4 I2C と SPI 設計の検討事項
  11. 8 GPIO
    1. 8.1 GPIO 出力のスイッチング速度と負荷容量
    2. 8.2 GPIO 電流シンクおよびソース
    3. 8.3 高速 GPIO (HSIO)
    4. 8.4 高駆動 GPIO (HDIO)
    5. 8.5 オープン・ドレイン GPIO により、レベル・シフタなしで 5V 通信を実現
    6. 8.6 レベル・シフタなしで 1.8V デバイスと通信する
    7. 8.7 未使用ピンの接続
  12. 9 レイアウト・ガイド
    1. 9.1 電源レイアウト
    2. 9.2 グランド・レイアウトに関する検討事項
    3. 9.3 トレース、ビア、その他の PCB コンポーネント
    4. 9.4 基板層の選択方法と推奨されるスタックアップ
  13. 10ブートローダー
    1. 10.1 ブートローダの紹介
    2. 10.2 ブートローダー・ハードウェア設計の検討事項
      1. 10.2.1 物理的通信インターフェイス
      2. 10.2.2 ハードウェア起動
  14. 11関連資料
  15. 12改訂履歴

7.2 UART と LIN のリソースと設計の検討事項

MSPM0G シリーズ MCU には、ユニバーサル非同期送受信機 (UART) が搭載されています。表 7-4 に示すように、UART0 は LIN、DALI、IrDA、ISO7816 マンチェスター符号化機能をサポートしています。

表 7-4 UART の特長
UART の特長 UART0 (拡張) UART1 (メイン)
停止およびスタンバイ・モードでアクティブ あり あり
送信 FIFO と受信 FIFO を分離 あり あり
ハードウェア・フロー制御をサポート あり あり
9 ビット構成をサポート あり あり
LIN モードをサポート あり -
DALI をサポート あり -
IrDA をサポート あり -
ISO7816 スマート・カードをサポート あり -
マンチェスター符号化をサポート あり -

MSPM0G UART モジュールは、ほぼすべての UART アプリケーションをサポートするため、パワー・ドメイン 1 で最高 10MHz のボー・データをサポートできます。

表 7-5 MSPM0G UART 仕様
パラメータ テスト条件 最小値 標準値 最大値 単位
fUART UART 入力クロック周波数 パワー・ドメイン 1 の UART 80 MHz
fUART UART 入力クロック周波数 パワー・ドメイン 0 の UART 40 MHz
fBITCLK BITCLK クロック周波数 (MBaud のボー・レートに等しい) パワー・ドメイン 1 の UART 10 MHz
fBITCLK BITCLK クロック周波数 (MBaud のボー・レートに等しい) 5 MHz
tSP 入力フィルタにより抑制されるスパイクのパルス持続時間 AGFSELx = 0 5 5.5 32 ns
AGFSELx = 1 8 15 55 ns
AGFSELx = 2 18 38 115 ns
AGFSELx = 3 30 74 165 ns

ローカル相互接続ネットワーク (LIN) は一般的に使用される低速ネットワーク・インターフェイスで、複数のリモート・レスポンダ・ノードと通信するコマンダ・ノードで構成されています。通信に必要なのは 1 本のワイヤのみであり、一般的に車両の配線ハーネスに含まれています。

TLIN1021A-Q1 のトランスミッタは最大 20kbps のデータ・レートをサポートしています。本トランシーバは、TXD ピン経由で LIN バスの状態を制御し、オープン・ドレインの RXD 出力ピンでバスの状態を報告します。このデバイスは、電磁気放射 (EME) を低減するために電流制限付き波形整形ドライバを備えています。

TLIN1021A-Q1 は、広い入力電圧動作範囲によって 12V アプリケーションに対応するように設計されています。このデバイスは低消費電力スリープ・モードと、LIN、WAKE ピン、EN ピンによる低消費電力モードからのウェークアップをサポートしています。このデバイスを使用すると、ノードに存在する可能性がある各種電源を TLIN1021A-Q1 の INH 出力ピンで選択的に有効にすることで、バッテリの消費電流をシステム・レベルで低減できます。図 7-1 に、テキサス・インスツルメンツ TLIN1021A LIN トランシーバを使用して実装されている代表的なインターフェイスを示します。

GUID-F95B039E-FCFA-4FB1-975B-B03DA1111EE7-low.png図 7-1 標準的な LIN TLIN1021A トランシーバ

通信に必要なのは 1 本のワイヤのみであり、一般的に車両の配線ハーネスに含まれています。図 7-2 および 図 7-3 に、テキサス・インスツルメンツ TLIN1021A LIN トランシーバを使用して実装されている代表的なインターフェイスを示します。詳細については、TLIN1021 データシートを参照してください。

GUID-452D63EA-A263-41DC-B4BD-4D376FC759E9-low.png図 7-2 MSPM0G を使用した代表的な LIN アプリケーション (コマンダ)
GUID-F9A69F67-B989-46FA-94C9-A40E0F2F03C8-low.png図 7-3 MSPM0G を使用した代表的な LIN アプリケーション (レスポンダ)