JAJSEI9B October   2017  – January 2018 UCC28056

PRODUCTION DATA.  

  1. 1 特長
  2. 2 アプリケーション
  3. 3 概要
    1.     スタンバイ消費電力
      1.      Device Images
        1.       アプリケーション概略図
  4. 4 改訂履歴
  5. 5 端子構成および機能
    1.     端子機能
  6. 6 仕様
    1. 6.1 絶対最大定格
    2. 6.2 ESD定格
    3. 6.3 推奨動作条件
    4. 6.4 熱特性
    5. 6.5 電気的特性
    6. 6.6 代表的特性
  7. 7 詳細説明
    1. 7.1 概要
    2. 7.2 機能ブロック図
    3. 7.3 機能説明
      1. 7.3.1 CrM/DCM制御原理
      2. 7.3.2 入力電圧フィードフォワード
        1. 7.3.2.1 ピーク入力電圧検出
      3. 7.3.3 バレー・スイッチングとCrM/DCMヒステリシス
        1. 7.3.3.1 バレー遅延調整
      4. 7.3.4 過渡応答高速化機能を備えたトランスコンダクタンス・アンプ
      5. 7.3.5 異常と保護
        1. 7.3.5.1 電源低電圧誤動作防止
        2. 7.3.5.2 2つの値の過電流保護
          1. 7.3.5.2.1 サイクル単位の電流制限Ocp1
          2. 7.3.5.2.2 Ocp2による重大過電流/CCM保護
        3. 7.3.5.3 出力過電圧保護
          1. 7.3.5.3.1 1次出力過電圧保護(Ovp1)
          2. 7.3.5.3.2 2次過電圧保護(Ovp2)
        4. 7.3.5.4 過熱保護動作
        5. 7.3.5.5 低入力電圧/ブラウンイン
      6. 7.3.6 大電流ドライバ
    4. 7.4 コントローラの機能モード
      1. 7.4.1 バースト・モード動作
      2. 7.4.2 ソフト・スタート
  8. 8 アプリケーションと実装
    1. 8.1 アプリケーション情報
    2. 8.2 代表的なアプリケーション
      1. 8.2.1 設計要件
      2. 8.2.2 詳細な設計手順
        1. 8.2.2.1 WEBENCH®ツールによるカスタム設計
        2. 8.2.2.2 電力段設計
          1. 8.2.2.2.1 ブースト・インダクタ設計
          2. 8.2.2.2.2 ブースト・スイッチの選定
          3. 8.2.2.2.3 ブースト・ダイオードの選定
          4. 8.2.2.2.4 出力コンデンサの選定
        3. 8.2.2.3 ZCD/CS端子
          1. 8.2.2.3.1 ZCD/CS端子波形に生じる電圧スパイク
        4. 8.2.2.4 VOSNS端子
        5. 8.2.2.5 電圧ループ補償
          1. 8.2.2.5.1 プラント・モデル
          2. 8.2.2.5.2 補償設計
      3. 8.2.3 アプリケーション曲線
  9. 9 電源に関する推奨事項
  10. 10レイアウト
    1. 10.1 レイアウトのガイドライン
      1. 10.1.1 VOSNS端子
      2. 10.1.2 ZCD/CS端子
      3. 10.1.3 VCC端子
      4. 10.1.4 GND端子
      5. 10.1.5 DRV端子
      6. 10.1.6 COMP端子
    2. 10.2 レイアウト例
  11. 11デバイスおよびドキュメントのサポート
    1. 11.1 WEBENCH®ツールによるカスタム設計
    2. 11.2 ドキュメントの更新通知を受け取る方法
    3. 11.3 コミュニティ・リソース
    4. 11.4 商標
    5. 11.5 静電気放電に関する注意事項
    6. 11.6 Glossary
  12. 12メカニカル、パッケージ、および注文情報

8.2.2.3.1 ZCD/CS端子波形に生じる電圧スパイク

ZCD/CS端子での電圧オフセットは、この端子に印加される波形に生じる大振幅のスイッチング・エッジ・スパイクに起因する傾向があります。こうしたスイッチング・エッジ・スパイクは、内蔵ESD構造のような非線形コントローラによってクランプされ、分圧器のDC動作ポイントをアップセットします。これは、特に電流の変化率が最高値(入力電圧ピーク程度の高負荷)のときに、ZCD/CS端子信号での電圧オフセットとして観測できます。ZCD/CS端子分圧器の設計に際しては、スイッチング・エッジ・スパイクを捕捉しないようにします。低インダクタンス・タイプの電流検知抵抗の採用も、同じ理由で重要となります。必要であれば、時定数が約30nsのRCフィルタを分圧器とZCD/CS端子の間に追加して、スイッチング・エッジ・スパイクを減衰することもできます。このフィルタの容量(CZC3)はCZC2の値に比べて小さくなるようにします。直列抵抗がEquation 67で計算した値を下回るようにして、R-Cフィルタに起因する誤差を1%未満に制限します。

Equation 67. UCC28056 eq-67.gif

この設計例では、RCフィルタに次の値を選択してスイッチング・エッジ・スパイクを減衰します。

Equation 68. UCC28056 eq-68.gif
Equation 69. UCC28056 eq-69.gif