JAJSGR3 データシート

JAJSGR3D December 2018 – September 2024 AWR1843

PRODUCTION DATA

6.2.2 信号の説明 - アナログ

インターフェイス	信号名	ピンの種類	説明	ボール番号
トランスミッタ	TX1	O	シングルエンドトランスミッタ 1 o/p	B4
	TX2	O	シングルエンドトランスミッタ 2 o/p	B6
	TX3	O	シングルエンドトランスミッタ 3 o/p	B8
レシーバ	RX1	I	シングルエンドレシーバ 1 i/p	M2
	RX2	I	シングルエンドレシーバ 2 i/p	K2
	RX3	I	シングルエンドレシーバ 3 i/p	H2
	RX4	I	シングルエンドレシーバ 4 i/p	F2
リセット	NRESET	I	チップのパワーオンリセット。アクティブ Low	R3
リファレンス発振器	CLKP	I	XTAL モード：リファレンス水晶振動子用入力外部クロックモード：シングルエンド入力リファレンスクロックポート	B15
リファレンス発振器	CLKM	I	XTAL モード：：リファレンス水晶振動子用フィードバック駆動外部クロックモード：このポートはグランドに接続します。	C15
リファレンスクロック	OSC_CLKOUT	O	PLL クリーンアップ後のクロック供給サブシステムからのリファレンスクロック出力 (1.4V 出力電圧スイング)。	A14
バンドギャップ電圧	VBGAP	O	デバイスのバンドギャップリファレンス出力	B10
電源	VDDIN	電源	1.2V デジタル電源	H15、N11、P15、R6
	VIN_SRAM	電源	内部 SRAM 用 1.2V 電源レール	G15
	VNWA	電源	SRAM アレイのバックバイアス用 1.2V 電源レール	P14
	VIOIN	電源	I/O 電源 (3.3V または 1.8V)：すべての CMOS I/O はこの電源で動作します。	R10、F15
	VIOIN_18	電源	CMOS IO 用 1.8V 電源	R9
	VIN_18CLK	電源	クロックモジュール用 1.8V 電源	B11
	VIOIN_18DIFF	電源	LVDS ポート用 1.8V 電源	D15
	VPP	電源	ヒューズチェーン用電源電圧	L13
電源	VIN_13RF1	電源	1.3V アナログおよび RF 電源、VIN_13RF1 と VIN_13RF2 が基板上で短絡されている可能性があります。	G5、H5、J5
	VIN_13RF2	電源	1.3V アナログおよび RF 電源	C2、D2
	VIN_18BB	電源	1.8V アナログベースバンド電源	K5、F5
	VIN_18VCO	電源	1.8V RF VCO 電源	B12
	VSS	グランド	デジタルグランド	L5、L6、L8、L10、K7、K8、K9、K10、K11、J6、J7、J8、J10、H7、H9、H11、G6、G7、G8、G10、F9、F11、E5、E6、E8、E10、E11、R15
	VSSA	グランド	アナロググランド	A1、A3、A5、A7、A15、B1、B3、B5、B7、C1、C3、C4、C5、C6、C7、E1、E2、E3、F3、G1、G2、G3、H3、J1、J2、J3、K3、L1、L2、L3、M3、N1、N2、N3、R1、A13、C8、A9、B9、C9、B14、C14
内部 LDO 出力 / 入力	VOUT_14APLL	O	内部 LDO 出力	A10
	VOUT_14SYNTH	O	内部 LDO 出力	B13
	VOUT_PA	IO	内部 PA LDO を使用する場合、このピンは LDO の出力電圧を供給します。内部 PA LDO がバイパスされ無効になっている場合、1V 電源をこのピンに供給する必要があります。3TX を同時に使用する事例では、これは必須です。	A2、B2
量産開始前フェーズのテストおよびデバッグ出力。量産ハードウェア上でフィールドデバッグ用にピン出力することが可能です。	アナログテスト 1 / ADC1	IO	ADC チャネル 1⁽¹⁾	P1
	アナログテスト 2 / ADC2	IO	ADC チャネル 2⁽¹⁾	P2
	アナログテスト 3 / ADC3	IO	ADC チャネル 3⁽¹⁾	P3
	アナログテスト 4 / ADC4	IO	ADC チャネル 4⁽¹⁾	R2
	ANAMUX / ADC5	IO	ADC チャネル 5⁽¹⁾	C13
	VSENSE / ADC6	IO	ADC チャネル 6⁽¹⁾	D14

(1) 詳細については、セクション 8.4.1 を参照してください。