JAJSOS8E September   2013  – July 2024 SN74LV1T00

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 関連製品
  6. 5 ピン構成および機能
  7. 6 仕様
    1. 6.1 絶対最大定格
    2. 6.2 ESD 定格
    3. 6.3 推奨動作条件
    4. 6.4 熱に関する情報
    5. 6.5 電気的特性
    6. 6.6 スイッチング特性
    7. 6.7 動作特性
    8. 6.8 代表的特性
  8. 7 パラメータ測定情報
  9. 8 詳細説明
    1. 8.1 概要
    2. 8.2 機能ブロック図
    3. 8.3 機能説明
      1. 8.3.1 クランプ ダイオード構造
      2. 8.3.2 平衡化された CMOS プッシュプル出力
      3. 8.3.3 LVxT 拡張入力電圧
        1. 8.3.3.1 降圧変換
        2. 8.3.3.2 昇圧変換
    4. 8.4 デバイスの機能モード
  10. 9 アプリケーションと実装
    1. 9.1 電源に関する推奨事項
    2. 9.2 レイアウト
      1. 9.2.1 レイアウトのガイドライン
  11. 10デバイスおよびドキュメントのサポート
    1. 10.1 ドキュメントの更新通知を受け取る方法
    2. 10.2 サポート・リソース
    3. 10.3 商標
    4. 10.4 静電気放電に関する注意事項
    5. 10.5 用語集
  12. 11改訂履歴
  13. 12メカニカル、パッケージ、および注文情報

3 概要

SN74LV1T00 は、産業用、携帯用、通信、車載の各アプリケーション向けの広い電圧範囲で動作する低電圧 CMOS ゲート ロジックです。出力レベルは電源電圧を基準としており、1.8V、2.5V、3.3V、5V の CMOS レベルをサポートできます

入力は、VCC = 3.3V で 1.8V 入力ロジックと一致するように低スレッショルド回路を使用して設計されており、1.8V から 3.3V への昇圧レベル変換に使用できます。また、5V 許容の入力ピンにより、降圧変換 (例：VCC = 2.5V で 3.3V 入から 2.5V 出力) が可能です。VCC の範囲が 1.8V～5.5V と広いため、目的の出力レベルを生成してコントローラまたはプロセッサと接続できます。

SN74LV1T00 は、8mA の電流駆動能力を使用して、高駆動出力によるライン反射、オーバーシュート、アンダーシュートを低減するように設計されています。

パッケージ情報
部品番号 パッケージ (1) パッケージ サイズ(2) 本体サイズ (3)
SN74LV1T00 DBV (SOT-23、5) 2.9mm × 2.8mm 2.9mm × 1.6mm
DCK (SC-70、5) 2mm × 2.1mm 2mm × 1.25mm
(1) 詳細については、セクション 12 を参照してください。
(2) パッケージ サイズ (長さ × 幅) は公称値であり、該当する場合はピンも含まれます。
(3) 本体サイズ (長さ×幅) は公称値であり、ピンは含まれません。
SN74LV1T00 1.8V から 3.3V への変換用のスイッチング スレッショルド1.8V から 3.3V への変換用のスイッチング スレッショルド