JAJSVB7 September   2024 TPLD801-Q1

ADVANCE INFORMATION  

  1.   1
  2. 1特長
  3. 2アプリケーション
  4. 3概要
  5. 4ピン構成および機能
  6. 5仕様
    1. 5.1 絶対最大定格
    2. 5.2 ESD 定格
    3. 5.3 推奨動作条件
    4. 5.4 熱に関する情報
    5. 5.5 電気的特性
    6. 5.6 電源電流特性
    7. 5.7 スイッチング特性
  7. 6パラメータ測定情報
  8. 7詳細説明
    1. 7.1 概要
    2. 7.2 機能ブロック図
    3. 7.3 機能説明
      1. 7.3.1 I/O ピン
      2. 7.3.2 接続マルチプレクサ
      3. 7.3.3 使用論理ブロック数を構成可能
        1. 7.3.3.1 2 ビット LUT マクロセル
        2. 7.3.3.2 3 ビット LUT マクロセル
        3. 7.3.3.3 2 ビット LUT または D フリップ フロップ / ラッチ マクロセル
        4. 7.3.3.4 3 ビット LUT または D フリップ フロップ / ラッチ (セット / リセット付き) マクロセル
        5. 7.3.3.5 3 ビット LUT またはパイプ遅延マクロセル
        6. 7.3.3.6 4 ビット LUT または 8 ビット カウンタ / 遅延マクロセル
      4. 7.3.4 8 ビット カウンタ / 遅延ジェネレータ (CNT/DLY)
        1. 7.3.4.1 遅延モード
        2. 7.3.4.2 カウンタ モードのリセット
      5. 7.3.5 プログラム可能なグリッチ除去フィルタまたはエッジ検出器マクロセル
      6. 7.3.6 周波数選択可能発振器
    4. 7.4 デバイスの機能モード
      1. 7.4.1 パワーオン リセット
    5. 7.5 プログラミング
      1. 7.5.1 ワンタイム プログラマブル メモリ (OTP)
  9. 8改訂履歴
  10. 9メカニカル、パッケージ、および注文情報
    1. 9.1 付録:パッケージ オプション
    2. 9.2 テープおよびリール情報
    3. 9.3 メカニカル データ

特長

  • 動作特性

    • 拡張温度範囲:-40℃~125℃

    • 広い電源電圧範囲:1.65V~5.5V

    • 車載アプリケーション認定済み

  • 構成可能マクロセル

    • 2 ビット、3 ビット、および 4 ビットのルックアップ テーブル

    • D タイプ フリップ フロップおよびラッチ、リセット / セット オプションありとなし

    • 8 ビットのパイプ遅延

    • カウンタと遅延ジェネレータ

    • グリッチ除去フィルタまたはエッジ検出器をプログラム可能

    • 発振器

  • 柔軟なデジタル I/O 機能

    • すべてのデジタル信号を任意の GPIO に配線可能

    • デジタル入力モード:デジタル入力 (シュミット トリガあり / なし)、低電圧デジタル入力

    • デジタル出力モード:プッシュプル、オープン ドレイン NMOS、トライステート

  • 開発ツール

    • InterConnect Studio

    • TPLD801-Q1 評価基板

    • TPLD プログラミング基板