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MSP430F534x ミクスト・シグナル・マイクロコントローラ
JAJSG78F
July 2011 – September 2018
MSP430F5340
,
MSP430F5341
,
MSP430F5342
PRODUCTION DATA.
CONTENTS
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MSP430F534x ミクスト・シグナル・マイクロコントローラ
1
デバイスの概要
1.1
特長
1.2
アプリケーション
1.3
概要
1.4
機能ブロック図
2
改訂履歴
3
Device Comparison
3.1
Related Products
4
Terminal Configuration and Functions
4.1
Pin Diagram
4.2
Signal Descriptions
Table 4-1
Signal Descriptions
5
Specifications
5.1
Absolute Maximum Ratings
5.2
ESD Ratings
5.3
Recommended Operating Conditions
5.4
Active Mode Supply Current Into VCC Excluding External Current
5.5
Low-Power Mode Supply Currents (Into VCC) Excluding External Current
5.6
Thermal Resistance Characteristics, VQFN (RGZ) Package
5.7
Schmitt-Trigger Inputs – General-Purpose I/O (P1.0 to P1.7, P2.7, P3.0 to P3.4, P4.0 to P4.7) (P5.0 to P5.5, P5.7, P6.1 to P6.5, PJ.0 to PJ.3, RST/NMI)
5.8
Inputs – Ports P1 and P2 (P1.0 to P1.7, P2.0 to P2.7)
5.9
Leakage Current – General-Purpose I/O (P1.0 to P1.7, P2.7, P3.0 to P3.4, P4.0 to P4.7) (P5.0 to P5.5, P5.7, P6.1 to P6.5, PJ.0 to PJ.3, RST/NMI)
5.10
Outputs – General-Purpose I/O (Full Drive Strength) (P1.0 to P1.7, P2.7, P3.0 to P3.4, P4.0 to P4.7) (P5.0 to P5.5, P5.7, P6.1 to P6.5, PJ.0 to PJ.3)
5.11
Outputs – General-Purpose I/O (Reduced Drive Strength) (P1.0 to P1.7, P2.7, P3.0 to P3.4, P4.0 to P4.7) (P5.0 to P5.5, P5.7, P6.1 to P6.5, PJ.0 to PJ.3)
5.12
Output Frequency – General-Purpose I/O (P1.0 to P1.7, P2.7, P3.0 to P3.4, P4.0 to P4.7) (P5.0 to P5.5, P5.7, P6.1 to P6.5, PJ.0 to PJ.3)
5.13
Typical Characteristics – Outputs, Reduced Drive Strength (PxDS.y = 0)
5.14
Typical Characteristics – Outputs, Full Drive Strength (PxDS.y = 1)
5.15
Crystal Oscillator, XT1, Low-Frequency Mode
5.16
Crystal Oscillator, XT2
5.17
Internal Very-Low-Power Low-Frequency Oscillator (VLO)
5.18
Internal Reference, Low-Frequency Oscillator (REFO)
5.19
DCO Frequency
5.20
PMM, Brownout Reset (BOR)
5.21
PMM, Core Voltage
5.22
PMM, SVS High Side
5.23
PMM, SVM High Side
5.24
PMM, SVS Low Side
5.25
PMM, SVM Low Side
5.26
Wake-up Times From Low-Power Modes and Reset
5.27
Timer_A
5.28
Timer_B
5.29
USCI (UART Mode) Clock Frequency
5.30
USCI (UART Mode)
5.31
USCI (SPI Master Mode) Clock Frequency
5.32
USCI (SPI Master Mode)
5.33
USCI (SPI Slave Mode)
5.34
USCI (I2C Mode)
5.35
12-Bit ADC, Power Supply and Input Range Conditions
5.36
12-Bit ADC, Timing Parameters
5.37
12-Bit ADC, Linearity Parameters Using an External Reference Voltage or AVCC as Reference Voltage
5.38
12-Bit ADC, Linearity Parameters Using the Internal Reference Voltage
5.39
12-Bit ADC, Temperature Sensor and Built-In VMID
5.40
REF, External Reference
5.41
REF, Built-In Reference
5.42
Comparator_B
5.43
Flash Memory
5.44
JTAG and Spy-Bi-Wire Interface
6
Detailed Description
6.1
CPU
6.2
Operating Modes
6.3
Interrupt Vector Addresses
6.4
Memory Organization
6.5
Bootloader (BSL)
6.6
JTAG Operation
6.6.1
JTAG Standard Interface
6.6.2
Spy-Bi-Wire Interface
6.7
Flash Memory
6.8
RAM
6.9
Peripherals
6.9.1
Digital I/O
6.9.2
Port Mapping Controller
6.9.3
Oscillator and System Clock
6.9.4
Power Management Module (PMM)
6.9.5
Hardware Multiplier
6.9.6
Real-Time Clock (RTC_A)
6.9.7
Watchdog Timer (WDT_A)
6.9.8
System Module (SYS)
6.9.9
DMA Controller
6.9.10
Universal Serial Communication Interface (USCI)
6.9.11
TA0
6.9.12
TA1
6.9.13
TA2
6.9.14
TB0
6.9.15
Comparator_B
6.9.16
ADC12_A
6.9.17
CRC16
6.9.18
Reference (REF) Module Voltage Reference
6.9.19
Embedded Emulation Module (EEM)
6.9.20
Peripheral File Map
6.10
Input/Output Diagrams
6.10.1
Port P1 (P1.0 to P1.7) Input/Output With Schmitt Trigger
6.10.2
Port P2 (P2.7) Input/Output With Schmitt Trigger
6.10.3
Port P3 (P3.0 to P3.4) Input/Output With Schmitt Trigger
6.10.4
Port P4 (P4.0 to P4.7) Input/Output With Schmitt Trigger
6.10.5
Port P5 (P5.0 and P5.1) Input/Output With Schmitt Trigger
6.10.6
Port P5 (P5.2) Input/Output With Schmitt Trigger
6.10.7
Port P5 (P5.3) Input/Output With Schmitt Trigger
6.10.8
Port P5 (P5.4 and P5.5) Input/Output With Schmitt Trigger
6.10.9
Port P5 (P5.7) Input/Output With Schmitt Trigger
6.10.10
Port P6 (P6.1 to P6.5) Input/Output With Schmitt Trigger
6.10.11
Port PJ (PJ.0) JTAG Pin TDO, Input/Output With Schmitt Trigger or Output
6.10.12
Port PJ (PJ.1 to PJ.3) JTAG Pins TMS, TCK, TDI/TCLK, Input/Output With Schmitt Trigger or Output
6.11
Device Descriptors
7
デバイスおよびドキュメントのサポート
7.1
はじめに
7.2
Device Nomenclature
7.3
ツールとソフトウェア
7.4
ドキュメントのサポート
7.5
関連リンク
7.6
Community Resources
7.7
商標
7.8
静電気放電に関する注意事項
7.9
Export Control Notice
7.10
Glossary
8
メカニカル、パッケージ、および注文情報
重要なお知らせ
パッケージ・オプション
メカニカル・データ(パッケージ|ピン)
RGZ|48
MPQF123F
サーマルパッド・メカニカル・データ
RGZ|48
QFND031W
発注情報
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jajsg78f_pm
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DATA SHEET
MSP430F534x ミクスト・シグナル・マイクロコントローラ
このリソースの元の言語は英語です。 翻訳は概要を便宜的に提供するもので、自動化ツール (機械翻訳) を使用していることがあり、TI では翻訳の正確性および妥当性につきましては一切保証いたしません。 実際の設計などの前には、ti.com で必ず最新の英語版をご参照くださいますようお願いいたします。
1
デバイスの概要
1.1
特長
低い電源電圧範囲: 3.6Vから最低1.8Vまで
超低消費電力
アクティブ・モード(AM):すべてのシステム・クロックがアクティブ
290µA/MHz (8MHz、3V)、フラッシュ・プログラム実行時(標準値)
150µA/MHz (8MHz、3V)、RAMプログラム実行時(標準値)
スタンバイ・モード(LPM3)
リアルタイム・クロック(RTC)(水晶振動子を使用)、ウォッチドッグ、および電源スーパーバイザが動作、RAMデータ完全保持、高速ウェークアップ:
1.9µA (2.2V)、2.1µA (3V)(標準値)
低消費電力発振器(VLO)、汎用カウンタ、ウォッチドッグ、および電源スーパーバイザが動作、RAMデータ完全保持、高速ウェークアップ:
1.4µA (3V)(標準値)
オフ・モード(LPM4)
RAMデータ完全保持、電源スーパーバイザが動作、高速ウェークアップ:
1.1µA (3V)(標準値)
シャットダウン・モード(LPM4.5)
0.18µA (3V)(標準値)
スタンバイ・モードから3.5µsでウェークアップ(標準値)
16ビットRISCアーキテクチャ、拡張メモリ、最大25MHzのシステム・クロック
柔軟な電力管理システム
プログラム可能な、レギュレートされたコア電源電圧を持つ、完全に統合されたLDO
電源電圧の管理、監視、およびブラウンアウト
統合クロック・システム
FLL制御ループによる周波数安定化
低電力、低周波数の内部クロック・ソース(VLO)
低周波数のトリムされた内部基準ソース(REFO)
32kHzの時計用水晶振動子(XT1)
最高32MHzの高周波数水晶振動子(XT2)
16ビット・タイマ TA0:5個のキャプチャ/コンペア・レジスタを備えたTimer_A
16ビット・タイマ TA1:3個のキャプチャ/コンペア・レジスタを備えたTimer_A
16ビット・タイマ TA2:3個のキャプチャ/コンペア・レジスタを備えたTimer_A
16ビット・タイマTB0:7個のキャプチャ/コンペア・シャドウ・レジスタを備えたTimer_B
2つのユニバーサル・シリアル通信インターフェイス(USCI)
USCI_A0、USCI_A1がそれぞれ次の機能をサポート
自動ボーレート検出機能付きの拡張UART
IrDAエンコーダおよびデコーダ
同期SPI
USCI_B0、USCI_B1がそれぞれ次の機能をサポート
I
2
C
同期SPI
内部リファレンス、サンプル・アンド・ホールド、オートスキャン機能搭載の12ビットのA/Dコンバータ(ADC)
コンパレータ
ハードウェア乗算器で32ビットの演算をサポート
シリアルのオンボード・プログラミング、外部からのプログラミング電圧は不要
3チャネルの内蔵DMA
RTC機能付き基本タイマ
デバイスの比較
に、供給中の製品ファミリを掲載
1.2
アプリケーション
アナログ・センサ・システム
デジタル・センサ・システム
データ・ロギング
汎用アプリケーション