データシート
74AC11138
- 高速メモリ デコーダおよびデータ転送システムに適した設計
- 3 つのイネーブル入力を備え、カスケード接続やデータ受信を簡素化
- センター ピン VCC および GND 構成により、高速スイッチング ノイズを最小化
- EPIC ™ (Enhanced-Performance Implanted CMOS) 1µm プロセス
- 500mA (標準値) のラッチアップ耐性 (125℃時)
- プラスチック SOP (Small-Outline Package) (D) および TSSOP (Thin Shrink Small-Outline Package) (PW)、標準プラスチック 300mil DIP (Dual In-line Package) (N) を選択可能
74AC11138 の回路は、伝搬遅延時間を極めて短くする必要がある高性能メモリ デコーディングまたはデータ ルーティング用途向けに設計されています。
技術資料
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| * | データシート | 74AC11138 3 ライン入力 8 ライン出力、デコーダ / デマルチプレクサ データシート (Rev. C 翻訳版) | PDF | HTML | 英語版 (Rev.C) | PDF | HTML | 2024年 7月 1日 |
購入と品質
記載されている情報：
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL 定格 / ピーク リフロー
- MTBF/FIT 推定値
- 使用原材料
- 認定試験結果
- 継続的な信頼性モニタ試験結果
記載されている情報：
- ファブの拠点
- 組み立てを実施した拠点