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SN54AHCT74

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クリアとプリセット搭載、デュアル・ポジティブ・エッジ・トリガ D タイプ・フリップ・フロップ

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製品詳細

Number of channels 2 Technology family AHCT Supply voltage (min) (V) 4.5 Supply voltage (max) (V) 5.5 Input type TTL-Compatible CMOS Output type Push-Pull Clock frequency (max) (MHz) 70 IOL (max) (mA) 8 IOH (max) (mA) -8 Supply current (max) (µA) 20 Features Balanced outputs, Very high speed (tpd 5-10ns) Operating temperature range (°C) -55 to 125 Rating Military
Number of channels 2 Technology family AHCT Supply voltage (min) (V) 4.5 Supply voltage (max) (V) 5.5 Input type TTL-Compatible CMOS Output type Push-Pull Clock frequency (max) (MHz) 70 IOL (max) (mA) 8 IOH (max) (mA) -8 Supply current (max) (µA) 20 Features Balanced outputs, Very high speed (tpd 5-10ns) Operating temperature range (°C) -55 to 125 Rating Military
CDIP (J) 14 130.4652 mm² 19.56 x 6.67 CFP (W) 14 58.023 mm² 9.21 x 6.3 LCCC (FK) 20 79.0321 mm² 8.89 x 8.89
  • 動作範囲：4.5V～5.5V
  • 低消費電力、I CC の最大値 10µA
  • 5V で ±8mA の出力駆動能力
  • 入力は TTL 電圧互換
  • JESD 17 準拠で 250mA 超のラッチアップ性能
  • 動作範囲：4.5V～5.5V
  • 低消費電力、I CC の最大値 10µA
  • 5V で ±8mA の出力駆動能力
  • 入力は TTL 電圧互換
  • JESD 17 準拠で 250mA 超のラッチアップ性能

AHCT74 デュアル・ポジティブ・エッジ・トリガ・デバイスは、D タイプ・フリップ・フロップです。

その他の入力のレベルに関係なく、プリセット ( PRE) 入力を Low レベルにすると出力は High になり、クリア ( CLR) 入力を Low レベルにすると出力は Low になります。 PRE と CLR が非アクティブ (High) の場合、セットアップ時間の要件を満たすデータ (D) 入力のデータは、クロック・パルスの正方向エッジで出力に転送されます。クロックのトリガは電圧レベルで発生し、クロック・パルスの立ち上がり時間とは直接関係しません。ホールド時間が経過した後、D 入力のデータは、出力のレベルに影響を及ぼさずに変更できます。

AHCT74 デュアル・ポジティブ・エッジ・トリガ・デバイスは、D タイプ・フリップ・フロップです。

その他の入力のレベルに関係なく、プリセット ( PRE) 入力を Low レベルにすると出力は High になり、クリア ( CLR) 入力を Low レベルにすると出力は Low になります。 PRE と CLR が非アクティブ (High) の場合、セットアップ時間の要件を満たすデータ (D) 入力のデータは、クロック・パルスの正方向エッジで出力に転送されます。クロックのトリガは電圧レベルで発生し、クロック・パルスの立ち上がり時間とは直接関係しません。ホールド時間が経過した後、D 入力のデータは、出力のレベルに影響を及ぼさずに変更できます。
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技術資料

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種類 タイトル 最新の英語版をダウンロード 日付
* データシート SNxAHCT74 デュアル・ポジティブ・エッジ・トリガ D タイプ・フリップ・フロップ、クリア / プリセット搭載 データシート (Rev. R 翻訳版) PDF | HTML 英語版 (Rev.R) PDF | HTML 2023年 11月 1日
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アプリケーション・ノート Migration From 3.3-V To 2.5-V Power Supplies For Logic Devices 1997年 12月 1日
アプリケーション・ノート Bus-Interface Devices With Output-Damping Resistors Or Reduced-Drive Outputs (Rev. A) 1997年 8月 1日
アプリケーション・ノート CMOS Power Consumption and CPD Calculation (Rev. B) 1997年 6月 1日
アプリケーション・ノート Live Insertion 1996年 10月 1日

設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
CDIP (J) 14 Ultra Librarian
CFP (W) 14 Ultra Librarian
LCCC (FK) 20 Ultra Librarian
TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用原材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブの拠点
  • 組み立てを実施した拠点

サポートとトレーニング

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