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SN74HC541

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3 ステート出力、8 チャネル、2V ～ 6V バッファ

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製品詳細

Technology family HC Supply voltage (min) (V) 2 Supply voltage (max) (V) 6 Number of channels 8 IOL (max) (mA) 6 Supply current (max) (µA) 80 IOH (max) (mA) -6 Input type Standard CMOS Output type 3-State Features Balanced outputs, Input clamp diode, Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 85
Technology family HC Supply voltage (min) (V) 2 Supply voltage (max) (V) 6 Number of channels 8 IOL (max) (mA) 6 Supply current (max) (µA) 80 IOH (max) (mA) -6 Input type Standard CMOS Output type 3-State Features Balanced outputs, Input clamp diode, Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 85
PDIP (N) 20 228.702 mm² 24.33 x 9.4 SOIC (DW) 20 131.84 mm² 12.8 x 10.3 SOP (NS) 20 98.28 mm² 12.6 x 7.8 SSOP (DB) 20 56.16 mm² 7.2 x 7.8 TSSOP (PW) 20 41.6 mm² 6.5 x 6.4
  • 広い動作電圧範囲：2V～6V
  • バス・ラインを直接、または最大 15 の LSTTL 負荷を駆動する大電流 3 ステート出力
  • 低い消費電力、最大 ICC：80µA
  • tpd = 10ns (標準値)
  • 5V で ±6mA の出力駆動能力
  • 低い入力電流：最大値 1µA
  • データ・フロースルーのピン配置 (すべての入力は出力の反対側)
  • 広い動作電圧範囲：2V～6V
  • バス・ラインを直接、または最大 15 の LSTTL 負荷を駆動する大電流 3 ステート出力
  • 低い消費電力、最大 ICC：80µA
  • tpd = 10ns (標準値)
  • 5V で ±6mA の出力駆動能力
  • 低い入力電流：最大値 1µA
  • データ・フロースルーのピン配置 (すべての入力は出力の反対側)

これらのオクタル・バッファおよびライン・ドライバは、SNx4HC541 デバイスの性能を備え、入力と出力がパッケージを挟んで反対側に位置するようにピンを配置しています。この配置のおかげで、プリント基板のレイアウトが非常に簡単です。

3 ステート出力は、 2 入力 NOR ゲートによって制御されます。いずれかの出力イネーブル (OE1 または OE2) 入力が High の場合、8 つの出力はすべて高インピーダンス状態になります。SNx4HC541 デバイスは、出力側に真のデータを提供します。

これらのオクタル・バッファおよびライン・ドライバは、SNx4HC541 デバイスの性能を備え、入力と出力がパッケージを挟んで反対側に位置するようにピンを配置しています。この配置のおかげで、プリント基板のレイアウトが非常に簡単です。

3 ステート出力は、 2 入力 NOR ゲートによって制御されます。いずれかの出力イネーブル (OE1 または OE2) 入力が High の場合、8 つの出力はすべて高インピーダンス状態になります。SNx4HC541 デバイスは、出力側に真のデータを提供します。
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技術資料

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種類 タイトル 最新の英語版をダウンロード 日付
* データシート SNx4HC541 3 ステート出力、オクタル・バッファ / ライン・ドライバ データシート (Rev. E 翻訳版) PDF | HTML 英語版 (Rev.E) PDF | HTML 2022年 6月 14日
アプリケーション・ノート Implications of Slow or Floating CMOS Inputs (Rev. E) 2021年 7月 26日
セレクション・ガイド Logic Guide (Rev. AB) 2017年 6月 12日
アプリケーション・ノート Understanding and Interpreting Standard-Logic Data Sheets (Rev. C) 2015年 12月 2日
セレクション・ガイド ロジック・ガイド (Rev. AA 翻訳版) 最新英語版 (Rev.AB) 2014年 11月 6日
ユーザー・ガイド LOGIC Pocket Data Book (Rev. B) 2007年 1月 16日
アプリケーション・ノート Semiconductor Packing Material Electrostatic Discharge (ESD) Protection 2004年 7月 8日
ユーザー・ガイド Signal Switch Data Book (Rev. A) 2003年 11月 14日
アプリケーション・ノート TI IBIS File Creation, Validation, and Distribution Processes 2002年 8月 29日
アプリケーション・ノート CMOS Power Consumption and CPD Calculation (Rev. B) 1997年 6月 1日
アプリケーション・ノート Designing With Logic (Rev. C) 1997年 6月 1日
アプリケーション・ノート Input and Output Characteristics of Digital Integrated Circuits 1996年 10月 1日
アプリケーション・ノート Live Insertion 1996年 10月 1日
アプリケーション・ノート SN54/74HCT CMOS Logic Family Applications and Restrictions 1996年 5月 1日
アプリケーション・ノート Using High Speed CMOS and Advanced CMOS in Systems With Multiple Vcc 1996年 4月 1日

設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

14-24-LOGIC-EVM — 14 ピンから 24 ピンの D、DB、DGV、DW、DYY、NS、PW の各パッケージに封止した各種ロジック製品向けの汎用評価基板

14-24-logic-EVM 評価基板は、14 ピンから 24 ピンの D、DW、DB、NS、PW、DYY、DGV の各パッケージに封止した各種ロジック デバイスをサポートする設計を採用しています。

ユーザー ガイド: PDF | HTML
TI.com で取り扱いなし
シミュレーション・モデル

SN74HC541 Behavioral SPICE Model

SCLM210.ZIP (7 KB) - PSpice Model
ダウンロード
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
PDIP (N) 20 Ultra Librarian
SOIC (DW) 20 Ultra Librarian
SOP (NS) 20 Ultra Librarian
SSOP (DB) 20 Ultra Librarian
TSSOP (PW) 20 Ultra Librarian
TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用原材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブの拠点
  • 組み立てを実施した拠点

サポートとトレーニング

TI E2E™ フォーラムでは、TI のエンジニアからの技術サポートを提供

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