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D タイプ・ラッチ

SN74HC573A

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3 ステート出力、オクタル・トランスペアレント D タイプ・ラッチ

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SN74HC573A

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製品詳細

Number of channels 8 Technology family HC Supply voltage (min) (V) 2 Supply voltage (max) (V) 6 Input type Standard CMOS Output type 3-State Clock frequency (max) (MHz) 28 IOL (max) (mA) 7.8 IOH (max) (mA) -7.8 Supply current (max) (µA) 80 Features Balanced outputs, Flow-through pinout, High speed (tpd 10-50ns), Positive input clamp diode Operating temperature range (°C) -40 to 85 Rating Catalog
Number of channels 8 Technology family HC Supply voltage (min) (V) 2 Supply voltage (max) (V) 6 Input type Standard CMOS Output type 3-State Clock frequency (max) (MHz) 28 IOL (max) (mA) 7.8 IOH (max) (mA) -7.8 Supply current (max) (µA) 80 Features Balanced outputs, Flow-through pinout, High speed (tpd 10-50ns), Positive input clamp diode Operating temperature range (°C) -40 to 85 Rating Catalog
PDIP (N) 20 228.702 mm² 24.33 x 9.4 SOIC (DW) 20 131.84 mm² 12.8 x 10.3 SSOP (DB) 20 56.16 mm² 7.2 x 7.8 TSSOP (PW) 20 41.6 mm² 6.5 x 6.4
  • 広い動作電圧範囲：2V～6V
  • バス・ラインを直接、または最大 15 の LSTTL 負荷を駆動する大電流 3 ステート出力
  • 低い消費電力：ICC = 80µA (最大値)
  • tpd = 21ns (標準値)
  • 5V で ±6mA の出力駆動能力
  • 低い入力電流：1µA (最大値)
  • バス配線に適したピン配置
  • 広い動作電圧範囲：2V～6V
  • バス・ラインを直接、または最大 15 の LSTTL 負荷を駆動する大電流 3 ステート出力
  • 低い消費電力：ICC = 80µA (最大値)
  • tpd = 21ns (標準値)
  • 5V で ±6mA の出力駆動能力
  • 低い入力電流：1µA (最大値)
  • バス配線に適したピン配置

SNx4HC573A は、オクタル・トランスペアレント D タイプ・ラッチで、大きい容量性負荷または比較的低いインピーダンスの負荷の駆動用に設計された 3 ステート出力を備えています。 特に、バッファ・レジスタ、I/O ポート、双方向バス・ドライバ、作業レジスタの実装に適しています。

ラッチ・イネーブル (LE) 入力が HIGH のとき、Q 出力はデータ (D) 入力に従います。 LE が LOW のとき、出力はラッチされて、設定されたデータを保持します。

SNx4HC573A は、オクタル・トランスペアレント D タイプ・ラッチで、大きい容量性負荷または比較的低いインピーダンスの負荷の駆動用に設計された 3 ステート出力を備えています。 特に、バッファ・レジスタ、I/O ポート、双方向バス・ドライバ、作業レジスタの実装に適しています。

ラッチ・イネーブル (LE) 入力が HIGH のとき、Q 出力はデータ (D) 入力に従います。 LE が LOW のとき、出力はラッチされて、設定されたデータを保持します。
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技術資料

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* データシート SNx4HC573A 3 ステート出力、オクタル・トランスペアレント D タイプ・ラッチ データシート (Rev. G 翻訳版) PDF | HTML 英語版 (Rev.G) PDF | HTML 2022年 6月 13日
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アプリケーション・ノート CMOS Power Consumption and CPD Calculation (Rev. B) 1997年 6月 1日
アプリケーション・ノート Designing With Logic (Rev. C) 1997年 6月 1日
アプリケーション・ノート Input and Output Characteristics of Digital Integrated Circuits 1996年 10月 1日
アプリケーション・ノート Live Insertion 1996年 10月 1日
アプリケーション・ノート SN54/74HCT CMOS Logic Family Applications and Restrictions 1996年 5月 1日
アプリケーション・ノート Using High Speed CMOS and Advanced CMOS in Systems With Multiple Vcc 1996年 4月 1日

設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

14-24-LOGIC-EVM — 14 ピンから 24 ピンの D、DB、DGV、DW、DYY、NS、PW の各パッケージに封止した各種ロジック製品向けの汎用評価基板

14-24-logic-EVM 評価基板は、14 ピンから 24 ピンの D、DW、DB、NS、PW、DYY、DGV の各パッケージに封止した各種ロジック デバイスをサポートする設計を採用しています。

ユーザー ガイド: PDF | HTML
TI.com で取り扱いなし
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
PDIP (N) 20 Ultra Librarian
SOIC (DW) 20 Ultra Librarian
SSOP (DB) 20 Ultra Librarian
TSSOP (PW) 20 Ultra Librarian
TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用原材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブの拠点
  • 組み立てを実施した拠点

サポートとトレーニング

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