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SN74LV595A

アクティブ

3 ステート出力レジスタ搭載、8 ビット シフト レジスタ

製品詳細

Configuration Serial-in, Parallel-out Bits (#) 8 Technology family LV-A Supply voltage (min) (V) 2 Supply voltage (max) (V) 5.5 Input type Standard CMOS Output type 3-State Clock frequency (MHz) 95 IOL (max) (mA) 16 IOH (max) (mA) -16 Supply current (max) (µA) 20 Features Balanced outputs, Output register, Over-voltage tolerant inputs, Partial power down (Ioff), Very high speed (tpd 5-10ns) Operating temperature range (°C) -40 to 125 Rating Catalog
Configuration Serial-in, Parallel-out Bits (#) 8 Technology family LV-A Supply voltage (min) (V) 2 Supply voltage (max) (V) 5.5 Input type Standard CMOS Output type 3-State Clock frequency (MHz) 95 IOL (max) (mA) 16 IOH (max) (mA) -16 Supply current (max) (µA) 20 Features Balanced outputs, Output register, Over-voltage tolerant inputs, Partial power down (Ioff), Very high speed (tpd 5-10ns) Operating temperature range (°C) -40 to 125 Rating Catalog
SOIC (D) 16 59.4 mm² 9.9 x 6 SOP (NS) 16 79.56 mm² 10.2 x 7.8 TSSOP (PW) 16 32 mm² 5 x 6.4 VQFN (RGY) 16 14 mm² 4 x 3.5 WQFN (BQB) 16 8.75 mm² 3.5 x 2.5
  • 2V~5.5V の V CC で動作
  • 最大 t pd 7.1ns (5V 時)
  • 標準 V OLP (出力グランド・バウンス) < 0.8V (V CC = 3.3V、T A = 25℃)
  • 標準 V OHV (出力 V OH アンダーシュート) > 2.3V (V CC = 3.3V、T A = 25℃)
  • すべてのポートで混在モード電圧動作をサポート
  • 8 ビットのシリアル・イン / パラレル・アウト・シフト
  • I off により活線挿抜、部分的パワーダウン・モード、バック・ドライブ保護をサポート
  • シフト・レジスタはダイレクト・クリアを装備
  • JESD 17 準拠で 250mA 超のラッチアップ性能
  • 2V~5.5V の V CC で動作
  • 最大 t pd 7.1ns (5V 時)
  • 標準 V OLP (出力グランド・バウンス) < 0.8V (V CC = 3.3V、T A = 25℃)
  • 標準 V OHV (出力 V OH アンダーシュート) > 2.3V (V CC = 3.3V、T A = 25℃)
  • すべてのポートで混在モード電圧動作をサポート
  • 8 ビットのシリアル・イン / パラレル・アウト・シフト
  • I off により活線挿抜、部分的パワーダウン・モード、バック・ドライブ保護をサポート
  • シフト・レジスタはダイレクト・クリアを装備
  • JESD 17 準拠で 250mA 超のラッチアップ性能

SN74LV595A デバイスには 8 ビットのシリアル・イン、パラレル・アウトのシフト・レジスタが搭載されており、8 ビットの D タイプ・ストレージ・レジスタへデータを供給します。シフト・レジスタ・クロック (SRCLK) とストレージ・レジスタ・クロック (RCLK) はどちらもポジティブ・エッジ・トリガです。

SN74LV595A デバイスには 8 ビットのシリアル・イン、パラレル・アウトのシフト・レジスタが搭載されており、8 ビットの D タイプ・ストレージ・レジスタへデータを供給します。シフト・レジスタ・クロック (SRCLK) とストレージ・レジスタ・クロック (RCLK) はどちらもポジティブ・エッジ・トリガです。

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技術資料

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種類 タイトル 最新の英語版をダウンロード 日付
* データシート SN74LV595A 3 ステート出力レジスタ搭載 8 ビット・シフト・レジスタ データシート (Rev. T 翻訳版) PDF | HTML 英語版 (Rev.T) PDF | HTML 2023年 4月 19日
アプリケーション・ノート Power-Up Behavior of Clocked Devices (Rev. B) PDF | HTML 2022年 12月 15日

設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

14-24-LOGIC-EVM — 14 ピンから 24 ピンの D、DB、DGV、DW、DYY、NS、PW の各パッケージに封止した各種ロジック製品向けの汎用評価基板

14-24-LOGIC-EVM 評価基板 (EVM) は、14 ピンから 24 ピンの D、DW、DB、NS、PW、DYY、DGV の各パッケージに封止した各種ロジック デバイスをサポートする設計を採用しています。

ユーザー ガイド: PDF | HTML
評価ボード

14-24-NL-LOGIC-EVM — 14 ピンから 24 ピンのリードなしパッケージ向け、ロジック製品の汎用評価基板

14-24-NL-LOGIC-EVM は、14 ピンから24 ピンの BQA、BQB、RGY、RSV、RJW、RHL の各パッケージに封止した各種ロジック デバイスや変換デバイスをサポートする設計を採用したフレキシブルな評価基板 (EVM) です。

ユーザー ガイド: PDF | HTML
シミュレーション・モデル

SN74LV595A IBIS Model (Rev. C)

SCEM148C.ZIP (45 KB) - IBIS Model
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
SOIC (D) 16 Ultra Librarian
SOP (NS) 16 Ultra Librarian
TSSOP (PW) 16 Ultra Librarian
VQFN (RGY) 16 Ultra Librarian
WQFN (BQB) 16 Ultra Librarian

購入と品質

記載されている情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用原材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報:
  • ファブの拠点
  • 組み立てを実施した拠点

サポートとトレーニング

TI E2E™ フォーラムでは、TI のエンジニアからの技術サポートを提供

コンテンツは、TI 投稿者やコミュニティ投稿者によって「現状のまま」提供されるもので、TI による仕様の追加を意図するものではありません。使用条件をご確認ください。

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