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SN74LVC00A

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4 チャネル、2 入力、1.65V ～ 3.6V NAND ゲート

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製品詳細

Technology family LVC Supply voltage (min) (V) 1.65 Supply voltage (max) (V) 3.6 Number of channels 4 Inputs per channel 2 IOL (max) (mA) 24 IOH (max) (mA) -24 Input type Standard CMOS Output type Push-Pull Features Over-voltage tolerant inputs, Partial power down (Ioff), Ultra high speed (tpd <5ns) Data rate (max) (Mbps) 100 Rating Catalog Operating temperature range (°C) -40 to 125
Technology family LVC Supply voltage (min) (V) 1.65 Supply voltage (max) (V) 3.6 Number of channels 4 Inputs per channel 2 IOL (max) (mA) 24 IOH (max) (mA) -24 Input type Standard CMOS Output type Push-Pull Features Over-voltage tolerant inputs, Partial power down (Ioff), Ultra high speed (tpd <5ns) Data rate (max) (Mbps) 100 Rating Catalog Operating temperature range (°C) -40 to 125
SOIC (D) 14 51.9 mm² 8.65 x 6 SOP (NS) 14 79.56 mm² 10.2 x 7.8 SSOP (DB) 14 48.36 mm² 6.2 x 7.8 TSSOP (PW) 14 32 mm² 5 x 6.4 VQFN (RGY) 14 12.25 mm² 3.5 x 3.5 WQFN (BQA) 14 7.5 mm² 3 x 2.5
  • JESD 22 を上回る ESD 保護
    • 2000V人体モデル
    • 1000V 荷電デバイス モデル
  • SN74LVC00A 動作範囲 1.65V～3.6V
  • SN54LVC00A 動作範囲 2V～3.6V
  • SNx4LVC00A –40℃～+85℃ および –40℃～+125℃ で動作を規定
  • SN54LVC00A -55℃～+125℃で動作を規定
  • 5.5V までの入力電圧に対応
  • 最大 tpd 4.3ns (3.3V 時)
  • VOLP 標準値 (出力グランド バウンス) < 0.8V (VCC = 3.3V、TA = 25℃)
  • VOHV 標準値 (出力 VOH アンダーシュート) > 2V (VCC = 3.3V、TA = 25℃)
  • JESD 17 準拠250mA 超のラッチアップ性能
  • MIL-PRF-38535 準拠の製品については、特に記述のない限り、すべてのパラメータはテスト済みです。その他のすべての製品については、量産プロセスにすべてのパラメータのテストが含まれているとは限りません。
  • JESD 22 を上回る ESD 保護
    • 2000V人体モデル
    • 1000V 荷電デバイス モデル
  • SN74LVC00A 動作範囲 1.65V～3.6V
  • SN54LVC00A 動作範囲 2V～3.6V
  • SNx4LVC00A –40℃～+85℃ および –40℃～+125℃ で動作を規定
  • SN54LVC00A -55℃～+125℃で動作を規定
  • 5.5V までの入力電圧に対応
  • 最大 tpd 4.3ns (3.3V 時)
  • VOLP 標準値 (出力グランド バウンス) < 0.8V (VCC = 3.3V、TA = 25℃)
  • VOHV 標準値 (出力 VOH アンダーシュート) > 2V (VCC = 3.3V、TA = 25℃)
  • JESD 17 準拠250mA 超のラッチアップ性能
  • MIL-PRF-38535 準拠の製品については、特に記述のない限り、すべてのパラメータはテスト済みです。その他のすべての製品については、量産プロセスにすべてのパラメータのテストが含まれているとは限りません。

SN54LVC00A クワッド 2 入力正論理 NAND ゲートは 2.7V～3.6V の VCC で動作するように設計されており、SN74LVC00A クワッド 2 入力正論理 NAND ゲートは 1.65V～3.6V の VCC で動作するように設計されて います。

SNx4LVC00A デバイスは、ブール関数 Y = A • B、すなわち Y = A + B を正論理で実行します。

入力は 3.3V または 5V のデバイスから駆動できます。この機能により、3.3V と 5V が混在するシステム環境での変換装置としてこのデバイスを使用できます。

SN54LVC00A クワッド 2 入力正論理 NAND ゲートは 2.7V～3.6V の VCC で動作するように設計されており、SN74LVC00A クワッド 2 入力正論理 NAND ゲートは 1.65V～3.6V の VCC で動作するように設計されて います。

SNx4LVC00A デバイスは、ブール関数 Y = A • B、すなわち Y = A + B を正論理で実行します。

入力は 3.3V または 5V のデバイスから駆動できます。この機能により、3.3V と 5V が混在するシステム環境での変換装置としてこのデバイスを使用できます。
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技術資料

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種類 タイトル 最新の英語版をダウンロード 日付
* データシート SNx4LVC00A クワッド、2 入力、正論理 NAND ゲート データシート (Rev. U 翻訳版) PDF | HTML 英語版 (Rev.U) PDF | HTML 2024年 7月 30日
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アプリケーション・ノート Input and Output Characteristics of Digital Integrated Circuits 1996年 10月 1日
アプリケーション・ノート Live Insertion 1996年 10月 1日
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設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

14-24-LOGIC-EVM — 14 ピンから 24 ピンの D、DB、DGV、DW、DYY、NS、PW の各パッケージに封止した各種ロジック製品向けの汎用評価基板

14-24-LOGIC-EVM 評価基板 (EVM) は、14 ピンから 24 ピンの D、DW、DB、NS、PW、DYY、DGV の各パッケージに封止した各種ロジック デバイスをサポートする設計を採用しています。

ユーザー ガイド: PDF | HTML
TI.com で取り扱いなし
評価ボード

14-24-NL-LOGIC-EVM — 14 ピンから 24 ピンのリードなしパッケージ向け、ロジック製品の汎用評価基板

14-24-NL-LOGIC-EVM は、14 ピンから24 ピンの BQA、BQB、RGY、RSV、RJW、RHL の各パッケージに封止した各種ロジック デバイスや変換デバイスをサポートする設計を採用したフレキシブルな評価基板 (EVM) です。

ユーザー ガイド: PDF | HTML
TI.com で取り扱いなし
シミュレーション・モデル

SN74LVC00A Behavioral SPICE Model

SCAM118.ZIP (7 KB) - PSpice Model
ダウンロード
シミュレーション・モデル

SN74LVC00A IBIS Model (Rev. C)

SCEM005C.ZIP (35 KB) - IBIS Model
ダウンロード
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
SOIC (D) 14 Ultra Librarian
SOP (NS) 14 Ultra Librarian
SSOP (DB) 14 Ultra Librarian
TSSOP (PW) 14 Ultra Librarian
VQFN (RGY) 14 Ultra Librarian
WQFN (BQA) 14 Ultra Librarian
TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用原材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブの拠点
  • 組み立てを実施した拠点

サポートとトレーニング

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