データシート
TPS28225
- 14ns の適応型デッド タイムで 2 個の N チャネル MOSFET を駆動
- 広いゲート駆動電圧範囲：4.5V～8.8V (7V～8Vで最大効率)
- 広いパワー システム トレイン入力電圧範囲：3V～27V
- 広い入力 PWM 信号範囲：2.0V～13.2V 振幅
- 1 相あたり 40A 以上の電流で MOSFET を駆動可能
- 高周波動作：14ns の伝搬遅延と 10ns の立ち上がり / 立ち下がり時間により、FSW – 2MHz が可能
- 30ns未満の入力 PWM パルスを伝播可能
- ローサイド ドライバのシンク オン抵抗 (0.4Ω) により、dV/dTに起因する貫通電流を防止
- 3ステートPWM入力による電源段のシャットダウン
- イネーブル（入力）信号とパワー グッド（出力）信号を同じピンに割り当てることでスペースを節約
- サーマル シャットダウン
- UVLO保護
- 内部ブートストラップ ダイオード
- 経済的な SOIC-8 および放熱強化された 3mm × 3mm VSON-8 パッケージ
- 一般的な3ステート入力ドライバを高性能で置き換え可能
TPS28225 は、適応型デッド タイム制御機能を備えた、N チャネル相補型パワー MOSFET 用の高速ドライバです。さまざまな種類の1相および多相の高電流DC-DCコンバータとともに使用できるよう最適化されています。TPS28225 は、高効率、小型、低 EMI 放射を実現するソリューションです。
この効率は、最大 8.8V のゲート駆動電圧、14ns の適応型デッド タイム制御、14ns の伝播遅延、2A ソースおよび 4A シンクの高電流駆動能力によって実現されています。ローサイド ゲート ドライバの 0.4Ω のインピーダンスによってパワー MOSFET のゲートをスレッショルド未満に保持し、高い dV/dt 位相ノード遷移で貫通電流が生じないようにしています。内部ダイオードによって充電されるブートストラップ コンデンサにより、NチャネルMOSFETをハーフブリッジ構成で使用することができます。
技術資料
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8 をすべて表示 | 種類 | タイトル | 最新の英語版をダウンロード | 日付 | |||
|---|---|---|---|---|---|---|
| * | データシート | TPS28225 高周波、4Aシンク、同期 MOSFET ドライバ データシート (Rev. E 翻訳版) | PDF | HTML | 英語版 (Rev.E) | PDF | HTML | 2024年 1月 30日 |
| アプリケーション・ノート | Using Half-Bridge Gate Driver to Achieve 100% Duty Cycle for High Side FET | PDF | HTML | 2024年 3月 25日 | |||
| アプリケーション・ノート | Bootstrap Circuitry Selection for Half Bridge Configurations (Rev. A) | PDF | HTML | 2023年 9月 8日 | |||
| アプリケーション概要 | External Gate Resistor Selection Guide (Rev. A) | 2020年 2月 28日 | ||||
| アプリケーション概要 | Understanding Peak IOH and IOL Currents (Rev. A) | 2020年 2月 28日 | ||||
| その他の技術資料 | Fundamentals of MOSFET and IGBT Gate Driver Circuits (Replaces SLUP169) (Rev. A) | 2018年 10月 29日 | ||||
| セレクション・ガイド | 電源 IC セレクション・ガイド 2018 (Rev. R 翻訳版) | 英語版 (Rev.R) | 2018年 9月 13日 | |||
| その他の技術資料 | Power Loss Calculation for Sync Buck Converter | 2007年 2月 14日 |
設計および開発
その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。
シミュレーション・モデル
TPS28225 TINA-TI Transient Reference Design
SLUM289.TSC (83 KB) - TINA-TI Reference Design
シミュレーション・ツール
PSPICE-FOR-TI — TI Design / シミュレーション・ツール向け PSpice®
PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。
設計とシミュレーション向けの環境である PSpice for TI (...)
設計とシミュレーション向けの環境である PSpice for TI (...)
| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| SOIC (D) | 8 | Ultra Librarian |
| VSON (DRB) | 8 | Ultra Librarian |
購入と品質
記載されている情報：
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL 定格 / ピーク リフロー
- MTBF/FIT 推定値
- 使用原材料
- 認定試験結果
- 継続的な信頼性モニタ試験結果
記載されている情報：
- ファブの拠点
- 組み立てを実施した拠点
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。