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CLOCK-PERFDATA-DESIGN

Clock performance data and register settings for clock generators, network synchronizers, jitter cleaners, and other clocking devices.

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最新バージョン
バージョン: 2025-01-30
リリース日: 30 1 2025
製品
クロック ネットワーク シンクロナイザ
LMK5B33216 2.5GHz のバルク弾性波発振器 (BAW VCO) を内蔵し 16 出力、3 個の DPLL と APLL (デジタルとアナログの PLL) を採用したネットワーク・シンクロナイザ LMK5B33414 2.5GHz のバルク弾性波発振器 (BAW VCO) を内蔵し 14 出力、3 個の DPLL と APLL (デジタルとアナログの PLL) を採用したネットワーク・シンクロナイザ LMK5C33414AS1 BAW VCO (バルク弾性波電圧制御発振器) 搭載、IEEE-1588 対応、3 個の DPLL (デジタル PLL)、3 個の APLL (アナログ PLL)、4 個の入力と 14 個の出力、ネッ LMK5C33414A JESD204B/C 対応、BAW VCO (バルク弾性波電圧制御発振器) 搭載、3 個の DPLL (デジタル PLL)、3 個の APLL (アナログ PLL)、4 個の入力と 14 個の出力、ネ LMK5C33216A JESD204B/C 対応、BAW VCO (バルク弾性波電圧制御発振器) 搭載、3 個の DPLL (デジタル PLL)、3 個の APLL (アナログ PLL)、2 個の入力と 16 個の出力、ネ LMK5C33216AS1 BAW VCO (バルク弾性波電圧制御発振器) 搭載、IEEE-1588 対応、3 個の DPLL (デジタル PLL)、3 個の APLL (アナログ PLL)、2 個の入力と 16 個の出力、ネッ LMK5C22212A BAW VCO (バルク弾性波電圧制御発振器) 搭載、3 個の DPLL (デジタル PLL)、2 個の APLL (アナログ PLL)、2 個の入力と 12 個の出力、ネットワーク シンクロナイザ  LMK5C22212AS1 BAW VCO (バルク弾性波電圧制御発振器) 搭載、IEEE-1588 対応、3 個の DPLL (デジタル PLL)、2 個の APLL (アナログ PLL)、2 個の入力と 12 個の出力、ネッ

技術情報

リリース情報

Added Configuration and Data Files:



  • LMK5B33216: 312.5 MHz+50 MHz and 312.5 MHz+156.25 MHz output phase noise performance with and without 4 MHz HPF filter applied
  • LMK5C33414A: 1PPS Configuration on IN0 and OUT0

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