JAJSUO1C May   1988  – May 2024 74AC11138

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 概要
  4. 3 ピン構成および機能
  5. 4 仕様
    1. 4.1 絶対最大定格
    2. 4.2 推奨動作条件
    3. 4.3 熱に関する情報
    4. 4.4 電気的特性
    5. 4.5 スイッチング特性、VCC = 3.3 V ± 0.3 V
    6. 4.6 スイッチング特性、VCC = 5 V ± 0.5 V
    7. 4.7 動作特性
  6. 5 パラメータ測定情報
  7. 6 詳細説明
    1. 6.1 概要
    2. 6.2 機能ブロック図
    3. 6.3 デバイスの機能モード
  8. 7 アプリケーションと実装
    1. 7.1 アプリケーション情報
    2. 7.2 電源に関する推奨事項
    3. 7.3 レイアウト
      1. 7.3.1 レイアウトのガイドライン
  9. 8 デバイスおよびドキュメントのサポート
    1. 8.1 ドキュメントのサポート (アナログ)
      1. 8.1.1 関連資料
    2. 8.2 ドキュメントの更新通知を受け取る方法
    3. 8.3 サポート・リソース
    4. 8.4 商標
    5. 8.5 静電気放電に関する注意事項
    6. 8.6 用語集
  10. 9 改訂履歴
  11. 10メカニカル、パッケージ、および注文情報

パッケージ・オプション

デバイスごとのパッケージ図は、PDF版データシートをご参照ください。

メカニカル・データ（パッケージ｜ピン）
  • PW|16
  • NS|16
  • N|16
  • D|16
サーマルパッド・メカニカル・データ
発注情報

2 概要

74AC11138 の回路は、伝搬遅延時間を極めて短くする必要がある高性能メモリ デコーディングまたはデータ ルーティング用途向けに設計されています。

パッケージ情報
部品番号 パッケージ (1) パッケージ サイズ(2) 本体サイズ (公称)(3)
74AC11138 D (SOIC、16) 9.9mm × 6mm 9.9mm × 3.9mm
N (PDIP、16) 19.3mm × 9.4mm 19.3mm × 6.35mm
NS (SOP、16) 10.2mm × 7.8mm 10.3mm × 5.3mm
PW (TSSOP、16) 5.00mm × 6.4mm 5.00mm × 4.4mm
(1) 詳細については、セクション 10 を参照してください。
(2) パッケージ サイズ (長さ × 幅) は公称値であり、該当する場合はピンも含まれます。
(3) 本体サイズ (長さ×幅) は公称値であり、ピンは含まれません。
74AC11138 論理図 (正論理)論理図 (正論理)