JAJSUL1A May   2024  – July 2024 DRV8161 , DRV8162

ADVANCE INFORMATION  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 Device Comparison Table
  6. 5 Pin Configuration and Functions
  7. 6 Specification
    1. 6.1 Absolute Maximum Ratings
    2. 6.2 ESD Ratings
    3. 6.3 Recommended Operating Conditions
    4. 6.4 Thermal Information 1pkg
    5. 6.5 Electrical Characteristics
    6. 6.6 Timing Diagrams
  8. 7 Detailed Description
    1. 7.1 Overview
    2. 7.2 Functional Block Diagram
    3. 7.3 Feature Description
      1. 7.3.1 Gate Drivers
        1. 7.3.1.1 PWM Control Modes
          1. 7.3.1.1.1 2-pin PWM Mode
          2. 7.3.1.1.2 1-pin PWM Mode (preview only)
          3. 7.3.1.1.3 Independent PWM Mode
        2. 7.3.1.2 Gate Drive Architecture
          1. 7.3.1.2.1 Tickle Charge Pump (TCP)
          2. 7.3.1.2.2 Deadtime and Cross-Conduction Prevention (Shoot through protection)
      2. 7.3.2 Pin Diagrams
        1. 7.3.2.1 Four Level Input Pin (CSAGAIN)
        2. 7.3.2.2 Digital output nFAULT (DRV8162, DRV8162L)
        3. 7.3.2.3 Digital InOut nFAULT/nDRVOFF (DRV8161)
        4. 7.3.2.4 Multi-level inputs (IDRIVE1 and IDRIVE2)
        5. 7.3.2.5 Multi-level digital input (VDSLVL)
        6. 7.3.2.6 Multi-level digital input DT/MODE
      3. 7.3.3 Low-Side Current Sense Amplifiers
        1. 7.3.3.1 Bidirectional Current Sense Operation
      4. 7.3.4 Gate Driver Shutdown Sequence (nDRVOFF)
        1. 7.3.4.1 nDRVOFF Diagnostic
      5. 7.3.5 Gate Driver Protective Circuits
        1. 7.3.5.1 GVDD Undervoltage Lockout (GVDD_UV)
        2. 7.3.5.2 MOSFET VDS Overcurrent Protection (VDS_OCP)
        3. 7.3.5.3 Thermal Shutdown (OTSD)
  9. 8 Application and Implementation
    1. 8.1 Application Information
    2. 8.2 Typical Application
      1. 8.2.1 Typical Application with DRV8161
      2. 8.2.2 Typical Application with DRV8162 and DRV8162L
      3. 8.2.3 External Components
  10. 9 Layout
    1. 9.1 Layout Guidelines
  11. 10Device and Documentation Support
    1. 10.1 Device Support
    2. 10.2 Documentation Support
      1. 10.2.1 Related Documentation
    3. 10.3 Receiving Notification of Documentation Updates
    4. 10.4 Community Resources
    5. 10.5 Trademarks
  12. 11Revision History
  13. 12Mechanical, Packaging, and Orderable Information
    1. 12.1 Tape and Reel Information

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

3 概要

DRV816x は、ハイサイドおよびローサイドの N チャネル パワー MOSFET を駆動できる、ハーフ ブリッジ ゲート ドライバです。ゲート駆動電圧は GVDD 電源ピンから生成され、内蔵ブートストラップ回路はハイサイド FET を最大 102V ドレインまで駆動するために使用されます。スマート ゲート ドライブ アーキテクチャは、最大でソース 1A、シンク 2A の 16 レベル (48 通りの組み合わせ) のゲート駆動ピーク電流をサポートし、ゲート駆動電流の内蔵タイミング制御機能も搭載しています。これらのデバイスを使用して、ブラシレス / ブラシ付き DC モータ、PMSM、ステッピング モータ、SRM、ソレノイドなど、各種の負荷を駆動できます。

電源低電圧、FET 過電流、ダイ過熱に対する保護機能が内蔵されています。nFAULT ピンは、保護機能によって検出されたフォルト イベントを通知します。nDRVOFF ピンは、PWM 制御から独立して電力段のシャットダウンを開始します。DRV8162 および DRV8162L デバイスは、セーフ トルク オフ (STO) 機能を補助するために、分割電源アーキテクチャを採用しています。

ゲート駆動電流、デッドタイム、PWM 制御インターフェイス、過電流検出など、デバイスの多くのパラメータは、いくつかの受動部品をデバイスのピンに接続して構成できます。内蔵のローサイド電流センス アンプ (DRV8161) は、電流測定情報をコントローラに返します。

製品情報
部品番号 パッケージ (1) 本体サイズ (公称)
DRV8161 VSSOP (20) 5.1mm × 3.0mm
DRV8162(2) VSSOP (20) 5.1mm × 3.0mm
(1) 詳細については、セクション 12 を参照してください。
(2) DRV8162 (製品プレビュー) および DRV8162L (事前情報) のデバイス バリアントが含まれます。「Device Comparison Table」を参照してください。
DRV8161 DRV8162 DRV816x の概略回路図DRV816x の概略回路図