JAJSUL1C May   2024  – February 2025 DRV8161 , DRV8162

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 説明
  5. 4 デバイス比較表
  6. 5 ピン構成および機能
  7. 6 仕様
    1. 6.1 絶対最大定格
    2. 6.2 ESD 定格
    3. 6.3 推奨動作条件
    4. 6.4 熱に関する情報 (1pkg)
    5. 6.5 電気的特性
    6. 6.6 タイミング図
  8. 7 詳細説明
    1. 7.1 概要
    2. 7.2 機能ブロック図
    3. 7.3 機能説明
      1. 7.3.1 ゲート ドライバ
        1. 7.3.1.1 PWM 制御モード
          1. 7.3.1.1.1 2 ピン PWM モード
          2. 7.3.1.1.2 1 ピン PWM モード
          3. 7.3.1.1.3 独立 PWM モード
        2. 7.3.1.2 ゲート ドライブ アーキテクチャ
          1. 7.3.1.2.1 ティックルチャージポンプ （TCP）
          2. 7.3.1.2.2 デッドタイムとクロス導通防止（貫通電流保護）
      2. 7.3.2 ピン配置図
        1. 7.3.2.1 4 レベル入力ピン（CSAGAIN）
        2. 7.3.2.2 デジタル出力 nFAULT（DRV8162、DRV8162L）
        3. 7.3.2.3 デジタル入力/出力 nFAULT/nDRVOFF （DRV8161）
        4. 7.3.2.4 マルチレベル入力（IDRIVE1 およびIDRIVE2）
        5. 7.3.2.5 マルチレベルデジタル入力（VDSLVL）
        6. 7.3.2.6 マルチレベルデジタル入力 DT/MODE
      3. 7.3.3 ローサイド電流検出アンプ
        1. 7.3.3.1 双方向電流検出の動作
      4. 7.3.4 ゲート ドライバ シャットダウン シーケンス （nDRVOFF）
        1. 7.3.4.1 nDRVOFF 診断
      5. 7.3.5 ゲート ドライバ保護回路
        1. 7.3.5.1 GVDD 低電圧誤動作防止 (GVDD_UV)
        2. 7.3.5.2 MOSFET VDS 過電流保護 (VDS_OCP)
        3. 7.3.5.3 サーマル シャットダウン (OTSD)
  9. 8 アプリケーションと実装
    1. 8.1 アプリケーション情報
    2. 8.2 代表的なアプリケーション
      1. 8.2.1 DRV8161 の代表的なアプリケーション
      2. 8.2.2 DRV8162 と DRV8162L を使用した代表的なアプリケーション
      3. 8.2.3 外付け部品
    3. 8.3 レイアウト
      1. 8.3.1 レイアウトのガイドライン
    4. 8.4 電源に関する推奨事項
      1. 8.4.1 バルク容量の決定
  10. 9 デバイスおよびドキュメントのサポート
    1. 9.1 デバイス サポート
    2. 9.2 ドキュメントのサポート
      1. 9.2.1 関連資料
    3. 9.3 ドキュメントの更新通知を受け取る方法
    4. 9.4 サポート・リソース
    5. 9.5 商標
    6. 9.6 静電気放電に関する注意事項
    7. 9.7 用語集
    8. 9.8 コミュニティ リソース
  11. 10改訂履歴
  12. 11メカニカル、パッケージ、および注文情報

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

7.3.4 ゲート ドライバ シャットダウン シーケンス （nDRVOFF）

nDRVOFF が Lowに駆動されると、ゲートドライバはシャットダウンに移行し、入力ピン INH/IN および INL/EN の信号がオーバーライドされます。nDRVOFF はデバイス内部のデジタル制御ロジックをバイパスし、ゲートドライバ出力に直接接続されます。このピンを使うと、内部制御ロジックを直接バイパスできるため、ゲート ドライバが無効化された際の故障を外部から監視できます。DRV816xが nDRVOFF ピンを LOW に駆動していることを検出すると、デバイスはゲートドライバを無効にし、ゲートドライバをプルダウンモードに移行します。ゲート ドライバのシャットダウン シーケンスは、図 7-17に示すように進行します。ゲートドライバがシャットダウンシーケンスを開始すると、ドライバプルダウンがI DRVN_SDの電流でt DRVN_SD時間の間アクティブプルダウンが適用されます。

DRV8161 DRV8162 ゲート ドライバ シャットダウン シーケンス図 7-17 ゲート ドライバ シャットダウン シーケンス