JAJSGM8E December   2018  – August 2023 LM5155 , LM51551

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 改訂履歴
  6. 5 概要 (続き)
  7. 6 デバイス比較表
  8. 7 ピン構成および機能
  9. 8 仕様
    1. 8.1 絶対最大定格
    2. 8.2 ESD 定格
    3. 8.3 推奨動作条件
    4. 8.4 熱に関する情報
    5. 8.5 電気的特性
    6. 8.6 代表的特性
  10. 9 詳細説明
    1. 9.1 概要
    2. 9.2 機能ブロック図
    3. 9.3 機能説明
      1. 9.3.1  ライン低電圧ロックアウト (UVLO/SYNC ピン)
      2. 9.3.2  高電圧 VCC レギュレータ (BIAS、VCC ピン)
      3. 9.3.3  ソフトスタート (SS ピン)
      4. 9.3.4  スイッチング周波数 (RT ピン)
      5. 9.3.5  クロック同期 (UVLO/SYNC ピン)
      6. 9.3.6  電流センスとスロープ補償 (CS ピン)
      7. 9.3.7  電流制限と最小オン時間 (CS ピン)
      8. 9.3.8  帰還およびエラー・アンプ (FB、COMP ピン)
      9. 9.3.9  パワー・グッド･インジケータ (PGOOD ピン)
      10. 9.3.10 ヒカップ・モード過負荷保護 (LM51551 のみ)
      11. 9.3.11 最大デューティ・サイクル制限と最低入力電源電圧
      12. 9.3.12 MOSFET ドライバ (GATE ピン)
      13. 9.3.13 過電圧保護 (OVP)
      14. 9.3.14 サーマル・シャットダウン (TSD)
    4. 9.4 デバイスの機能モード
      1. 9.4.1 シャットダウン・モード
      2. 9.4.2 スタンバイ・モード
      3. 9.4.3 実行モード
  11. 10アプリケーションと実装
    1. 10.1 アプリケーション情報
    2. 10.2 代表的なアプリケーション
      1. 10.2.1 設計要件
      2. 10.2.2 詳細な設計手順
        1. 10.2.2.1 WEBENCH® ツールによるカスタム設計
        2. 10.2.2.2 推奨部品
        3. 10.2.2.3 インダクタの選択 (LM)
        4. 10.2.2.4 出力コンデンサ (COUT)
        5. 10.2.2.5 入力コンデンサ
        6. 10.2.2.6 MOSFET の選択
        7. 10.2.2.7 ダイオードの選択
        8. 10.2.2.8 効率の推定
      3. 10.2.3 アプリケーション曲線
    3. 10.3 システム例
    4. 10.4 電源に関する推奨事項
    5. 10.5 レイアウト
      1. 10.5.1 レイアウトのガイドライン
      2. 10.5.2 レイアウト例
  12. 11デバイスおよびドキュメントのサポート
    1. 11.1 デバイスのサポート
      1. 11.1.1 サード・パーティ製品に関する免責事項
      2. 11.1.2 開発サポート
        1. 11.1.2.1 WEBENCH® ツールによるカスタム設計
    2. 11.2 ドキュメントのサポート
      1. 11.2.1 関連資料
    3. 11.3 ドキュメントの更新通知を受け取る方法
    4. 11.4 サポート・リソース
    5. 11.5 商標
    6. 11.6 静電気放電に関する注意事項
    7. 11.7 用語集
  13. 12メカニカル、パッケージ、および注文情報

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

9.3.8 帰還およびエラー・アンプ (FB、COMP ピン)

帰還分割抵抗は、内部の相互コンダクタンス・エラー・アンプに接続され、このアンプは高い出力抵抗 (RO = 10MΩ) と広い帯域幅 (BW = 7MHz) を備えています。内部の相互コンダクタンス・エラー・アンプは、FB ピンと SS ピンの電圧の差または内部基準電圧のいずれか低い方に比例する電流を供給します。内部の相互コンダクタンス・エラー・アンプは、通常動作中には対称的なソースおよびシンク機能を提供し、FB が OVP スレッショルドを超えるとシンク機能を低減します。

出力レギュレーション･ターゲットを設定するには、式 14 に示すように帰還抵抗の値を選択します。

式 14. GUID-BBC1CDDB-B5D9-49E2-8062-6D7B0F0FD653-low.gif

エラー・アンプの出力は COMP ピンに接続されるため、Type 2 のループ補償ネットワークを使用できます。RCOMP、CCOMP、およびオプションの CHF ループ補償部品は、エラー・アンプのゲインと位相の特性を構成し、安定したループ応答を実現します。FB ピンの絶対最大定格電圧は 3.8V です。必要に応じて、特に車載用の負荷ダンプ過渡時に、帰還抵抗分圧器の入力を外付けのツェナー・ダイオードでクランプできます。

COMP ピンは内部クランプを備えています。最大 COMP クランプは、シャットダウン中でも COMP ピンの最大電圧を絶対最大定格未満に制限します。最小 COMP クランプは、無負荷から重負荷への移行中にできるだけ早くスイッチングを開始できるように、COMP ピンの最小電圧を制限します。フライバック・トポロジで FB がグランドに接続されている場合、最小 COMP クランプはディセーブルになります。