JAJSTH2B July   2006  – March 2024 SN65MLVD047A

PRODUCTION DATA  

  1.   1
  2. 特長
  3. アプリケーション
  4. 概要
  5. Pin Configuration
  6. Specifications
    1. 5.1 Absolute Maximum Ratings
    2. 5.2 ESD Ratings
    3. 5.3 Recommended Operating Conditions
    4. 5.4 Package Dissipation Ratings
    5. 5.5 Thermal Information
    6. 5.6 Device Electrical Characteristics
    7. 5.7 Device Electrical Characteristics
    8. 5.8 Switching Characteristics
    9. 5.9 Typical Characteristics
  7. Parameter Measurement Information
  8. Device Functional Modes
  9. Application and Implementation
    1. 8.1 Application Information
      1. 8.1.1 Synchroization Clock in AdvancedTCA
      2. 8.1.2 Multipoint Configuration
      3. 8.1.3 Multidrop Configuration
      4. 8.1.4 Unused Channel
  10. Device and Documentation Support
    1. 9.1 ドキュメントの更新通知を受け取る方法
    2. 9.2 サポート・リソース
    3. 9.3 Trademarks
    4. 9.4 静電気放電に関する注意事項
    5. 9.5 用語集
  11. 10Revision History
  12. 11Mechanical, Packaging, and Orderable Information

パッケージ・オプション

メカニカル・データ(パッケージ|ピン)
サーマルパッド・メカニカル・データ
発注情報

概要

SN65MLVD047A は、TIA/EIA-899 規格、マルチポイント低電圧差動信号処理 (M−LVDS) の電気的特性に準拠したクワッド ライン ドライバです。この M-LVDS デバイスの出力電流は、二重終端の伝送ラインと高負荷のバックプレーン バス アプリケーションに対応するため、標準の LVDS 準拠デバイスに比べて増加しています。バックプレーン アプリケーションでは一般に、バスの両端でインピーダンス整合の終端抵抗が必要です。二重終端バスの実効インピーダンスは、バス終端とバス インターフェイス デバイスの容量性負荷により、30Ω まで下げることができます。SN65MLVD047A ドライバにより、最小 30Ω の負荷での動作が可能です。SN65MLVD047A デバイスは、単一のバス上に複数のドライバを存在させることができます。SN65MLVD047A ドライバは、ディセーブルまたは電源オフ時に高インピーダンスになります。動作をサポートするため、ドライバのエッジ レート制御が組み込まれています。M-LVDS 規格では、メイン伝送ラインからインターフェイス デバイスへの複数のバス スタブが予想される場合、最大 32 ノード (ドライバまたはレシーバ) をバックプレーン内の同じメディアに接続できます。SN65MLVD047A は、すべてのバス ピンに 9kV ESD 保護を実現します。

パッケージ情報
部品番号パッケージ (1)パッケージ サイズ(2)
SN65MLVD047APW (TSSOP、16)5mm × 6.4mm
D (SOIC、16)9.9mm × 6mm
詳細は、セクション 11を参照してください。
パッケージ サイズ (長さ × 幅) は公称値であり、該当する場合はピンも含まれます。


GUID-67C93E8B-3DB6-4D3C-AE3A-114BE4DD4631-low.gif