JAJSN34B July   2021  – August 2024 SN74HCS240

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5.   5
  6.   6
  7. 4 ピン構成および機能
  8. 5 仕様
    1. 5.1 絶対最大定格
    2. 5.2 ESD 定格
    3. 5.3 推奨動作条件
    4. 5.4 熱に関する情報
    5. 5.5 電気的特性
    6. 5.6 スイッチング特性
    7. 5.7 動作特性
    8. 5.8 代表的特性
  9. 6 パラメータ測定情報
  10. 7 詳細説明
    1. 7.1 概要
    2. 7.2 機能ブロック図
    3. 7.3 機能説明
      1. 7.3.1 機能説明
        1. 7.3.1.1 平衡化された CMOS 3 ステート出力
        2. 7.3.1.2 平衡化された CMOS プッシュプル出力
        3. 7.3.1.3 オープン ドレイン CMOS 出力
        4. 7.3.1.4 CMOS シュミット トリガ入力
        5. 7.3.1.5 TTL 互換 CMOS 入力
        6. 7.3.1.6 標準 CMOS 入力
        7. 7.3.1.7 クランプ ダイオード構造
    4. 7.4 デバイスの機能モード
  11. 8 アプリケーションと実装
    1. 8.1 アプリケーション情報
    2. 8.2 代表的なアプリケーション
      1. 8.2.1 設計要件
        1. 8.2.1.1 電源に関する考慮事項
        2. 8.2.1.2 入力に関する考慮事項
        3. 8.2.1.3 出力に関する考慮事項
      2. 8.2.2 詳細な設計手順
      3. 8.2.3 アプリケーション曲線
    3. 8.3 電源に関する推奨事項
    4. 8.4 レイアウト
      1. 8.4.1 レイアウトのガイドライン
      2. 8.4.2 レイアウト例
  12. 9 デバイスおよびドキュメントのサポート
    1. 9.1 ドキュメントのサポート
      1. 9.1.1 関連資料
    2. 9.2 ドキュメントの更新通知を受け取る方法
    3. 9.3 サポート・リソース
    4. 9.4 商標
    5. 9.5 静電気放電に関する注意事項
    6. 9.6 用語集
  13. 10改訂履歴
  14. 11メカニカル、パッケージ、および注文情報

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

7.1 概要

SN74HCS240 は、シュミット トリガ入力と 3 ステート出力を備えた 8 つの独立した高速 CMOS インバータを内蔵しています。

各インバータは、ブール論理関数 xYn = xAn を実行します。x はバンク番号、n はチャネル番号です。

各出力イネーブル (xOE) は 4 つのインバータを制御します。xOE ピンが Low 状態のとき、バンク x のすべてのインバータの出力がイネーブルになります。xOE ピンが High 状態のとき、バンク x のすべてのインバータの出力がディセーブルになります。ディセーブルされた出力はすべて高インピーダンス状態になります。

電源投入または電源切断時に確実に高インピーダンス状態にするため、両方の OE ピンをプルアップ抵抗経由で VCC に接続する必要があります。この抵抗の最小値は、「電気的特性」表に定義されているドライバの電流シンク能力とピンのリーク電流によって決定されます。