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  • SN74LXCH1T45 シングル・ビット、デュアル電源バス・トランシーバ、構成可能な電圧変換、3 ステート出力、バス・ホールド入力

    • JAJSME7 April   2022 SN74LXCH1T45

      PRODUCTION DATA  

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  • SN74LXCH1T45 シングル・ビット、デュアル電源バス・トランシーバ、構成可能な電圧変換、3 ステート出力、バス・ホールド入力
  1. 1 特長
  2. 2 アプリケーション
  3. 3 説明
  4. 4 Revision History
  5. 5 Pin Configuration and Functions
  6. 6 Specifications
    1. 6.1  Absolute Maximum Ratings
    2. 6.2  ESD Ratings
    3. 6.3  Recommended Operating Conditions
    4. 6.4  Thermal Information
    5. 6.5  Electrical Characteristics
    6. 6.6  Switching Characteristics, VCCA = 1.2 ± 0.1 V
    7. 6.7  Switching Characteristics, VCCA = 1.5 ± 0.1 V
    8. 6.8  Switching Characteristics, VCCA = 1.8 ± 0.15 V
    9. 6.9  Switching Characteristics, VCCA = 2.5 ± 0.2 V
    10. 6.10 Switching Characteristics, VCCA = 3.3 ± 0.3 V
    11. 6.11 Switching Characteristics, VCCA = 5.0 ± 0.5 V
    12. 6.12 Switching Characteristics: Tsk, TMAX
    13. 6.13 Operating Characteristics
    14. 6.14 Typical Characteristics
  7. 7 Parameter Measurement Information
    1. 7.1 Load Circuit and Voltage Waveforms
  8. 8 Detailed Description
    1. 8.1 Overview
    2. 8.2 Functional Block Diagram
    3. 8.3 Feature Description
      1. 8.3.1  CMOS Schmitt-Trigger Inputs
        1. 8.3.1.1 Control Inputs with Integrated Static Pull-Down Resistors
      2. 8.3.2  Balanced High-Drive CMOS Push-Pull Outputs
      3. 8.3.3  Partial Power Down (Ioff)
      4. 8.3.4  VCC Isolation and VCC Disconnect
      5. 8.3.5  Over-Voltage Tolerant Inputs
      6. 8.3.6  Glitch-Free Power Supply Sequencing
      7. 8.3.7  Negative Clamping Diodes
      8. 8.3.8  Fully Configurable Dual-Rail Design
      9. 8.3.9  Supports High-Speed Translation
      10. 8.3.10 Bus-Hold Data Inputs
    4. 8.4 Device Functional Modes
  9. 9 Application and Implementation
    1. 9.1 Application Information
    2. 9.2 Enable Times
    3. 9.3 Typical Application
      1. 9.3.1 Design Requirements
      2. 9.3.2 Detailed Design Procedure
      3. 9.3.3 Application Curve
  10. 10Power Supply Recommendations
  11. 11Layout
    1. 11.1 Layout Guidelines
    2. 11.2 Layout Example
  12. 12Device and Documentation Support
    1. 12.1 Documentation Support
      1. 12.1.1 Related Documentation
    2. 12.2 Receiving Notification of Documentation Updates
    3. 12.3 サポート・リソース
    4. 12.4 Trademarks
    5. 12.5 Electrostatic Discharge Caution
    6. 12.6 Glossary
  13. 13Mechanical, Packaging, and Orderable Information
  14. 重要なお知らせ

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
  • DRY|6
    • MPDS221F
  • DCK|6
    • MPDS114F
  • DTQ|6
    • MUSS003A
サーマルパッド・メカニカル・データ
  • DRY|6
    • QFND138E
発注情報
  • jajsme7_oa
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DATA SHEET

SN74LXCH1T45 シングル・ビット、デュアル電源バス・トランシーバ、構成可能な電圧変換、3 ステート出力、バス・ホールド入力

このリソースの元の言語は英語です。 翻訳は概要を便宜的に提供するもので、自動化ツール (機械翻訳) を使用していることがあり、TI では翻訳の正確性および妥当性につきましては一切保証いたしません。 実際の設計などの前には、ti.com で必ず最新の英語版をご参照くださいますようお願いいたします。

1 特長

  • 完全に構成可能なデュアル・レール設計により、各ポートは 1.1V～5.5V で動作可能
  • 堅牢でグリッチの発生しない電源シーケンシング
  • 3.3V～5.0V で最高 420Mbps をサポート
  • データ入力時のバス・ホールドにより、外付けプルアップ / プルダウン抵抗が不要
  • シュミット・トリガ制御入力により低速またはノイズの多い入力に対応
  • スタティック・プルダウン抵抗を内蔵した制御入力により、制御入力のフローティングが可能
  • 高い駆動強度 (5V で最大 32mA)
  • 低い消費電力
    • 最大 3µA (25℃)
    • 最大 6µA (–40℃～125℃)
  • VCC 絶縁および VCC 切断機能
    • どちらかの VCC 電源が 100mV 未満になると、すべての I/O が高インピーダンス化
    • Ioff-float により VCC 切断動作をサポート
  • Ioff により部分的パワーダウン・モードでの動作をサポート
  • LVC ファミリのレベル・シフタと互換
  • 制御ロジック (DIR) は VCCA 基準
  • 動作温度範囲：–40℃～+125℃
  • JESD 78、Class II 準拠で 100mA 超のラッチアップ性能
  • JESD 22 を上回る ESD 保護
    • 人体モデル 4000V
    • デバイス帯電モデル 1000V

2 アプリケーション

  • 低速またはノイズの多い入力信号の除去
  • インジケータ LED または ブザーの駆動
  • メカニカル・スイッチのデバウンス
  • 汎用 I/O レベル・シフト

3 説明

SN74LXCH1T45 は、バス・ホールド回路を備えた 1 ビット、デュアル電源、非反転、双方向の電圧レベル変換デバイスです。I/O ピン A および制御ピン (DIR) は VCCA のロジック・レベルを基準とし、I/O ピン B は VCCB ロジック・レベルを基準とします。A ピンは 1.1V～5.5V の範囲の I/O 電圧を受け入れ、B ポートは 1.1V～5.5V の I/O 電圧を受け入れます。DIR が HIGH のときは A から B へ、DIR が LOW のときは B から A へデータが転送されます。制御ロジックの概要についてはデバイス機能モードを参照してください。

製品情報(1)
部品番号 パッケージ 本体サイズ (公称)
SN74LXCH1T45 SC70 (DCK) (6) 2.00mm × 1.25mm
SON (DRY) (6) 1.45mm × 1.00mm
X2SON (DTQ) (6) 1.00mm × 0.80mm
(1) 利用可能なパッケージについては、このデータシートの末尾にある注文情報を参照してください。
機能ブロック図

4 Revision History

DATE REVISION NOTES
April 2022 * Initial Release

 
Texas Instruments

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