JAJSII0E June   2020  – November 2023 LM339LV-Q1 , LM393LV-Q1 , TL331LV-Q1 , TL391LV-Q1

PRODMIX  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 ピン構成および機能
    1. 4.1 TL331LV-Q1 および TL391LV-Q1 のピン機能
    2. 4.2 ピンの機能：LM393LV-Q1
    3. 4.3 ピンの機能：LM339LV-Q1
  6. 5 仕様
    1. 5.1  絶対最大定格
    2. 5.2  ESD 定格
    3. 5.3  推奨動作条件
    4. 5.4  TL3x1LV-Q1 の熱に関する情報
    5. 5.5  熱に関する情報、LM393LV-Q1
    6. 5.6  熱に関する情報、LM339LV-Q1
    7. 5.7  電気的特性、TL3x1LV-Q1
    8. 5.8  スイッチング特性、TL3x1LV-Q1
    9. 5.9  熱に関する情報、LM393LV-Q1
    10. 5.10 スイッチング特性、LM393LV-Q1
    11. 5.11 電気的特性、LM339LV-Q1
    12. 5.12 スイッチング特性、LM339LV-Q1
    13. 5.13 代表的特性
  7. 6 詳細説明
    1. 6.1 概要
    2. 6.2 機能ブロック図
    3. 6.3 機能説明
    4. 6.4 デバイスの機能モード
      1. 6.4.1 オープン・ドレイン出力
      2. 6.4.2 パワーオン・リセット (POR)
      3. 6.4.3 入力
        1. 6.4.3.1 レール・ツー・レール入力
        2. 6.4.3.2 フォルト・トレラント入力
        3. 6.4.3.3 入力保護
      4. 6.4.4 ESD 保護
      5. 6.4.5 未使用入力
      6. 6.4.6 ヒステリシス
  8. 7 アプリケーションと実装
    1. 7.1 アプリケーション情報
      1. 7.1.1 基本的なコンパレータの定義
        1. 7.1.1.1 動作
        2. 7.1.1.2 伝搬遅延
        3. 7.1.1.3 オーバードライブ電圧
      2. 7.1.2 ヒステリシス
        1. 7.1.2.1 ヒステリシス付きの反転コンパレータ
        2. 7.1.2.2 ヒステリシス付きの非反転コンパレータ
    2. 7.2 代表的なアプリケーション
      1. 7.2.1 ウィンドウ・コンパレータ
        1. 7.2.1.1 設計要件
        2. 7.2.1.2 詳細な設計手順
        3. 7.2.1.3 アプリケーション曲線
      2. 7.2.2 方形波発振器
        1. 7.2.2.1 設計要件
        2. 7.2.2.2 詳細な設計手順
        3. 7.2.2.3 アプリケーション曲線
      3. 7.2.3 可変パルス幅ジェネレータ
      4. 7.2.4 時間遅延ジェネレータ
      5. 7.2.5 ロジック・レベル・シフタ
      6. 7.2.6 ワンショット・マルチバイブレータ
      7. 7.2.7 双安定マルチバイブレータ
      8. 7.2.8 ゼロ交差検出器
      9. 7.2.9 パルス・スライサ
    3. 7.3 電源に関する推奨事項
    4. 7.4 レイアウト
      1. 7.4.1 レイアウトのガイドライン
      2. 7.4.2 レイアウト例
  9. 8 デバイスおよびドキュメントのサポート
    1. 8.1 関連資料
    2. 8.2 ドキュメントの更新通知を受け取る方法
    3. 8.3 サポート・リソース
    4. 8.4 商標
    5. 8.5 静電気放電に関する注意事項
    6. 8.6 用語集
  10. 9 改訂履歴
  11. 10メカニカル、パッケージ、および注文情報

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

7.2.9 パルス・スライサ

パルス・スライサはゼロ交差検出器のバリエーションで、ベースライン・レベルが変動する入力信号上でのゼロ交差の検出に使用されます。この回路は、対称型の波形で最良の性能を発揮します。R1 と C1 の RC ネットワークにより、平均基準電圧 VREF が設定されます。この電圧は VIN 信号の平均振幅に追従します。非反転入力は、R2 を介して VREF に直接接続されます。R2 と R3 を使用してヒステリシスを設定すると、遷移をスプリアス・トグルが発生しない状態に維持できます。時定数は、長期間の対称性と振幅の変化に対する応答時間の間のトレードオフとなります。

波形がデータである場合、適切な平均ベースラインを維持するために、データを NRZ (Non-Return to Zero) 形式でエンコードすることをお勧めします。非対称入力では、VREF 平均電圧の変化を原因とするタイミング歪みが発生する場合があります。

GUID-14C578E8-0300-4453-819C-77555656792F-low.gif図 7-18 パルス・スライサ

この設計については、以下の設計要件に従ってください。

  • 有効なトリップ・スレッショルドを維持するには、RC 定数の値 (R2 および C1) が目標データ・レートをサポートする必要があります。
  • R2 と R43 を使用して設定されたヒステリシスにより、スプリアス出力信号のトグルを防止できます。

図 7-19 は、ベースラインが変動する、ボー・レート 9600 のデータ信号の結果を示しています。

GUID-4368F1EB-4917-43C2-8FEC-44466991207C-low.gif図 7-19 パルス・スライサの波形