JAJSV12A July   2024  – October 2024 TLC3555-Q1

PRODMIX  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 Pin Configuration and Functions
  6. 5 Specifications
    1. 5.1 Absolute Maximum Ratings
    2. 5.2 ESD Ratings
    3. 5.3 Recommended Operating Conditions
    4. 5.4 Thermal Information
    5. 5.5 Electrical Characteristics
    6. 5.6 Switching Characteristics
    7. 5.7 Typical Characteristics
  7. 6 Detailed Description
    1. 6.1 Overview
    2. 6.2 Functional Block Diagram
    3. 6.3 Feature Description
      1. 6.3.1 Monostable Operation
      2. 6.3.2 Astable Operation
      3. 6.3.3 Power-on Reset
      4. 6.3.4 Thermal Shutdown
    4. 6.4 Device Functional Modes
  8. 7 Application and Implementation
    1. 7.1 Application Information
    2. 7.2 Typical Applications
      1. 7.2.1 Missing-Pulse Detector
        1. 7.2.1.1 Design Requirements
        2. 7.2.1.2 Detailed Design Procedure
        3. 7.2.1.3 Application Curve
      2. 7.2.2 Pulse-Width Modulation
        1. 7.2.2.1 Design Requirements
        2. 7.2.2.2 Detailed Design Procedure
        3. 7.2.2.3 Application Curve
    3. 7.3 Power Supply Recommendations
    4. 7.4 Layout
      1. 7.4.1 Layout Guidelines
      2. 7.4.2 Layout Example
  9. 8 Device and Documentation Support
    1. 8.1 Documentation Support
      1. 8.1.1 Related Documentation
    2. 8.2 ドキュメントの更新通知を受け取る方法
    3. 8.3 サポート・リソース
    4. 8.4 Trademarks
    5. 8.5 静電気放電に関する注意事項
    6. 8.6 用語集
  10. 9 Revision History
  11. 10Mechanical, Packaging, and Orderable Information

パッケージ・オプション

デバイスごとのパッケージ図は、PDF版データシートをご参照ください。

メカニカル・データ（パッケージ｜ピン）
  • D|8
  • DDF|8
サーマルパッド・メカニカル・データ
発注情報

3 概要

TLC3555-Q1 は、テキサス・インスツルメンツの CMOS プロセスを利用して製造されたモノリシック タイミング回路です。このタイマは、CMOS、TTL、MOS ロジックと完全互換であり、3MHz まで、さらにはそれを超える周波数でも動作します。TLC3555-Q1 は、性能と機能の両方の観点から既存の TLC555-Q1 を改良したものであり、より厳格な仕様許容誤差に加え、サーマル シャットダウンやパワーオン リセットなどの追加機能も備えています。

TLC3555-Q1 のトリガ、スレッショルド、リセットのロジックは、TLC555-Q1 と同じ真理値表に従います。リセット ピン (RESET) を High に設定すると標準的な動作になり、リセット ピンを Low に設定すると、フリップ フロップがリセットされて、出力が強制的に Low になります。TLC3555-Q1 は、RESET から VDD への内部プルアップ抵抗を備えているため、受動部品数を減らし、基板面積を削減できます。

伝搬遅延時間が短く、立ち上がりおよび立ち下がり時間が短いため、TLC3555-Q1 は、NE555 や TLC555-Q1 など従来のタイマよりも高い周波数の非安定動作をサポートしています。TLC3555-Q1 は、電源電圧が 15V の場合、テキサス・インスツルメンツの従来型非安定テスト回路で 3.1MHz のクリーンな方形波を実現します。TLC3555-Q1 を発振器として使用し、出力と入力を互いに接続すると、7.2MHz の発振周波数が得られます。高い周波数での応答は、回路の寄生成分が支配的です。TLC555-Q1 とピン互換の D パッケージに加えて、TLC3555-Q1 は DDF パッケージでも供給されるため、寄生成分を低減しながら簡潔な実装が可能です。

パッケージ情報
部品番号 パッケージ (1) パッケージ サイズ(2)
TLC3555-Q1 D (SOIC、8) 4.9mm × 6.0mm
DDF (SOT-23-THIN、8)(3) 2.9 mm × 2.8mm
(1) 詳細については、セクション 10 を参照してください。
(2) パッケージ サイズ (長さ × 幅) は公称値であり、該当する場合はピンも含まれます。
(3) 事前情報 (量産データではありません)。