JAJSBT2D October   2012  – March 2017 TPS54340

PRODUCTION DATA.  

  1. 特長
  2. アプリケーション
  3. 概要
  4. 改訂履歴
  5. Pin Configuration and Functions
  6. Specifications
    1. 6.1 Absolute Maximum Ratings
    2. 6.2 ESD Ratings
    3. 6.3 Recommended Operating Conditions
    4. 6.4 Thermal Information
    5. 6.5 Electrical Characteristics
    6. 6.6 Timing Requirements
    7. 6.7 Typical Characteristics
  7. Detailed Description
    1. 7.1 Overview
    2. 7.2 Functional Block Diagram
    3. 7.3 Feature Description
      1. 7.3.1  Fixed Frequency PWM Control
      2. 7.3.2  Slope Compensation Output Current
      3. 7.3.3  Pulse Skip Eco-mode
      4. 7.3.4  Low Dropout Operation and Bootstrap Voltage (BOOT)
      5. 7.3.5  Error Amplifier
      6. 7.3.6  Adjusting the Output Voltage
      7. 7.3.7  Enable and Adjusting Undervoltage Lockout
      8. 7.3.8  Internal Soft-Start
      9. 7.3.9  Constant Switching Frequency and Timing Resistor (RT/CLK) Terminal)
      10. 7.3.10 Accurate Current Limit Operation and Maximum Switching Frequency
      11. 7.3.11 Synchronization to RT/CLKTerminal
      12. 7.3.12 Overvoltage Protection
      13. 7.3.13 Thermal Shutdown
      14. 7.3.14 Small Signal Model for Loop Response
      15. 7.3.15 Simple Small Signal Model for Peak Current Mode Control
      16. 7.3.16 Small Signal Model for Frequency Compensation
    4. 7.4 Device Functional Modes
      1. 7.4.1 Operation with VIN < 4.5 V (Minimum VIN)
      2. 7.4.2 Operation with EN Control
  8. Application and Implementation
    1. 8.1 Application Information
    2. 8.2 Typical Applications
      1. 8.2.1 Buck Converter
        1. 8.2.1.1 Design Requirements
        2. 8.2.1.2 Detailed Design Procedures
          1. 8.2.1.2.1  Custom Design with WEBENCH Tools
          2. 8.2.1.2.2  Selecting the Switching Frequency
          3. 8.2.1.2.3  Output Inductor Selection (LO)
          4. 8.2.1.2.4  Output Capacitor
          5. 8.2.1.2.5  Catch Diode
          6. 8.2.1.2.6  Input Capacitor
          7. 8.2.1.2.7  Bootstrap Capacitor Selection
          8. 8.2.1.2.8  Undervoltage Lockout Set Point
          9. 8.2.1.2.9  Output Voltage and Feedback Resistors Selection
          10. 8.2.1.2.10 Minimum VIN
          11. 8.2.1.2.11 Compensation
          12. 8.2.1.2.12 Discontinuous Conduction Mode and Eco-mode Boundary
          13. 8.2.1.2.13 Power Dissipation
        3. 8.2.1.3 Application Curves
      2. 8.2.2 Inverting Power
      3. 8.2.3 Split Rail Power Supply
    3. 8.3 WEBENCH Power Designer
  9. Power Supply Recommendations
  10. 10Layout
    1. 10.1 Layout Guidelines
    2. 10.2 Layout Example
      1. 10.2.1 Estimated Circuit Area
  11. 11デバイスおよびドキュメントのサポート
    1. 11.1 ドキュメントのサポート
      1. 11.1.1 WEBENCHツールによるカスタム設計
      2. 11.1.2 ドキュメントの更新通知を受け取る方法
      3. 11.1.3 関連資料
    2. 11.2 商標
    3. 11.3 コミュニティ・リソース
    4. 11.4 静電気放電に関する注意事項
    5. 11.5 Glossary
  12. 12メカニカル、パッケージ、および注文情報

パッケージ・オプション

メカニカル・データ(パッケージ|ピン)
サーマルパッド・メカニカル・データ
発注情報

特長

  • 入力範囲4.5V~42V (絶対最大定格45V)
  • 連続電流3.5A、最小ピーク・インダクタ電流制限4.5A
  • 電流モード制御のDC/DCコンバータ
  • 92mΩのハイサイドMOSFET
  • 軽負荷で高い効率を実現するパルス・スキップ Eco-mode™
  • 内蔵のブート再充電FETにより軽負荷時のドロップアウトを低減
  • 動作時の静止電流146μA
  • シャットダウン時電流1μA
  • 固定スイッチング周波数: 100kHz~2.5MHz
  • 外部クロックに同期
  • 調整可能なUVLO電圧およびヒステリシス
  • 内部ソフト・スタート
  • 高精度のサイクル単位電流制限
  • 熱、過電圧、周波数フォールドバック保護
  • 内部基準電圧: 0.8V、1%
  • 8端子のHSOP PowerPAD™パッケージ
  • 動作温度範囲TJ = -40℃~150℃
  • WEBENCH Power Designerにより、TPS54340を使用するカスタム設計を作成

アプリケーション

    12V、24Vの産業用、車載用、通信用電源システム

概要

TPS54340は、ハイサイドMOSFETを内蔵した42V、3.5Aの降圧型レギュレータです。ISO 7637に準拠し、最大45Vの負荷ダンプ・パルスに耐えることができます。電流モード制御により、外部補償が単純化され、柔軟な部品選択が可能になります。低リップルのパルス・スキップ・モードを使用すると、無負荷時の消費電流を146μAまで低減できます。イネーブル・ピンをLowにすると、シャットダウン時消費電流が1μAまで減少します。

低電圧誤動作防止は内部で4.3Vに設定されていますが、イネーブル・ピンを使用してさらに高い電圧に設定することができます。起動時の出力電圧の上昇を内部で制御することにより、オーバーシュートを防ぎます。

スイッチング周波数の範囲が広いため、効率または外部部品のサイズを最適化できます。周波数フォールドバックと過熱シャットダウン機能によって、過負荷状態時に内部部品および外部部品を保護します。

TPS54340は、熱特性が強化された8端子のHSOP PowerPAD™パッケージで供給されます。

製品情報

発注型番 パッケージ 本体サイズ
TPS54340DDA HSOP (8) 4.89mm×3.9mm

spacer

概略回路図

TPS54340 simple_sch_lvsBK0.gif

効率と負荷電流との関係

TPS54340 eff_fron_pg_lvsBK0.gif