JAJSM42C may   2021  – march 2023 TPS629210-Q1

PRODUCTION DATA  

  1. 1 特長
  2. 2 アプリケーション
  3. 3 概要
  4. 4 Revision History
  5. 5 Device Comparison Table
  6. 6 Pin Configuration and Functions
  7. 7 Specifications
    1. 7.1 Absolute Maximum Ratings
    2. 7.2 ESD Ratings
    3. 7.3 Recommended Operating Conditions
    4. 7.4 Thermal Information
    5. 7.5 Thermal Information - DYC Package
    6. 7.6 Electrical Characteristics
    7. 7.7 Typical Characteristics
  8. 8 Detailed Description
    1. 8.1 Overview
    2. 8.2 Functional Block Diagram
    3. 8.3 Feature Description
      1. 8.3.1 Mode Selection and Device Configuration (MODE/S-CONF Pin)
      2. 8.3.2 Adjustable VO Operation (External Voltage Divider)
      3. 8.3.3 Selectable VO Operation (VSET and Internal Voltage Divider)
      4. 8.3.4 Smart Enable with Precise Threshold
      5. 8.3.5 Power Good (PG)
      6. 8.3.6 Output Discharge Function
      7. 8.3.7 Undervoltage Lockout (UVLO)
      8. 8.3.8 Current Limit and Short Circuit Protection
      9. 8.3.9 Thermal Shutdown
    4. 8.4 Device Functional Modes
      1. 8.4.1 Forced Pulse Width Modulation (PWM) Operation
      2. 8.4.2 Power Save Mode Operation (Auto PFM/PWM)
      3. 8.4.3 AEE (Automatic Efficiency Enhancement)
      4. 8.4.4 100% Duty-Cycle Operation
      5. 8.4.5 Starting into a Prebiased Load
  9. 9 Application and Implementation
    1. 9.1 Application Information
    2. 9.2 Typical Application
      1. 9.2.1 Design Requirements
      2. 9.2.2 Detailed Design Procedure
        1. 9.2.2.1 Custom Design With WEBENCH® Tools
        2. 9.2.2.2 Programming the Output Voltage
        3. 9.2.2.3 External Component Selection
          1. 9.2.2.3.1 Output Filter and Loop Stability
          2. 9.2.2.3.2 Inductor Selection
          3. 9.2.2.3.3 Capacitor Selection
            1. 9.2.2.3.3.1 Output Capacitor
            2. 9.2.2.3.3.2 Input Capacitor
      3. 9.2.3 Application Curves
    3. 9.3 System Examples
      1. 9.3.1 Powering Multiple Loads
      2. 9.3.2 Inverting Buck-Boost (IBB)
    4. 9.4 Power Supply Recommendations
    5. 9.5 Layout
      1. 9.5.1 Layout Guidelines
      2. 9.5.2 Layout Example
      3. 9.5.3 Thermal Considerations
  10. 10Device and Documentation Support
    1. 10.1 Device Support
      1. 10.1.1 サード・パーティ製品に関する免責事項
      2. 10.1.2 Development Support
        1. 10.1.2.1 Custom Design With WEBENCH® Tools
    2. 10.2 Documentation Support
      1. 10.2.1 Related Documentation
    3. 10.3 ドキュメントの更新通知を受け取る方法
    4. 10.4 サポート・リソース
    5. 10.5 Trademarks
    6. 10.6 静電気放電に関する注意事項
    7. 10.7 用語集
  11. 11Mechanical, Packaging, and Orderable Information

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

3 概要

車載用認定済みの TPS6292xx-Q1 デバイス・ファミリは、高効率かつ小型で非常に柔軟性が高く、使いやすい同期整流式降圧 DC/DC コンバータです。入力電圧範囲が 3V～17V と広いため、12V、5V、3.3V の電源レールまたはシングル・セル / マルチセル・リチウムイオン・バッテリで動作する各種システムに対応できます。TPS629210-Q1 は、2.5MHz または 1MHz の強制 PWM モードまたは可変周波数 (自動 PFM) モードで動作するように構成できます。自動 PFM モードでは、軽負荷になると自動的にパワーセーブ・モードに移行して高い効率を維持します。静止電流が 4µA (代表値) と低いことも、最小の負荷まで高い効率が得られる理由です。テキサス・インスツルメンツの自動効率拡張 (AEE) モードを使うと、入力と出力の電圧に基づいてスイッチング周波数が自動的に調整されるため、同じインダクタを使っても動作範囲全域で高い変換効率を維持できます。MODE/S-CONF 入力ピンは、スイッチング周波数の挙動の選択に加えて、外部および内部帰還分圧器の各種組み合わせと出力電圧放電機能のイネーブル / ディセーブルの選択にも使えます。内部帰還構成では、FB/VSET ピンと GND の間に接続する抵抗の値によって 18 種類の出力電圧を選択できます (表 8-2 を参照)。

パッケージ情報
部品番号 パッケージ(1) 本体サイズ (公称)
TPS629210-Q1 DRL (SOT-5X3、8) 1.60mm × 2.10mm (ピンを含む)
TPS629210-Q1 DYC (SOT-5X3、8) 1.60mm × 2.10mm (ピンを含む)
(1) 利用可能なすべてのパッケージについては、このデータシートの末尾にある注文情報を参照してください。
GUID-20210614-CA0I-QTHN-57JK-RBPCRCJ8Q778-low.svg簡略回路図
GUID-20211108-SS0I-LQWD-L8PP-VNMQ0K9VNTVL-low.svg効率と出力電流との関係
VOUT = 3.3V (2.5MHz 自動 PFM/PWM)